[ARM] Assembler and disassembler support Dot Product Extension

  This patch add assembler and disassembler support for new Dot Product
  Extension.

  The support can be enabled through the new "+dotprod" extension.

include/
	* opcode/arm.h (FPU_NEON_EXT_DOTPROD): New macro.
	(FPU_ARCH_DOTPROD_NEON_VFP_ARMV8): New macro.

gas/
	* config/tc-arm.c (fpu_neon_ext_dotprod): New variable.
	(neon_scalar_for_mul): Improve comments.
	(do_neon_dotproduct): New function to encode Dot Product instructions.
	(do_neon_dotproduct_s): Wrapper function for signed Dot Product
	instructions.
	(do_neon_dotproduct_u): Wrapper function for unsigned Dot Product
	instructions.
	(insns): New entries for vsdot and vudot.
	(arm_extensions): New entry for "dotprod".
	* doc/c-arm.texi: Document new "dotprod" extension.
	* testsuite/gas/arm/dotprod.s: New test source.
	* testsuite/gas/arm/dotprod-illegal.s: New test source.
	* testsuite/gas/arm/dotprod.d: New test.
	* testsuite/gas/arm/dotprod-thumb2.d: New test.
	* testsuite/gas/arm/dotprod-illegal.d: New test.
	* testsuite/gas/arm/dotprod-legacy-arch.d: New test.
	* testsuite/gas/arm/dotprod-illegal.l: New error file.
	* testsuite/gas/arm/dotprod-legacy-arch.l: New error file.

opcodes/
	* arm-dis.c (coprocessor_opcodes): New entries for vsdot and vudot.

8 files changed, 672 insertions, 0 deletions

diff --git a/gas/testsuite/gas/arm/dotprod-illegal.d b/gas/testsuite/gas/arm/dotprod-illegal.d
new file mode 100644
index 0000000..f75450c
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod-illegal.d
@@ -0,0 +1,2 @@
+#as: -march=armv8.2-a+dotprod -mfpu=neon-fp-armv8
+#error-output: dotprod-illegal.l
diff --git a/gas/testsuite/gas/arm/dotprod-illegal.l b/gas/testsuite/gas/arm/dotprod-illegal.l
new file mode 100644
index 0000000..5b88bc3
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod-illegal.l
@@ -0,0 +1,10 @@
+[^:]*: Assembler messages:
+[^:]*:4: Error: bad type in Neon instruction -- `vudot.s8 d0,d2,d5'
+[^:]*:6: Error: bad type in Neon instruction -- `vudot.u16 d0,d2,d5'
+[^:]*:7: Error: bad type in Neon instruction -- `vsdot.s16 d1,d12,d18'
+[^:]*:9: Error: bad type in Neon instruction -- `vudot.u32 d2,d22,d1'
+[^:]*:10: Error: bad type in Neon instruction -- `vsdot.s32 d3,d30,d9'
+[^:]*:12: Error: scalar out of range for multiply instruction -- `vudot.u8 d31,d2,d16\[0\]'
+[^:]*:13: Error: scalar out of range for multiply instruction -- `vsdot.s8 q13,q14,d22\[1\]'
+[^:]*:15: Error: scalar out of range for multiply instruction -- `vudot.u8 d1,d8,d15\[2\]'
+[^:]*:16: Error: scalar out of range for multiply instruction -- `vsdot.s8 q14,q7,d15\[3\]'
diff --git a/gas/testsuite/gas/arm/dotprod-illegal.s b/gas/testsuite/gas/arm/dotprod-illegal.s
new file mode 100644
index 0000000..8b78591
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod-illegal.s
@@ -0,0 +1,16 @@
+	.text
+func:
+	# name and suffix mismatch.
+	vudot.s8	d0, d2, d5
+	# No .*16 suffix support.
+	vudot.u16	d0, d2, d5
+	vsdot.s16	d1, d12, d18
+	# No .*32 suffix support.
+	vudot.u32	d2, d22, d1
+	vsdot.s32	d3, d30, d9
+	# Scalar base register out of bound
+	vudot.u8	d31, d2, d16[0]
+	vsdot.s8	q13, q14, d22[1]
+	# Scalar index out of bound
+	vudot.u8	d1, d8, d15[2]
+	vsdot.s8	q14, q7, d15[3]
diff --git a/gas/testsuite/gas/arm/dotprod-legacy-arch.d b/gas/testsuite/gas/arm/dotprod-legacy-arch.d
new file mode 100644
index 0000000..9f87503
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod-legacy-arch.d
@@ -0,0 +1,3 @@
+#as: -march=armv8.1-a+dotprod -mfpu=neon-fp-armv8
+#source: dotprod.s
+#error-output: dotprod-legacy-arch.l
diff --git a/gas/testsuite/gas/arm/dotprod-legacy-arch.l b/gas/testsuite/gas/arm/dotprod-legacy-arch.l
new file mode 100644
index 0000000..a627a36
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod-legacy-arch.l
@@ -0,0 +1,3 @@
+Assembler messages:
+[^:]*: extension does not apply to the base architecture
+[^:]*: unrecognized option -march=armv8.1-a\+dotprod
diff --git a/gas/testsuite/gas/arm/dotprod-thumb2.d b/gas/testsuite/gas/arm/dotprod-thumb2.d
new file mode 100644
index 0000000..9b558a6
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod-thumb2.d
@@ -0,0 +1,297 @@
+#as: -march=armv8.2-a+dotprod -mfpu=neon-fp-armv8 -mthumb
+#source: dotprod.s
+#objdump: -d
+
+.*: +file format .*arm.*
+
+Disassembly of section .text:
+
+.* <.*>:
+.*:	fc22 0d10 	vudot.u8	d0, d2, d0
+.*:	fe22 0d10 	vudot.u8	d0, d2, d0\[0\]
+.*:	fc22 0d18 	vudot.u8	d0, d2, d8
+.*:	fe22 0d18 	vudot.u8	d0, d2, d8\[0\]
+.*:	fc22 0d1f 	vudot.u8	d0, d2, d15
+.*:	fe22 0d1f 	vudot.u8	d0, d2, d15\[0\]
+.*:	fc2f 0d10 	vudot.u8	d0, d15, d0
+.*:	fe2f 0d10 	vudot.u8	d0, d15, d0\[0\]
+.*:	fc2f 0d18 	vudot.u8	d0, d15, d8
+.*:	fe2f 0d18 	vudot.u8	d0, d15, d8\[0\]
+.*:	fc2f 0d1f 	vudot.u8	d0, d15, d15
+.*:	fe2f 0d1f 	vudot.u8	d0, d15, d15\[0\]
+.*:	fc2e 0d90 	vudot.u8	d0, d30, d0
+.*:	fe2e 0d90 	vudot.u8	d0, d30, d0\[0\]
+.*:	fc2e 0d98 	vudot.u8	d0, d30, d8
+.*:	fe2e 0d98 	vudot.u8	d0, d30, d8\[0\]
+.*:	fc2e 0d9f 	vudot.u8	d0, d30, d15
+.*:	fe2e 0d9f 	vudot.u8	d0, d30, d15\[0\]
+.*:	fc22 7d10 	vudot.u8	d7, d2, d0
+.*:	fe22 7d10 	vudot.u8	d7, d2, d0\[0\]
+.*:	fc22 7d18 	vudot.u8	d7, d2, d8
+.*:	fe22 7d18 	vudot.u8	d7, d2, d8\[0\]
+.*:	fc22 7d1f 	vudot.u8	d7, d2, d15
+.*:	fe22 7d1f 	vudot.u8	d7, d2, d15\[0\]
+.*:	fc2f 7d10 	vudot.u8	d7, d15, d0
+.*:	fe2f 7d10 	vudot.u8	d7, d15, d0\[0\]
+.*:	fc2f 7d18 	vudot.u8	d7, d15, d8
+.*:	fe2f 7d18 	vudot.u8	d7, d15, d8\[0\]
+.*:	fc2f 7d1f 	vudot.u8	d7, d15, d15
+.*:	fe2f 7d1f 	vudot.u8	d7, d15, d15\[0\]
+.*:	fc2e 7d90 	vudot.u8	d7, d30, d0
+.*:	fe2e 7d90 	vudot.u8	d7, d30, d0\[0\]
+.*:	fc2e 7d98 	vudot.u8	d7, d30, d8
+.*:	fe2e 7d98 	vudot.u8	d7, d30, d8\[0\]
+.*:	fc2e 7d9f 	vudot.u8	d7, d30, d15
+.*:	fe2e 7d9f 	vudot.u8	d7, d30, d15\[0\]
+.*:	fc62 0d10 	vudot.u8	d16, d2, d0
+.*:	fe62 0d10 	vudot.u8	d16, d2, d0\[0\]
+.*:	fc62 0d18 	vudot.u8	d16, d2, d8
+.*:	fe62 0d18 	vudot.u8	d16, d2, d8\[0\]
+.*:	fc62 0d1f 	vudot.u8	d16, d2, d15
+.*:	fe62 0d1f 	vudot.u8	d16, d2, d15\[0\]
+.*:	fc6f 0d10 	vudot.u8	d16, d15, d0
+.*:	fe6f 0d10 	vudot.u8	d16, d15, d0\[0\]
+.*:	fc6f 0d18 	vudot.u8	d16, d15, d8
+.*:	fe6f 0d18 	vudot.u8	d16, d15, d8\[0\]
+.*:	fc6f 0d1f 	vudot.u8	d16, d15, d15
+.*:	fe6f 0d1f 	vudot.u8	d16, d15, d15\[0\]
+.*:	fc6e 0d90 	vudot.u8	d16, d30, d0
+.*:	fe6e 0d90 	vudot.u8	d16, d30, d0\[0\]
+.*:	fc6e 0d98 	vudot.u8	d16, d30, d8
+.*:	fe6e 0d98 	vudot.u8	d16, d30, d8\[0\]
+.*:	fc6e 0d9f 	vudot.u8	d16, d30, d15
+.*:	fe6e 0d9f 	vudot.u8	d16, d30, d15\[0\]
+.*:	fc62 fd10 	vudot.u8	d31, d2, d0
+.*:	fe62 fd10 	vudot.u8	d31, d2, d0\[0\]
+.*:	fc62 fd18 	vudot.u8	d31, d2, d8
+.*:	fe62 fd18 	vudot.u8	d31, d2, d8\[0\]
+.*:	fc62 fd1f 	vudot.u8	d31, d2, d15
+.*:	fe62 fd1f 	vudot.u8	d31, d2, d15\[0\]
+.*:	fc6f fd10 	vudot.u8	d31, d15, d0
+.*:	fe6f fd10 	vudot.u8	d31, d15, d0\[0\]
+.*:	fc6f fd18 	vudot.u8	d31, d15, d8
+.*:	fe6f fd18 	vudot.u8	d31, d15, d8\[0\]
+.*:	fc6f fd1f 	vudot.u8	d31, d15, d15
+.*:	fe6f fd1f 	vudot.u8	d31, d15, d15\[0\]
+.*:	fc6e fd90 	vudot.u8	d31, d30, d0
+.*:	fe6e fd90 	vudot.u8	d31, d30, d0\[0\]
+.*:	fc6e fd98 	vudot.u8	d31, d30, d8
+.*:	fe6e fd98 	vudot.u8	d31, d30, d8\[0\]
+.*:	fc6e fd9f 	vudot.u8	d31, d30, d15
+.*:	fe6e fd9f 	vudot.u8	d31, d30, d15\[0\]
+.*:	fc22 0d00 	vsdot.s8	d0, d2, d0
+.*:	fe22 0d00 	vsdot.s8	d0, d2, d0\[0\]
+.*:	fc22 0d08 	vsdot.s8	d0, d2, d8
+.*:	fe22 0d08 	vsdot.s8	d0, d2, d8\[0\]
+.*:	fc22 0d0f 	vsdot.s8	d0, d2, d15
+.*:	fe22 0d0f 	vsdot.s8	d0, d2, d15\[0\]
+.*:	fc2f 0d00 	vsdot.s8	d0, d15, d0
+.*:	fe2f 0d00 	vsdot.s8	d0, d15, d0\[0\]
+.*:	fc2f 0d08 	vsdot.s8	d0, d15, d8
+.*:	fe2f 0d08 	vsdot.s8	d0, d15, d8\[0\]
+.*:	fc2f 0d0f 	vsdot.s8	d0, d15, d15
+.*:	fe2f 0d0f 	vsdot.s8	d0, d15, d15\[0\]
+.*:	fc2e 0d80 	vsdot.s8	d0, d30, d0
+.*:	fe2e 0d80 	vsdot.s8	d0, d30, d0\[0\]
+.*:	fc2e 0d88 	vsdot.s8	d0, d30, d8
+.*:	fe2e 0d88 	vsdot.s8	d0, d30, d8\[0\]
+.*:	fc2e 0d8f 	vsdot.s8	d0, d30, d15
+.*:	fe2e 0d8f 	vsdot.s8	d0, d30, d15\[0\]
+.*:	fc22 7d00 	vsdot.s8	d7, d2, d0
+.*:	fe22 7d00 	vsdot.s8	d7, d2, d0\[0\]
+.*:	fc22 7d08 	vsdot.s8	d7, d2, d8
+.*:	fe22 7d08 	vsdot.s8	d7, d2, d8\[0\]
+.*:	fc22 7d0f 	vsdot.s8	d7, d2, d15
+.*:	fe22 7d0f 	vsdot.s8	d7, d2, d15\[0\]
+.*:	fc2f 7d00 	vsdot.s8	d7, d15, d0
+.*:	fe2f 7d00 	vsdot.s8	d7, d15, d0\[0\]
+.*:	fc2f 7d08 	vsdot.s8	d7, d15, d8
+.*:	fe2f 7d08 	vsdot.s8	d7, d15, d8\[0\]
+.*:	fc2f 7d0f 	vsdot.s8	d7, d15, d15
+.*:	fe2f 7d0f 	vsdot.s8	d7, d15, d15\[0\]
+.*:	fc2e 7d80 	vsdot.s8	d7, d30, d0
+.*:	fe2e 7d80 	vsdot.s8	d7, d30, d0\[0\]
+.*:	fc2e 7d88 	vsdot.s8	d7, d30, d8
+.*:	fe2e 7d88 	vsdot.s8	d7, d30, d8\[0\]
+.*:	fc2e 7d8f 	vsdot.s8	d7, d30, d15
+.*:	fe2e 7d8f 	vsdot.s8	d7, d30, d15\[0\]
+.*:	fc62 0d00 	vsdot.s8	d16, d2, d0
+.*:	fe62 0d00 	vsdot.s8	d16, d2, d0\[0\]
+.*:	fc62 0d08 	vsdot.s8	d16, d2, d8
+.*:	fe62 0d08 	vsdot.s8	d16, d2, d8\[0\]
+.*:	fc62 0d0f 	vsdot.s8	d16, d2, d15
+.*:	fe62 0d0f 	vsdot.s8	d16, d2, d15\[0\]
+.*:	fc6f 0d00 	vsdot.s8	d16, d15, d0
+.*:	fe6f 0d00 	vsdot.s8	d16, d15, d0\[0\]
+.*:	fc6f 0d08 	vsdot.s8	d16, d15, d8
+.*:	fe6f 0d08 	vsdot.s8	d16, d15, d8\[0\]
+.*:	fc6f 0d0f 	vsdot.s8	d16, d15, d15
+.*:	fe6f 0d0f 	vsdot.s8	d16, d15, d15\[0\]
+.*:	fc6e 0d80 	vsdot.s8	d16, d30, d0
+.*:	fe6e 0d80 	vsdot.s8	d16, d30, d0\[0\]
+.*:	fc6e 0d88 	vsdot.s8	d16, d30, d8
+.*:	fe6e 0d88 	vsdot.s8	d16, d30, d8\[0\]
+.*:	fc6e 0d8f 	vsdot.s8	d16, d30, d15
+.*:	fe6e 0d8f 	vsdot.s8	d16, d30, d15\[0\]
+.*:	fc62 fd00 	vsdot.s8	d31, d2, d0
+.*:	fe62 fd00 	vsdot.s8	d31, d2, d0\[0\]
+.*:	fc62 fd08 	vsdot.s8	d31, d2, d8
+.*:	fe62 fd08 	vsdot.s8	d31, d2, d8\[0\]
+.*:	fc62 fd0f 	vsdot.s8	d31, d2, d15
+.*:	fe62 fd0f 	vsdot.s8	d31, d2, d15\[0\]
+.*:	fc6f fd00 	vsdot.s8	d31, d15, d0
+.*:	fe6f fd00 	vsdot.s8	d31, d15, d0\[0\]
+.*:	fc6f fd08 	vsdot.s8	d31, d15, d8
+.*:	fe6f fd08 	vsdot.s8	d31, d15, d8\[0\]
+.*:	fc6f fd0f 	vsdot.s8	d31, d15, d15
+.*:	fe6f fd0f 	vsdot.s8	d31, d15, d15\[0\]
+.*:	fc6e fd80 	vsdot.s8	d31, d30, d0
+.*:	fe6e fd80 	vsdot.s8	d31, d30, d0\[0\]
+.*:	fc6e fd88 	vsdot.s8	d31, d30, d8
+.*:	fe6e fd88 	vsdot.s8	d31, d30, d8\[0\]
+.*:	fc6e fd8f 	vsdot.s8	d31, d30, d15
+.*:	fe6e fd8f 	vsdot.s8	d31, d30, d15\[0\]
+.*:	fc24 0d50 	vudot.u8	q0, q2, q0
+.*:	fe24 0d70 	vudot.u8	q0, q2, d0\[1\]
+.*:	fc24 0d5e 	vudot.u8	q0, q2, q7
+.*:	fe24 0d77 	vudot.u8	q0, q2, d7\[1\]
+.*:	fc24 0d7e 	vudot.u8	q0, q2, q15
+.*:	fe24 0d7f 	vudot.u8	q0, q2, d15\[1\]
+.*:	fc26 0d50 	vudot.u8	q0, q3, q0
+.*:	fe26 0d70 	vudot.u8	q0, q3, d0\[1\]
+.*:	fc26 0d5e 	vudot.u8	q0, q3, q7
+.*:	fe26 0d77 	vudot.u8	q0, q3, d7\[1\]
+.*:	fc26 0d7e 	vudot.u8	q0, q3, q15
+.*:	fe26 0d7f 	vudot.u8	q0, q3, d15\[1\]
+.*:	fc2c 0dd0 	vudot.u8	q0, q14, q0
+.*:	fe2c 0df0 	vudot.u8	q0, q14, d0\[1\]
+.*:	fc2c 0dde 	vudot.u8	q0, q14, q7
+.*:	fe2c 0df7 	vudot.u8	q0, q14, d7\[1\]
+.*:	fc2c 0dfe 	vudot.u8	q0, q14, q15
+.*:	fe2c 0dff 	vudot.u8	q0, q14, d15\[1\]
+.*:	fc24 2d50 	vudot.u8	q1, q2, q0
+.*:	fe24 2d70 	vudot.u8	q1, q2, d0\[1\]
+.*:	fc24 2d5e 	vudot.u8	q1, q2, q7
+.*:	fe24 2d77 	vudot.u8	q1, q2, d7\[1\]
+.*:	fc24 2d7e 	vudot.u8	q1, q2, q15
+.*:	fe24 2d7f 	vudot.u8	q1, q2, d15\[1\]
+.*:	fc26 2d50 	vudot.u8	q1, q3, q0
+.*:	fe26 2d70 	vudot.u8	q1, q3, d0\[1\]
+.*:	fc26 2d5e 	vudot.u8	q1, q3, q7
+.*:	fe26 2d77 	vudot.u8	q1, q3, d7\[1\]
+.*:	fc26 2d7e 	vudot.u8	q1, q3, q15
+.*:	fe26 2d7f 	vudot.u8	q1, q3, d15\[1\]
+.*:	fc2c 2dd0 	vudot.u8	q1, q14, q0
+.*:	fe2c 2df0 	vudot.u8	q1, q14, d0\[1\]
+.*:	fc2c 2dde 	vudot.u8	q1, q14, q7
+.*:	fe2c 2df7 	vudot.u8	q1, q14, d7\[1\]
+.*:	fc2c 2dfe 	vudot.u8	q1, q14, q15
+.*:	fe2c 2dff 	vudot.u8	q1, q14, d15\[1\]
+.*:	fc24 cd50 	vudot.u8	q6, q2, q0
+.*:	fe24 cd70 	vudot.u8	q6, q2, d0\[1\]
+.*:	fc24 cd5e 	vudot.u8	q6, q2, q7
+.*:	fe24 cd77 	vudot.u8	q6, q2, d7\[1\]
+.*:	fc24 cd7e 	vudot.u8	q6, q2, q15
+.*:	fe24 cd7f 	vudot.u8	q6, q2, d15\[1\]
+.*:	fc26 cd50 	vudot.u8	q6, q3, q0
+.*:	fe26 cd70 	vudot.u8	q6, q3, d0\[1\]
+.*:	fc26 cd5e 	vudot.u8	q6, q3, q7
+.*:	fe26 cd77 	vudot.u8	q6, q3, d7\[1\]
+.*:	fc26 cd7e 	vudot.u8	q6, q3, q15
+.*:	fe26 cd7f 	vudot.u8	q6, q3, d15\[1\]
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+.*:	fc6c adc0 	vsdot.s8	q13, q14, q0
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+.*:	fe6c adef 	vsdot.s8	q13, q14, d15\[1\]
diff --git a/gas/testsuite/gas/arm/dotprod.d b/gas/testsuite/gas/arm/dotprod.d
new file mode 100644
index 0000000..c927f0b
--- /dev/null
+++ b/gas/testsuite/gas/arm/dotprod.d
@@ -0,0 +1,297 @@
+#no fpu options passed, we expect dotprod to imply simd+fp
+#as: -march=armv8.2-a+dotprod
+#objdump: -d
+
+.*: +file format .*arm.*
+
+Disassembly of section .text:
+
+.* <.*>:
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+.*:	fe2f0d10 	vudot.u8	d0, d15, d0\[0\]
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+.*:	fe2f0d18 	vudot.u8	d0, d15, d8\[0\]
+.*:	fc2f0d1f 	vudot.u8	d0, d15, d15
+.*:	fe2f0d1f 	vudot.u8	d0, d15, d15\[0\]
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+.*:	fe2e0d90 	vudot.u8	d0, d30, d0\[0\]
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+.*:	fe227d10 	vudot.u8	d7, d2, d0\[0\]
+.*:	fc227d18 	vudot.u8	d7, d2, d8
+.*:	fe227d18 	vudot.u8	d7, d2, d8\[0\]
+.*:	fc227d1f 	vudot.u8	d7, d2, d15
+.*:	fe227d1f 	vudot.u8	d7, d2, d15\[0\]
+.*:	fc2f7d10 	vudot.u8	d7, d15, d0
+.*:	fe2f7d10 	vudot.u8	d7, d15, d0\[0\]
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+.*:	fe2f7d18 	vudot.u8	d7, d15, d8\[0\]
+.*:	fc2f7d1f 	vudot.u8	d7, d15, d15
+.*:	fe2f7d1f 	vudot.u8	d7, d15, d15\[0\]
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+.*:	fe227d0f 	vsdot.s8	d7, d2, d15\[0\]
+.*:	fc2f7d00 	vsdot.s8	d7, d15, d0
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diff --git a/gas/testsuite/gas/arm/dotprod.s b/gas/testsuite/gas/arm/dotprod.s
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+		dotprod_q_iter_d_n \op, \d, \n
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+	.endm
+
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