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author | Alexandre Oliva <aoliva@redhat.com> | 2004-06-26 22:18:18 +0000 |
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committer | Alexandre Oliva <aoliva@redhat.com> | 2004-06-26 22:18:18 +0000 |
commit | c76b4bab300417fcc0c430f6a6609c0bbec123b0 (patch) | |
tree | 78f35f06a86e32ec69464a0cf8fcf0f9fcdc8a37 /sim/mn10300/mn10300.igen | |
parent | 489503ee33210714338f1f5f3320360990f0358b (diff) | |
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2000-08-07 Graham Stott <grahams@cygnus.co.uk>
* am33-2.igen (fmadd, fmsub, fmnadd, fmnsub): Correct typo.
2000-05-29 Alexandre Oliva <aoliva@cygnus.com>
* interp.c (fpu_disabled_exception, fpu_unimp_exception,
fpu_check_signal_exception): Take additional state arguments.
Print exception type and call program_interrupt. Adjust callers.
(fpu_rsqrt, fpu_cmp, fpu_add, fpu_sub, fpu_mul, fpu_div,
fpu_fmadd, fpu_fmsub, fpu_fnmadd, fpu_fnmsub): Take additional
arguments.
* mn10300_sim.h (fpu_disabled_exception, fpu_unimp_exception,
fpu_check_signal_exception): Adjust prototypes.
(fpu_rsqrt, fpu_cmp, fpu_add, fpu_sub, fpu_mul, fpu_div,
fpu_fmadd, fpu_fmsub, fpu_fnmadd, fpu_fnmsub): Likewise.
* am33-2.igen: Adjust calls.
2000-05-19 Alexandre Oliva <aoliva@cygnus.com>
* op_utils.c (cmp2fcc): Moved...
* interp.c: ... here.
2000-05-18 Alexandre Oliva <aoliva@cygnus.com>
* am33-2.igen: Use `unsigned32', `signed32', `unsigned64' or
`signed64' where type width is relevant.
2000-05-15 Alexandre Oliva <aoliva@cygnus.com>
* mn10300_sim.h: Include sim-fpu.h.
(FD2FPU, FPU2FD): Enclose the FD argument in parentheses.
(fpu_check_signal_exception): Declare.
(struct fp_prec_t, fp_single_prec, fp_double_prec): Likewise.
(FP_SINGLE, FP_DOUBLE): Shorthands for fp_*_prec.
(fpu_rsqrt, fpu_cmp, fpu_add, fpu_sub, fpu_mul, fpu_div,
fpu_fmadd, fpu_fmsub, fpu_fnmadd, fpu_fnmsub): Declare.
* interp.c (fpu_disabled_exception): Document.
(fpu_unimp_exception): Likewise.
(fpu_check_signal_exception): Define.
(reg2val_32, round_32, val2reg_32, fp_single_prec): Likewise.
(reg2val_64, round_64, val2reg_64, fp_double_prec): Likewise.
(REG2VAL, ROUND, VAL2REG): Define shorthands.
(fpu_status_ok): Define.
(fpu_rsqrt, fpu_cmp, fpu_add, fpu_sub, fpu_mul, fpu_div,
fpu_fmadd, fpu_fmsub, fpu_fnmadd, fpu_fnmsub): Define.
* am33-2.igen (frsqrt, fcmp, fadd, fsub, fmul, fdiv,
fmadd, fmsub, fnmadd, fnmsub): Use new functions.
2000-04-27 Alexandre Oliva <aoliva@cygnus.com>
* interp.c (sim_create_inferior): Set PSW bit to enable FP insns
if architecture is AM33/2.0.
* am33.igen: Include am33-2.igen.
2000-04-23 Alexandre Oliva <aoliva@cygnus.com>
* mn10300.igen (movm, call, ret, retf): Check for am33_2 too.
* am33.igen (movm): Likewise.
2000-04-19 Alexandre Oliva <aoliva@cygnus.com>
* am33.igen: Added `*am33_2' to some instructions that were
missing it.
2000-04-07 Alexandre Oliva <aoliva@cygnus.com>
* am33-2.igen: New file. All insns implemented, but FP flags are
only set for fcmp, exceptional conditions are not handled yet.
* Makefile.in (IGEN_INSN): Added am33-2.igen.
(tmp-igen): Added -M am33_2.
* mn10300.igen, am33.igen: Added `*am33_2' to all insns.
* gencode.c: Support FMT_D3.
* mn10300_sim.h (dword): New type.
(struct _state): Added fpregs.
(REG_FPCR, FPCR): New define. All assorted bitmaps.
(XS2FS, AS2FS, Xf2FD): New macros.
(FS2FPU, FD2FPU, FPU2FS, FPU2FD): Likewise.
(load_dword, store_dword): New functions or macros.
(u642dw, dw2u64): New functions.
(fpu_disabled_exception, fpu_unimp_exception): Declared.
* interp.c (fpu_disabled_exception): Defined; no actual
implementation.
(fpu_unimp_exception): Likewise.
* op_utils.c (cmp2fcc): New function.
Diffstat (limited to 'sim/mn10300/mn10300.igen')
-rw-r--r-- | sim/mn10300/mn10300.igen | 241 |
1 files changed, 241 insertions, 0 deletions
diff --git a/sim/mn10300/mn10300.igen b/sim/mn10300/mn10300.igen index b0ab89f..c7b83ed 100644 --- a/sim/mn10300/mn10300.igen +++ b/sim/mn10300/mn10300.igen @@ -4,6 +4,7 @@ :option:::hi-bit-nr:7 :model:::mn10300:mn10300: :model:::am33:am33: +:model:::am33_2:am33_2: // What do we do with an illegal instruction? :internal::::illegal: @@ -17,6 +18,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_8000 (); */ signed32 immed = EXTEND8 (IMM8); @@ -29,6 +31,7 @@ "mov" *mn10300 *am33 +*am33_2 { PC = cia; /* OP_80 (); */ @@ -41,6 +44,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F1E0 (); */ PC = cia; @@ -53,6 +57,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F1D0 (); */ PC = cia; @@ -65,6 +70,7 @@ "mov" *mn10300 *am33 +*am33_2 { PC = cia; /* OP_9000 (); */ @@ -77,6 +83,7 @@ "mov" *mn10300 *am33 +*am33_2 { PC = cia; /* OP_90 (); */ @@ -89,6 +96,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_3C (); */ PC = cia; @@ -101,6 +109,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F2F0 (); */ PC = cia; @@ -113,6 +122,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F2E4 (); */ PC = cia; @@ -125,6 +135,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F2F3 (); */ PC = cia; @@ -137,6 +148,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F2E0 (); */ PC = cia; @@ -149,6 +161,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F2F2 (); */ PC = cia; @@ -161,6 +174,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_70 (); */ PC = cia; @@ -173,6 +187,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F80000 (); */ PC = cia; @@ -186,6 +201,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FA000000 (); */ PC = cia; @@ -199,6 +215,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FC000000 (); */ PC = cia; @@ -213,6 +230,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_5800 (); */ PC = cia; @@ -225,6 +243,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FAB40000 (); */ PC = cia; @@ -238,6 +257,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FCB40000 (); */ PC = cia; @@ -251,6 +271,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F300 (); */ PC = cia; @@ -264,6 +285,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_300000 (); */ PC = cia; @@ -275,6 +297,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FCA40000 (); */ PC = cia; @@ -287,6 +310,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F000 (); */ PC = cia; @@ -299,6 +323,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F82000 (); */ PC = cia; @@ -312,6 +337,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FA200000 (); */ PC = cia; @@ -326,6 +352,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FC200000 (); */ PC = cia; @@ -340,6 +367,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_5C00 (); */ PC = cia; @@ -353,6 +381,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FAB00000 (); */ PC = cia; @@ -366,6 +395,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FCB00000 (); */ PC = cia; @@ -380,6 +410,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F380 (); */ PC = cia; @@ -394,6 +425,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FAA00000 (); */ PC = cia; @@ -406,6 +438,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FCA00000 (); */ PC = cia; @@ -419,6 +452,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F8F000 (); */ PC = cia; @@ -432,6 +466,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_60 (); */ PC = cia; @@ -444,6 +479,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F81000 (); */ PC = cia; @@ -457,6 +493,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FA100000 (); */ PC = cia; @@ -470,6 +507,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FC100000 (); */ PC = cia; @@ -484,6 +522,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_4200 (); */ PC = cia; @@ -496,6 +535,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FA910000 (); */ PC = cia; @@ -509,6 +549,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FC910000 (); */ PC = cia; @@ -522,6 +563,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F340 (); */ PC = cia; @@ -535,6 +577,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_10000 (); */ PC = cia; @@ -547,6 +590,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FC810000 (); */ PC = cia; @@ -560,6 +604,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F010 (); */ PC = cia; @@ -572,6 +617,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_F83000 (); */ PC = cia; @@ -585,6 +631,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FA300000 (); */ PC = cia; @@ -598,6 +645,7 @@ "mov" *mn10300 *am33 +*am33_2 { /* OP_FC300000 (); */ PC = cia; @@ -613,6 +661,7 @@ *mn10300 *am33 +*am33_2 { /* OP_4300 (); */ @@ -627,6 +676,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FA900000 (); */ @@ -642,6 +692,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FC900000 (); */ @@ -657,6 +708,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F3C0 (); */ @@ -672,6 +724,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FA800000 (); */ @@ -687,6 +740,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FC800000 (); */ @@ -702,6 +756,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F8F400 (); */ @@ -717,6 +772,7 @@ *mn10300 *am33 +*am33_2 { /* OP_2C0000 (); */ @@ -734,6 +790,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FCCC0000 (); */ @@ -751,6 +808,7 @@ *mn10300 *am33 +*am33_2 { /* OP_240000 (); */ @@ -768,6 +826,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FCDC0000 (); */ @@ -782,6 +841,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F040 (); */ @@ -797,6 +857,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F84000 (); */ @@ -812,6 +873,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FA400000 (); */ @@ -828,6 +890,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FC400000 (); */ @@ -844,6 +907,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F8B800 (); */ @@ -859,6 +923,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FAB80000 (); */ @@ -875,6 +940,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FCB80000 (); */ @@ -891,6 +957,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F400 (); */ @@ -907,6 +974,7 @@ *mn10300 *am33 +*am33_2 { /* OP_340000 (); */ @@ -921,6 +989,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FCA80000 (); */ @@ -936,6 +1005,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F050 (); */ @@ -950,6 +1020,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F85000 (); */ @@ -965,6 +1036,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FA500000 (); */ @@ -980,6 +1052,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FC500000 (); */ @@ -996,6 +1069,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F89200 (); */ @@ -1010,6 +1084,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FA920000 (); */ @@ -1025,6 +1100,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FC920000 (); */ @@ -1040,6 +1116,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F440 (); */ @@ -1055,6 +1132,7 @@ *mn10300 *am33 +*am33_2 { /* OP_20000 (); */ @@ -1070,6 +1148,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FC820000 (); */ @@ -1085,6 +1164,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F060 (); */ @@ -1100,6 +1180,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F86000 (); */ @@ -1115,6 +1196,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FA600000 (); */ @@ -1131,6 +1213,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FC600000 (); */ @@ -1147,6 +1230,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F8BC00 (); */ @@ -1162,6 +1246,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FABC0000 (); */ @@ -1177,6 +1262,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FCBC0000 (); */ @@ -1192,6 +1278,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F480 (); */ @@ -1207,6 +1294,7 @@ *mn10300 *am33 +*am33_2 { /* OP_380000 (); */ @@ -1221,6 +1309,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FCAC0000 (); */ @@ -1236,6 +1325,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F070 (); */ @@ -1251,6 +1341,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F87000 (); */ @@ -1266,6 +1357,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FA700000 (); */ @@ -1281,6 +1373,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FC700000 (); */ @@ -1297,6 +1390,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F89300 (); 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*/ @@ -1545,6 +1655,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FAC00000 (); */ @@ -1559,6 +1670,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FCC00000 (); */ @@ -1573,6 +1685,7 @@ *mn10300 *am33 +*am33_2 { /* OP_2000 (); */ @@ -1587,6 +1700,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FAD00000 (); */ @@ -1601,6 +1715,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FCD00000 (); */ @@ -1615,6 +1730,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F8FE00 (); */ @@ -1633,6 +1749,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FAFE0000 (); */ @@ -1651,6 +1768,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FCFE0000 (); */ @@ -1669,6 +1787,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F140 (); */ @@ -1699,6 +1818,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F100 (); */ @@ -1712,6 +1832,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F120 (); */ @@ -1726,6 +1847,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F110 (); */ @@ -1740,6 +1862,7 @@ *mn10300 *am33 +*am33_2 { /* OP_F130 (); */ @@ -1754,6 +1877,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FCC40000 (); */ @@ -1768,6 +1892,7 @@ *mn10300 *am33 +*am33_2 { /* OP_FCD40000 (); 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