bfd/

    * elf32-arm.c (arm_stub_required_alignment): New.
    (arm_build_one_stub): Use above to partition stubs.
    (make_branch_to_a8_stub): Use arm_stub_a8_veneer_lwm not
    arm_stub_a8_veneer_b_cond.

    ld/testsuite/
    * ld-arm/arm-elf.exp (armelftests): Add cortex-a8-fix-blx-bcond.s.
    * ld-arm/cortex-a8-fix-blx-bcond.s: New.
    * ld-arm/cortex-a8-fix-blx-bcond.d: New.

4 files changed, 1198 insertions, 0 deletions

diff --git a/ld/testsuite/ChangeLog b/ld/testsuite/ChangeLog
index eeed7da..85063c3 100644
--- a/ld/testsuite/ChangeLog
+++ b/ld/testsuite/ChangeLog
@@ -1,3 +1,9 @@
+2010-08-25  Julian Brown  <julian@codesourcery.com>
+
+	* ld-arm/arm-elf.exp (armelftests): Add cortex-a8-fix-blx-bcond.s.
+	* ld-arm/cortex-a8-fix-blx-bcond.s: New.
+	* ld-arm/cortex-a8-fix-blx-bcond.d: New.
+
 2010-08-24  H.J. Lu  <hongjiu.lu@intel.com>
 
 	* ld-x86-64/x86-64.exp: Fix typos.
diff --git a/ld/testsuite/ld-arm/arm-elf.exp b/ld/testsuite/ld-arm/arm-elf.exp
index c23da54..ef5f0f4 100644
--- a/ld/testsuite/ld-arm/arm-elf.exp
+++ b/ld/testsuite/ld-arm/arm-elf.exp
@@ -221,6 +221,10 @@ set armelftests {
      "-EL -mcpu=cortex-a8" {cortex-a8-fix-hdr.s}
      {{objdump -dr cortex-a8-fix-hdr.d}}
      "cortex-a8-fix-hdr"}
+    {"Cortex-A8 erratum fix, blx.w and b<cond>.w together"
+     "-EL -Ttext=0x8f00 --fix-cortex-a8" "-EL" {cortex-a8-fix-blx-bcond.s}
+     {{objdump -dr cortex-a8-fix-blx-bcond.d}}
+     "cortex-a8-fix-blx-bcond"}
     {"Unwinding and -gc-sections" "-gc-sections" "" {gc-unwind.s}
      {{objdump -sj.data gc-unwind.d}}
      "gc-unwind"}
diff --git a/ld/testsuite/ld-arm/cortex-a8-fix-blx-bcond.d b/ld/testsuite/ld-arm/cortex-a8-fix-blx-bcond.d
new file mode 100644
index 0000000..692a606
--- /dev/null
+++ b/ld/testsuite/ld-arm/cortex-a8-fix-blx-bcond.d
@@ -0,0 +1,1107 @@
+
+.*:     file format .*
+
+
+Disassembly of section \.text:
+
+00008f00 <_start>:
+    8f00:	bf00      	nop
+    8f02:	eb01 0002 	add\.w	r0, r1, r2
+    8f06:	f47f affc 	bne\.w	8f02 <_start\+0x2>
+    8f0a:	eb01 0002 	add\.w	r0, r1, r2
+    8f0e:	f47f aff8 	bne\.w	8f02 <_start\+0x2>
+    8f12:	eb01 0002 	add\.w	r0, r1, r2
+    8f16:	f47f aff4 	bne\.w	8f02 <_start\+0x2>
+    8f1a:	eb01 0002 	add\.w	r0, r1, r2
+    8f1e:	f47f aff0 	bne\.w	8f02 <_start\+0x2>
+    8f22:	eb01 0002 	add\.w	r0, r1, r2
+    8f26:	f47f affc 	bne\.w	8f22 <_start\+0x22>
+    8f2a:	eb01 0002 	add\.w	r0, r1, r2
+    8f2e:	f47f aff8 	bne\.w	8f22 <_start\+0x22>
+    8f32:	eb01 0002 	add\.w	r0, r1, r2
+    8f36:	f47f aff4 	bne\.w	8f22 <_start\+0x22>
+    8f3a:	eb01 0002 	add\.w	r0, r1, r2
+    8f3e:	f47f aff0 	bne\.w	8f22 <_start\+0x22>
+    8f42:	eb01 0002 	add\.w	r0, r1, r2
+    8f46:	f47f affc 	bne\.w	8f42 <_start\+0x42>
+    8f4a:	eb01 0002 	add\.w	r0, r1, r2
+    8f4e:	f47f aff8 	bne\.w	8f42 <_start\+0x42>
+    8f52:	eb01 0002 	add\.w	r0, r1, r2
+    8f56:	f47f aff4 	bne\.w	8f42 <_start\+0x42>
+    8f5a:	eb01 0002 	add\.w	r0, r1, r2
+    8f5e:	f47f aff0 	bne\.w	8f42 <_start\+0x42>
+    8f62:	eb01 0002 	add\.w	r0, r1, r2
+    8f66:	f47f affc 	bne\.w	8f62 <_start\+0x62>
+    8f6a:	eb01 0002 	add\.w	r0, r1, r2
+    8f6e:	f47f aff8 	bne\.w	8f62 <_start\+0x62>
+    8f72:	eb01 0002 	add\.w	r0, r1, r2
+    8f76:	f47f aff4 	bne\.w	8f62 <_start\+0x62>
+    8f7a:	eb01 0002 	add\.w	r0, r1, r2
+    8f7e:	f47f aff0 	bne\.w	8f62 <_start\+0x62>
+    8f82:	eb01 0002 	add\.w	r0, r1, r2
+    8f86:	f47f affc 	bne\.w	8f82 <_start\+0x82>
+    8f8a:	eb01 0002 	add\.w	r0, r1, r2
+    8f8e:	f47f aff8 	bne\.w	8f82 <_start\+0x82>
+    8f92:	eb01 0002 	add\.w	r0, r1, r2
+    8f96:	f47f aff4 	bne\.w	8f82 <_start\+0x82>
+    8f9a:	eb01 0002 	add\.w	r0, r1, r2
+    8f9e:	f47f aff0 	bne\.w	8f82 <_start\+0x82>
+    8fa2:	eb01 0002 	add\.w	r0, r1, r2
+    8fa6:	f47f affc 	bne\.w	8fa2 <_start\+0xa2>
+    8faa:	eb01 0002 	add\.w	r0, r1, r2
+    8fae:	f47f aff8 	bne\.w	8fa2 <_start\+0xa2>
+    8fb2:	eb01 0002 	add\.w	r0, r1, r2
+    8fb6:	f47f aff4 	bne\.w	8fa2 <_start\+0xa2>
+    8fba:	eb01 0002 	add\.w	r0, r1, r2
+    8fbe:	f47f aff0 	bne\.w	8fa2 <_start\+0xa2>
+    8fc2:	eb01 0002 	add\.w	r0, r1, r2
+    8fc6:	f47f affc 	bne\.w	8fc2 <_start\+0xc2>
+    8fca:	eb01 0002 	add\.w	r0, r1, r2
+    8fce:	f47f aff8 	bne\.w	8fc2 <_start\+0xc2>
+    8fd2:	eb01 0002 	add\.w	r0, r1, r2
+    8fd6:	f47f aff4 	bne\.w	8fc2 <_start\+0xc2>
+    8fda:	eb01 0002 	add\.w	r0, r1, r2
+    8fde:	f47f aff0 	bne\.w	8fc2 <_start\+0xc2>
+    8fe2:	eb01 0002 	add\.w	r0, r1, r2
+    8fe6:	f47f affc 	bne\.w	8fe2 <_start\+0xe2>
+    8fea:	eb01 0002 	add\.w	r0, r1, r2
+    8fee:	f47f aff8 	bne\.w	8fe2 <_start\+0xe2>
+    8ff2:	eb01 0002 	add\.w	r0, r1, r2
+    8ff6:	f47f aff4 	bne\.w	8fe2 <_start\+0xe2>
+    8ffa:	eb01 0002 	add\.w	r0, r1, r2
+    8ffe:	f001 b805 	b\.w	a00c <bl_insns\+0x10c>
+    9002:	bf00      	nop
+    9004:	f3af 8000 	nop\.w
+    9008:	f3af 8000 	nop\.w
+    900c:	f3af 8000 	nop\.w
+    9010:	f3af 8000 	nop\.w
+    9014:	f3af 8000 	nop\.w
+    9018:	f3af 8000 	nop\.w
+    901c:	f3af 8000 	nop\.w
+    9020:	f3af 8000 	nop\.w
+    9024:	f3af 8000 	nop\.w
+    9028:	f3af 8000 	nop\.w
+    902c:	f3af 8000 	nop\.w
+    9030:	f3af 8000 	nop\.w
+    9034:	f3af 8000 	nop\.w
+    9038:	f3af 8000 	nop\.w
+    903c:	f3af 8000 	nop\.w
+    9040:	f3af 8000 	nop\.w
+    9044:	f3af 8000 	nop\.w
+    9048:	f3af 8000 	nop\.w
+    904c:	f3af 8000 	nop\.w
+    9050:	f3af 8000 	nop\.w
+    9054:	f3af 8000 	nop\.w
+    9058:	f3af 8000 	nop\.w
+    905c:	f3af 8000 	nop\.w
+    9060:	f3af 8000 	nop\.w
+    9064:	f3af 8000 	nop\.w
+    9068:	f3af 8000 	nop\.w
+    906c:	f3af 8000 	nop\.w
+    9070:	f3af 8000 	nop\.w
+    9074:	f3af 8000 	nop\.w
+    9078:	f3af 8000 	nop\.w
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+    9080:	f3af 8000 	nop\.w
+    9084:	f3af 8000 	nop\.w
+    9088:	f3af 8000 	nop\.w
+    908c:	f3af 8000 	nop\.w
+    9090:	f3af 8000 	nop\.w
+    9094:	f3af 8000 	nop\.w
+    9098:	f3af 8000 	nop\.w
+    909c:	f3af 8000 	nop\.w
+    90a0:	f3af 8000 	nop\.w
+    90a4:	f3af 8000 	nop\.w
+    90a8:	f3af 8000 	nop\.w
+    90ac:	f3af 8000 	nop\.w
+    90b0:	f3af 8000 	nop\.w
+    90b4:	f3af 8000 	nop\.w
+    90b8:	f3af 8000 	nop\.w
+    90bc:	f3af 8000 	nop\.w
+    90c0:	f3af 8000 	nop\.w
+    90c4:	f3af 8000 	nop\.w
+    90c8:	f3af 8000 	nop\.w
+    90cc:	f3af 8000 	nop\.w
+    90d0:	f3af 8000 	nop\.w
+    90d4:	f3af 8000 	nop\.w
+    90d8:	f3af 8000 	nop\.w
+    90dc:	f3af 8000 	nop\.w
+    90e0:	f3af 8000 	nop\.w
+    90e4:	f3af 8000 	nop\.w
+    90e8:	f3af 8000 	nop\.w
+    90ec:	f3af 8000 	nop\.w
+    90f0:	f3af 8000 	nop\.w
+    90f4:	f3af 8000 	nop\.w
+    90f8:	f3af 8000 	nop\.w
+    90fc:	f3af 8000 	nop\.w
+    9100:	f3af 8000 	nop\.w
+    9104:	f3af 8000 	nop\.w
+    9108:	f3af 8000 	nop\.w
+    910c:	f3af 8000 	nop\.w
+    9110:	f3af 8000 	nop\.w
+    9114:	f3af 8000 	nop\.w
+    9118:	f3af 8000 	nop\.w
+    911c:	f3af 8000 	nop\.w
+    9120:	f3af 8000 	nop\.w
+    9124:	f3af 8000 	nop\.w
+    9128:	f3af 8000 	nop\.w
+    912c:	f3af 8000 	nop\.w
+    9130:	f3af 8000 	nop\.w
+    9134:	f3af 8000 	nop\.w
+    9138:	f3af 8000 	nop\.w
+    913c:	f3af 8000 	nop\.w
+    9140:	f3af 8000 	nop\.w
+    9144:	f3af 8000 	nop\.w
+    9148:	f3af 8000 	nop\.w
+    914c:	f3af 8000 	nop\.w
+    9150:	f3af 8000 	nop\.w
+    9154:	f3af 8000 	nop\.w
+    9158:	f3af 8000 	nop\.w
+    915c:	f3af 8000 	nop\.w
+    9160:	f3af 8000 	nop\.w
+    9164:	f3af 8000 	nop\.w
+    9168:	f3af 8000 	nop\.w
+    916c:	f3af 8000 	nop\.w
+    9170:	f3af 8000 	nop\.w
+    9174:	f3af 8000 	nop\.w
+    9178:	f3af 8000 	nop\.w
+    917c:	f3af 8000 	nop\.w
+    9180:	f3af 8000 	nop\.w
+    9184:	f3af 8000 	nop\.w
+    9188:	f3af 8000 	nop\.w
+    918c:	f3af 8000 	nop\.w
+    9190:	f3af 8000 	nop\.w
+    9194:	f3af 8000 	nop\.w
+    9198:	f3af 8000 	nop\.w
+    919c:	f3af 8000 	nop\.w
+    91a0:	f3af 8000 	nop\.w
+    91a4:	f3af 8000 	nop\.w
+    91a8:	f3af 8000 	nop\.w
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+    91b0:	f3af 8000 	nop\.w
+    91b4:	f3af 8000 	nop\.w
+    91b8:	f3af 8000 	nop\.w
+    91bc:	f3af 8000 	nop\.w
+    91c0:	f3af 8000 	nop\.w
+    91c4:	f3af 8000 	nop\.w
+    91c8:	f3af 8000 	nop\.w
+    91cc:	f3af 8000 	nop\.w
+    91d0:	f3af 8000 	nop\.w
+    91d4:	f3af 8000 	nop\.w
+    91d8:	f3af 8000 	nop\.w
+    91dc:	f3af 8000 	nop\.w
+    91e0:	f3af 8000 	nop\.w
+    91e4:	f3af 8000 	nop\.w
+    91e8:	f3af 8000 	nop\.w
+    91ec:	f3af 8000 	nop\.w
+    91f0:	f3af 8000 	nop\.w
+    91f4:	f3af 8000 	nop\.w
+    91f8:	f3af 8000 	nop\.w
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+    9200:	f3af 8000 	nop\.w
+    9204:	f3af 8000 	nop\.w
+    9208:	f3af 8000 	nop\.w
+    920c:	f3af 8000 	nop\.w
+    9210:	f3af 8000 	nop\.w
+    9214:	f3af 8000 	nop\.w
+    9218:	f3af 8000 	nop\.w
+    921c:	f3af 8000 	nop\.w
+    9220:	f3af 8000 	nop\.w
+    9224:	f3af 8000 	nop\.w
+    9228:	f3af 8000 	nop\.w
+    922c:	f3af 8000 	nop\.w
+    9230:	f3af 8000 	nop\.w
+    9234:	f3af 8000 	nop\.w
+    9238:	f3af 8000 	nop\.w
+    923c:	f3af 8000 	nop\.w
+    9240:	f3af 8000 	nop\.w
+    9244:	f3af 8000 	nop\.w
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+    9258:	f3af 8000 	nop\.w
+    925c:	f3af 8000 	nop\.w
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+    9264:	f3af 8000 	nop\.w
+    9268:	f3af 8000 	nop\.w
+    926c:	f3af 8000 	nop\.w
+    9270:	f3af 8000 	nop\.w
+    9274:	f3af 8000 	nop\.w
+    9278:	f3af 8000 	nop\.w
+    927c:	f3af 8000 	nop\.w
+    9280:	f3af 8000 	nop\.w
+    9284:	f3af 8000 	nop\.w
+    9288:	f3af 8000 	nop\.w
+    928c:	f3af 8000 	nop\.w
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+    92a4:	f3af 8000 	nop\.w
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+    92b0:	f3af 8000 	nop\.w
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+    92c4:	f3af 8000 	nop\.w
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+
+00009ef8 <arm_target>:
+    9ef8:	e0843005 	add	r3, r4, r5
+    9efc:	e12fff1e 	bx	lr
+
+00009f00 <bl_insns>:
+    9f00:	bf00      	nop
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+    a002:	4770      	bx	lr
+    a004:	f3af 8000 	nop\.w
+    a008:	eaffffba 	b	9ef8 <arm_target>
+    a00c:	d101      	bne\.n	a012 <bl_insns\+0x112>
+    a00e:	f7fe bff8 	b\.w	9002 <_start\+0x102>
+    a012:	f7fe bfe6 	b\.w	8fe2 <_start\+0xe2>
diff --git a/ld/testsuite/ld-arm/cortex-a8-fix-blx-bcond.s b/ld/testsuite/ld-arm/cortex-a8-fix-blx-bcond.s
new file mode 100644
index 0000000..cb40fb4
--- /dev/null
+++ b/ld/testsuite/ld-arm/cortex-a8-fix-blx-bcond.s
@@ -0,0 +1,81 @@
+	.syntax unified
+	.cpu cortex-a8
+	.thumb
+	.text
+
+	@ expansion 32 bytes
+	.macro bw1
+1:
+	add.w r0, r1, r2
+	blx.w arm_target
+	add.w r0, r1, r2
+	blx.w arm_target
+	add.w r0, r1, r2
+	blx.w arm_target
+	add.w r0, r1, r2
+	blx.w arm_target
+	.endm
+
+	@ expansion 128 bytes
+	.macro bw2
+	bw1
+	bw1
+	bw1
+	bw1
+	.endm
+
+	@ expansion 32 bytes
+	.macro bw3
+1:
+	add.w r0, r1, r2
+	bne.w 1b
+	add.w r0, r1, r2
+	bne.w 1b
+	add.w r0, r1, r2
+	bne.w 1b
+	add.w r0, r1, r2
+	bne.w 1b
+	.endm
+
+	@ expansion 128 bytes
+	.macro bw4
+	bw3
+	bw3
+	bw3
+	bw3
+	.endm
+
+	.align  3
+	.global _start
+
+	.thumb
+	.thumb_func
+	.type   _start, %function
+_start:
+	nop
+
+	@ Trigger Cortex-A8 erratum workaround with b<cond> instructions.
+	bw4
+	bw4
+
+	nop
+
+	.rept 957
+	nop.w
+	.endr
+
+	.arm
+arm_target:
+	add r3, r4, r5
+	bx lr
+
+	.thumb
+bl_insns:
+
+	nop
+
+	@ ...and again with bl instructions.
+	bw2
+	bw2
+
+	bx      lr