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path: root/gas
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authorAndreas Krebbel <krebbel@linux.vnet.ibm.com>2015-01-16 12:19:21 +0100
committerAndreas Krebbel <krebbel@linux.vnet.ibm.com>2015-01-16 12:28:58 +0100
commit1e2e8c529c1cf4fcc8cbae382aa0a653d0b65da6 (patch)
tree2cc295f864977f3b461a8f8fa80af608dcb8a769 /gas
parent9f2850baa3ce341f0ba42bd9519cb3c1bf1287c7 (diff)
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S/390: Add support for IBM z13.
- 32 128 bit vector registers (overlapping with the existing 16 64 bit floating point registers) - vector double instructions - vector integer instructions - scalar vector instructions (allowing to have more floating point registers for scalar operations) - vector string instructions gas/ChangeLog: * config/tc-s390.c (struct pd_reg): Remove. (pre_defined_registers): Remove. (REG_NAME_CNT): Remove. (reg_name_search): Calculate the register number instead of doing a lookup. (register_name, tc_s390_regname_to_dw2regnum): Adopt to the new reg_name_search signature. (s390_parse_cpu): Support the new arch string z13. (s390_insert_operand): Support for vector registers with the extra field for the fifth bit of each vector register operand. (md_gather_operand): Adjust to the new handling of optional parameters. * doc/as.texinfo: Document the z13 cpu string. gas/testsuite/ChangeLog: * gas/s390/esa-g5.d: Add a variant without the optional operand. * gas/s390/esa-g5.s: Likewise. * gas/s390/esa-z9-109.d: Likewise. * gas/s390/esa-z9-109.s: Likewise. * gas/s390/zarch-z9-109.d: Likewise. * gas/s390/zarch-z9-109.s: Likewise. * gas/s390/zarch-z10.d: For variants with a zero optional argument it is not dumped by objdump anymore. * gas/s390/zarch-zEC12.d: Likewise. * gas/s390/zarch-z13.d: New file. * gas/s390/zarch-z13.s: New file. * gas/s390/s390.exp: Run the test for the z13 files. include/opcode/ChangeLog: * s390.h (s390_opcode_cpu_val): Add S390_OPCODE_Z13. ld/testsuite/ChangeLog: * ld-s390/tlsbin.dd: The nopr register operand is optional and not printed if 0 anymore. opcodes/ChangeLog: * s390-dis.c (s390_extract_operand): Support vector register operands. (s390_print_insn_with_opcode): Support new operands types and add new handling of optional operands. * s390-mkopc.c (s390_opcode_mode_val, s390_opcode_cpu_val): Remove and include opcode/s390.h instead. (struct op_struct): New field `flags'. (insertOpcode, insertExpandedMnemonic): New parameter `flags'. (dumpTable): Dump flags. (main): Parse flags from the s390-opc.txt file. Add z13 as cpu string. * s390-opc.c: Add new operands types, instruction formats, and instruction masks. (s390_opformats): Add new formats for .insn. * s390-opc.txt: Add new instructions.
Diffstat (limited to 'gas')
-rw-r--r--gas/ChangeLog17
-rw-r--r--gas/config/tc-s390.c202
-rw-r--r--gas/doc/as.texinfo2
-rw-r--r--gas/doc/c-s390.texi8
-rw-r--r--gas/testsuite/ChangeLog16
-rw-r--r--gas/testsuite/gas/s390/esa-g5.d44
-rw-r--r--gas/testsuite/gas/s390/esa-g5.s2
-rw-r--r--gas/testsuite/gas/s390/esa-z9-109.d4
-rw-r--r--gas/testsuite/gas/s390/esa-z9-109.s4
-rw-r--r--gas/testsuite/gas/s390/s390.exp1
-rw-r--r--gas/testsuite/gas/s390/zarch-z10.d4
-rw-r--r--gas/testsuite/gas/s390/zarch-z13.d548
-rw-r--r--gas/testsuite/gas/s390/zarch-z13.s542
-rw-r--r--gas/testsuite/gas/s390/zarch-z9-109.d5
-rw-r--r--gas/testsuite/gas/s390/zarch-z9-109.s5
-rw-r--r--gas/testsuite/gas/s390/zarch-zEC12.d2
16 files changed, 1254 insertions, 152 deletions
diff --git a/gas/ChangeLog b/gas/ChangeLog
index ef0af89..abb6d67 100644
--- a/gas/ChangeLog
+++ b/gas/ChangeLog
@@ -1,3 +1,20 @@
+2015-01-16 Andreas Krebbel <krebbel@linux.vnet.ibm.com>
+
+ * config/tc-s390.c (struct pd_reg): Remove.
+ (pre_defined_registers): Remove.
+ (REG_NAME_CNT): Remove.
+ (reg_name_search): Calculate the register number instead of doing
+ a lookup.
+ (register_name, tc_s390_regname_to_dw2regnum): Adopt to the new
+ reg_name_search signature.
+ (s390_parse_cpu): Support the new arch string z13.
+ (s390_insert_operand): Support for vector registers with the extra
+ field for the fifth bit of each vector register operand.
+ (md_gather_operand): Adjust to the new handling of optional
+ parameters.
+
+ * doc/as.texinfo: Document the z13 cpu string.
+
2015-01-13 Matthew Wahab <matthew.wahab@arm.com>
* config/tc-arm.c (parse_ifimm_zero): Accept #0x0 as a synonym for
diff --git a/gas/config/tc-s390.c b/gas/config/tc-s390.c
index 39ade23..9102c60 100644
--- a/gas/config/tc-s390.c
+++ b/gas/config/tc-s390.c
@@ -109,138 +109,35 @@ const pseudo_typeS md_pseudo_table[] =
{ NULL, NULL, 0 }
};
-
-/* Structure to hold information about predefined registers. */
-struct pd_reg
- {
- char *name;
- int value;
- };
-
-/* List of registers that are pre-defined:
-
- Each access register has a predefined name of the form:
- a<reg_num> which has the value <reg_num>.
-
- Each control register has a predefined name of the form:
- c<reg_num> which has the value <reg_num>.
-
- Each general register has a predefined name of the form:
- r<reg_num> which has the value <reg_num>.
-
- Each floating point register a has predefined name of the form:
- f<reg_num> which has the value <reg_num>.
-
- There are individual registers as well:
- sp has the value 15
- lit has the value 12
-
- The table is sorted. Suitable for searching by a binary search. */
-
-static const struct pd_reg pre_defined_registers[] =
-{
- { "a0", 0 }, /* Access registers */
- { "a1", 1 },
- { "a10", 10 },
- { "a11", 11 },
- { "a12", 12 },
- { "a13", 13 },
- { "a14", 14 },
- { "a15", 15 },
- { "a2", 2 },
- { "a3", 3 },
- { "a4", 4 },
- { "a5", 5 },
- { "a6", 6 },
- { "a7", 7 },
- { "a8", 8 },
- { "a9", 9 },
-
- { "c0", 0 }, /* Control registers */
- { "c1", 1 },
- { "c10", 10 },
- { "c11", 11 },
- { "c12", 12 },
- { "c13", 13 },
- { "c14", 14 },
- { "c15", 15 },
- { "c2", 2 },
- { "c3", 3 },
- { "c4", 4 },
- { "c5", 5 },
- { "c6", 6 },
- { "c7", 7 },
- { "c8", 8 },
- { "c9", 9 },
-
- { "f0", 0 }, /* Floating point registers */
- { "f1", 1 },
- { "f10", 10 },
- { "f11", 11 },
- { "f12", 12 },
- { "f13", 13 },
- { "f14", 14 },
- { "f15", 15 },
- { "f2", 2 },
- { "f3", 3 },
- { "f4", 4 },
- { "f5", 5 },
- { "f6", 6 },
- { "f7", 7 },
- { "f8", 8 },
- { "f9", 9 },
-
- { "lit", 13 }, /* Pointer to literal pool */
-
- { "r0", 0 }, /* General purpose registers */
- { "r1", 1 },
- { "r10", 10 },
- { "r11", 11 },
- { "r12", 12 },
- { "r13", 13 },
- { "r14", 14 },
- { "r15", 15 },
- { "r2", 2 },
- { "r3", 3 },
- { "r4", 4 },
- { "r5", 5 },
- { "r6", 6 },
- { "r7", 7 },
- { "r8", 8 },
- { "r9", 9 },
-
- { "sp", 15 }, /* Stack pointer */
-
-};
-
-#define REG_NAME_CNT (sizeof (pre_defined_registers) / sizeof (struct pd_reg))
-
/* Given NAME, find the register number associated with that name, return
the integer value associated with the given name or -1 on failure. */
static int
-reg_name_search (const struct pd_reg *regs, int regcount, const char *name)
+reg_name_search (const char *name)
{
- int middle, low, high;
- int cmp;
+ int val = -1;
- low = 0;
- high = regcount - 1;
+ if (strcasecmp (name, "lit") == 0)
+ return 13;
- do
+ if (strcasecmp (name, "sp") == 0)
+ return 15;
+
+ if (name[0] != 'a' && name[0] != 'c' && name[0] != 'f'
+ && name[0] != 'r' && name[0] != 'v')
+ return -1;
+
+ if (ISDIGIT (name[1]))
{
- middle = (low + high) / 2;
- cmp = strcasecmp (name, regs[middle].name);
- if (cmp < 0)
- high = middle - 1;
- else if (cmp > 0)
- low = middle + 1;
- else
- return regs[middle].value;
+ val = name[1] - '0';
+ if (ISDIGIT (name[2]))
+ val = val * 10 + name[2] - '0';
}
- while (low <= high);
- return -1;
+ if ((name[0] != 'v' && val > 15) || val > 31)
+ val = -1;
+
+ return val;
}
@@ -272,7 +169,7 @@ register_name (expressionS *expressionP)
return FALSE;
c = get_symbol_end ();
- reg_number = reg_name_search (pre_defined_registers, REG_NAME_CNT, name);
+ reg_number = reg_name_search (name);
/* Put back the delimiting char. */
*input_line_pointer = c;
@@ -382,6 +279,8 @@ s390_parse_cpu (char *arg)
return S390_OPCODE_Z196;
else if (strcmp (arg, "zEC12") == 0)
return S390_OPCODE_ZEC12;
+ else if (strcmp (arg, "z13") == 0)
+ return S390_OPCODE_Z13;
else if (strcmp (arg, "all") == 0)
return S390_OPCODE_MAXCPU - 1;
else
@@ -633,6 +532,12 @@ s390_insert_operand (unsigned char *insn,
max = (((addressT) 1 << (operand->bits - 1)) << 1) - 1;
min = (offsetT) 0;
uval = (addressT) val;
+
+ /* Vector register operands have an additional bit in the RXB
+ field. */
+ if (operand->flags & S390_OPERAND_VR)
+ max = (max << 1) | 1;
+
/* Length x in an instructions has real length x+1. */
if (operand->flags & S390_OPERAND_LENGTH)
uval--;
@@ -652,6 +557,43 @@ s390_insert_operand (unsigned char *insn,
}
}
+ if (operand->flags & S390_OPERAND_VR)
+ {
+ /* Insert the extra bit into the RXB field. */
+ switch (operand->shift)
+ {
+ case 8:
+ insn[4] |= (uval & 0x10) >> 1;
+ break;
+ case 12:
+ insn[4] |= (uval & 0x10) >> 2;
+ break;
+ case 16:
+ insn[4] |= (uval & 0x10) >> 3;
+ break;
+ case 32:
+ insn[4] |= (uval & 0x10) >> 4;
+ break;
+ }
+ uval &= 0xf;
+ }
+
+ if (operand->flags & S390_OPERAND_OR1)
+ uval |= 1;
+ if (operand->flags & S390_OPERAND_OR2)
+ uval |= 2;
+ if (operand->flags & S390_OPERAND_OR8)
+ uval |= 8;
+
+ /* Duplicate the operand at bit pos 12 to 16. */
+ if (operand->flags & S390_OPERAND_CP16)
+ {
+ /* Copy VR operand at bit pos 12 to bit pos 16. */
+ insn[2] |= uval << 4;
+ /* Copy the flag in the RXB field. */
+ insn[4] |= (insn[4] & 4) >> 1;
+ }
+
/* Insert fragments of the operand byte for byte. */
offset = operand->shift + operand->bits;
uval <<= (-offset) & 7;
@@ -1206,6 +1148,14 @@ md_gather_operands (char *str,
operand = s390_operands + *opindex_ptr;
+ if ((opcode->flags & S390_INSTR_FLAG_OPTPARM) && *str == '\0')
+ {
+ /* Optional parameters might need to be ORed with a
+ value so calling s390_insert_operand is needed. */
+ s390_insert_operand (insn, operand, 0, NULL, 0);
+ break;
+ }
+
if (skip_optional && (operand->flags & S390_OPERAND_INDEX))
{
/* We do an early skip. For D(X,B) constructions the index
@@ -1477,6 +1427,10 @@ md_gather_operands (char *str,
as_bad (_("syntax error; ')' not allowed here"));
str++;
}
+
+ if ((opcode->flags & S390_INSTR_FLAG_OPTPARM) && *str == '\0')
+ continue;
+
/* If there is a next operand it must be separated by a comma. */
if (opindex_ptr[1] != '\0')
{
@@ -2499,7 +2453,7 @@ tc_s390_regname_to_dw2regnum (char *regname)
if (regname[0] != 'c' && regname[0] != 'a')
{
- regnum = reg_name_search (pre_defined_registers, REG_NAME_CNT, regname);
+ regnum = reg_name_search (regname);
if (regname[0] == 'f' && regnum != -1)
regnum += 16;
}
diff --git a/gas/doc/as.texinfo b/gas/doc/as.texinfo
index 5997669..9668039 100644
--- a/gas/doc/as.texinfo
+++ b/gas/doc/as.texinfo
@@ -1591,7 +1591,7 @@ Architecture (esa) or the z/Architecture mode (zarch).
@item -march=@var{processor}
Specify which s390 processor variant is the target, @samp{g6}, @samp{g6},
@samp{z900}, @samp{z990}, @samp{z9-109}, @samp{z9-ec}, @samp{z10},
-@samp{z196}, or @samp{zEC12}.
+@samp{z196}, @samp{zEC12}, or @samp{z13}.
@item -mregnames
@itemx -mno-regnames
Allow or disallow symbolic names for registers.
diff --git a/gas/doc/c-s390.texi b/gas/doc/c-s390.texi
index 7910bc5..ec36188 100644
--- a/gas/doc/c-s390.texi
+++ b/gas/doc/c-s390.texi
@@ -16,7 +16,7 @@
The s390 version of @code{@value{AS}} supports two architectures modes
and seven chip levels. The architecture modes are the Enterprise System
Architecture (ESA) and the newer z/Architecture mode. The chip levels
-are g5, g6, z900, z990, z9-109, z9-ec, z10, z196, and zEC12.
+are g5, g6, z900, z990, z9-109, z9-ec, z10, z196, zEC12, and z13.
@menu
* s390 Options:: Command-line Options.
@@ -64,8 +64,10 @@ are recognized:
@code{z990},
@code{z9-109},
@code{z9-ec},
-@code{z10} and
-@code{z196}.
+@code{z10},
+@code{z196},
+@code{zEC12}, and
+@code{z13}.
Assembling an instruction that is not supported on the target processor
results in an error message. Do not specify @code{g5} or @code{g6}
with @samp{-mzarch}.
diff --git a/gas/testsuite/ChangeLog b/gas/testsuite/ChangeLog
index a63ebd1..37c3e86 100644
--- a/gas/testsuite/ChangeLog
+++ b/gas/testsuite/ChangeLog
@@ -1,3 +1,19 @@
+2015-01-16 Andreas Krebbel <krebbel@linux.vnet.ibm.com>
+
+ * gas/s390/esa-g5.d: Add a variant without the optional operand.
+ * gas/s390/esa-g5.s: Likewise.
+ * gas/s390/esa-z9-109.d: Likewise.
+ * gas/s390/esa-z9-109.s: Likewise.
+ * gas/s390/zarch-z9-109.d: Likewise.
+ * gas/s390/zarch-z9-109.s: Likewise.
+ * gas/s390/zarch-z10.d: For variants with a zero optional argument
+ it is not dumped by objdump anymore.
+ * gas/s390/zarch-zEC12.d: Likewise.
+
+ * gas/s390/zarch-z13.d: New file.
+ * gas/s390/zarch-z13.s: New file.
+ * gas/s390/s390.exp: Run the test for the z13 files.
+
2015-01-13 Matthew Wahab <matthew.wahab@arm.com>
* gas/arm/ual-vcmp.s: Add vcmp, vcmpe with #0x0 operand.
diff --git a/gas/testsuite/gas/s390/esa-g5.d b/gas/testsuite/gas/s390/esa-g5.d
index 2896966..2ea72b1 100644
--- a/gas/testsuite/gas/s390/esa-g5.d
+++ b/gas/testsuite/gas/s390/esa-g5.d
@@ -157,6 +157,7 @@ Disassembly of section .text:
.*: de ff 5f ff af ff [ ]*ed 4095\(256,%r5\),4095\(%r10\)
.*: df ff 5f ff af ff [ ]*edmk 4095\(256,%r5\),4095\(%r10\)
.*: b3 8c 00 69 [ ]*efpc %r6,%r9
+.*: b3 8c 00 60 [ ]*efpc %r6
.*: b2 26 00 60 [ ]*epar %r6
.*: b2 49 00 69 [ ]*ereg %r6,%r9
.*: b2 27 00 60 [ ]*esar %r6
@@ -179,27 +180,27 @@ Disassembly of section .text:
.*: b2 21 00 69 [ ]*ipte %r6,%r9
.*: b2 29 00 69 [ ]*iske %r6,%r9
.*: b2 23 00 69 [ ]*ivsk %r6,%r9
-.*: a7 f4 00 00 [ ]*j 274 <foo\+0x274>
-.*: a7 84 00 00 [ ]*je 278 <foo\+0x278>
-.*: a7 24 00 00 [ ]*jh 27c <foo\+0x27c>
-.*: a7 a4 00 00 [ ]*jhe 280 <foo\+0x280>
-.*: a7 44 00 00 [ ]*jl 284 <foo\+0x284>
-.*: a7 c4 00 00 [ ]*jle 288 <foo\+0x288>
-.*: a7 64 00 00 [ ]*jlh 28c <foo\+0x28c>
-.*: a7 44 00 00 [ ]*jl 290 <foo\+0x290>
-.*: a7 74 00 00 [ ]*jne 294 <foo\+0x294>
-.*: a7 d4 00 00 [ ]*jnh 298 <foo\+0x298>
-.*: a7 54 00 00 [ ]*jnhe 29c <foo\+0x29c>
-.*: a7 b4 00 00 [ ]*jnl 2a0 <foo\+0x2a0>
-.*: a7 34 00 00 [ ]*jnle 2a4 <foo\+0x2a4>
-.*: a7 94 00 00 [ ]*jnlh 2a8 <foo\+0x2a8>
-.*: a7 b4 00 00 [ ]*jnl 2ac <foo\+0x2ac>
-.*: a7 e4 00 00 [ ]*jno 2b0 <foo\+0x2b0>
-.*: a7 d4 00 00 [ ]*jnh 2b4 <foo\+0x2b4>
-.*: a7 74 00 00 [ ]*jne 2b8 <foo\+0x2b8>
-.*: a7 14 00 00 [ ]*jo 2bc <foo\+0x2bc>
-.*: a7 24 00 00 [ ]*jh 2c0 <foo\+0x2c0>
-.*: a7 84 00 00 [ ]*je 2c4 <foo\+0x2c4>
+.*: a7 f4 00 00 [ ]*j 278 <foo\+0x278>
+.*: a7 84 00 00 [ ]*je 27c <foo\+0x27c>
+.*: a7 24 00 00 [ ]*jh 280 <foo\+0x280>
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+.*: a7 84 00 00 [ ]*je 2c8 <foo\+0x2c8>
.*: ed 65 af ff 00 18 [ ]*kdb %f6,4095\(%r5,%r10\)
.*: b3 18 00 69 [ ]*kdbr %f6,%f9
.*: ed 65 af ff 00 08 [ ]*keb %f6,4095\(%r5,%r10\)
@@ -372,6 +373,7 @@ Disassembly of section .text:
.*: b3 0b 00 69 [ ]*sebr %f6,%f9
.*: 3b 69 [ ]*ser %f6,%f9
.*: b3 84 00 69 [ ]*sfpc %r6,%r9
+.*: b3 84 00 60 [ ]*sfpc %r6
.*: 4b 65 af ff [ ]*sh %r6,4095\(%r5,%r10\)
.*: b2 14 5f ff [ ]*sie 4095\(%r5\)
.*: b2 74 5f ff [ ]*siga 4095\(%r5\)
diff --git a/gas/testsuite/gas/s390/esa-g5.s b/gas/testsuite/gas/s390/esa-g5.s
index d0bfb20..1bdc4da 100644
--- a/gas/testsuite/gas/s390/esa-g5.s
+++ b/gas/testsuite/gas/s390/esa-g5.s
@@ -151,6 +151,7 @@ foo:
ed 4095(256,%r5),4095(%r10)
edmk 4095(256,%r5),4095(%r10)
efpc %r6,%r9
+ efpc %r6
epar %r6
ereg %r6,%r9
esar %r6
@@ -366,6 +367,7 @@ foo:
sebr %f6,%f9
ser %f6,%f9
sfpc %r6,%r9
+ sfpc %r6
sh %r6,4095(%r5,%r10)
sie 4095(%r5)
siga 4095(%r5)
diff --git a/gas/testsuite/gas/s390/esa-z9-109.d b/gas/testsuite/gas/s390/esa-z9-109.d
index c379c46..d9cfcae 100644
--- a/gas/testsuite/gas/s390/esa-z9-109.d
+++ b/gas/testsuite/gas/s390/esa-z9-109.d
@@ -7,7 +7,11 @@ Disassembly of section .text:
.* <foo>:
.*: b9 93 f0 68 [ ]*troo %r6,%r8,15
+.*: b9 93 00 68 [ ]*troo %r6,%r8
.*: b9 92 f0 68 [ ]*trot %r6,%r8,15
+.*: b9 92 00 68 [ ]*trot %r6,%r8
.*: b9 91 f0 68 [ ]*trto %r6,%r8,15
+.*: b9 91 00 68 [ ]*trto %r6,%r8
.*: b9 90 f0 68 [ ]*trtt %r6,%r8,15
+.*: b9 90 00 68 [ ]*trtt %r6,%r8
.*: b2 2b 00 69 [ ]*sske %r6,%r9
diff --git a/gas/testsuite/gas/s390/esa-z9-109.s b/gas/testsuite/gas/s390/esa-z9-109.s
index 438f76e..c11fd38 100644
--- a/gas/testsuite/gas/s390/esa-z9-109.s
+++ b/gas/testsuite/gas/s390/esa-z9-109.s
@@ -1,9 +1,13 @@
.text
foo:
troo %r6,%r8,15
+ troo %r6,%r8
trot %r6,%r8,15
+ trot %r6,%r8
trto %r6,%r8,15
+ trto %r6,%r8
trtt %r6,%r8,15
+ trtt %r6,%r8
# z9-109 z/Architecture mode extended sske with an additional parameter
# make sure the old version still works for esa
sske %r6,%r9
diff --git a/gas/testsuite/gas/s390/s390.exp b/gas/testsuite/gas/s390/s390.exp
index 8dee249..734e86c 100644
--- a/gas/testsuite/gas/s390/s390.exp
+++ b/gas/testsuite/gas/s390/s390.exp
@@ -27,6 +27,7 @@ if [expr [istarget "s390-*-*"] || [istarget "s390x-*-*"]] then {
run_dump_test "zarch-z10" "{as -m64} {as -march=z10}"
run_dump_test "zarch-z196" "{as -m64} {as -march=z196}"
run_dump_test "zarch-zEC12" "{as -m64} {as -march=zEC12}"
+ run_dump_test "zarch-z13" "{as -m64} {as -march=z13}"
run_dump_test "zarch-reloc" "{as -m64}"
run_dump_test "zarch-operands" "{as -m64} {as -march=z9-109}"
run_dump_test "zarch-machine" "{as -m64} {as -march=z900}"
diff --git a/gas/testsuite/gas/s390/zarch-z10.d b/gas/testsuite/gas/s390/zarch-z10.d
index 9f94875..50a7138 100644
--- a/gas/testsuite/gas/s390/zarch-z10.d
+++ b/gas/testsuite/gas/s390/zarch-z10.d
@@ -371,9 +371,9 @@ Disassembly of section .text:
.*: b9 a2 00 60 [ ]*ptf %r6
.*: b9 af 00 67 [ ]*pfmf %r6,%r7
.*: b9 bf a0 67 [ ]*trte %r6,%r7,10
-.*: b9 bf 00 67 [ ]*trte %r6,%r7,0
+.*: b9 bf 00 67 [ ]*trte %r6,%r7
.*: b9 bd a0 67 [ ]*trtre %r6,%r7,10
-.*: b9 bd 00 67 [ ]*trtre %r6,%r7,0
+.*: b9 bd 00 67 [ ]*trtre %r6,%r7
.*: b2 ed 00 67 [ ]*ecpga %r6,%r7
.*: b2 e4 00 67 [ ]*ecctr %r6,%r7
.*: b2 e5 00 67 [ ]*epctr %r6,%r7
diff --git a/gas/testsuite/gas/s390/zarch-z13.d b/gas/testsuite/gas/s390/zarch-z13.d
new file mode 100644
index 0000000..f74b9f8
--- /dev/null
+++ b/gas/testsuite/gas/s390/zarch-z13.d
@@ -0,0 +1,548 @@
+#name: s390x opcode
+#objdump: -dr
+
+.*: +file format .*
+
+Disassembly of section .text:
+
+.* <foo>:
+.*: e7 69 bf a0 d0 27 [ ]*lcbb %r6,4000\(%r9,%r11\),13
+.*: e7 f6 9f a0 d0 13 [ ]*vgef %v15,4000\(%v6,%r9\),13
+.*: e7 f6 9f a0 d0 12 [ ]*vgeg %v15,4000\(%v6,%r9\),13
+.*: e7 f0 ff fd 00 44 [ ]*vgbm %v15,65533
+.*: e7 f0 00 00 00 44 [ ]*vzero %v15
+.*: e7 f0 ff ff 00 44 [ ]*vone %v15
+.*: e7 f0 fd fc b0 46 [ ]*vgm %v15,253,252,11
+.*: e7 f0 fd fc 00 46 [ ]*vgmb %v15,253,252
+.*: e7 f0 fd fc 10 46 [ ]*vgmh %v15,253,252
+.*: e7 f0 fd fc 20 46 [ ]*vgmf %v15,253,252
+.*: e7 f0 fd fc 30 46 [ ]*vgmg %v15,253,252
+.*: e7 f6 9f a0 00 06 [ ]*vl %v15,4000\(%r6,%r9\)
+.*: e7 f1 00 00 04 56 [ ]*vlr %v15,%v17
+.*: e7 f6 9f a0 d0 05 [ ]*vlrep %v15,4000\(%r6,%r9\),13
+.*: e7 f6 9f a0 00 05 [ ]*vlrepb %v15,4000\(%r6,%r9\)
+.*: e7 f6 9f a0 10 05 [ ]*vlreph %v15,4000\(%r6,%r9\)
+.*: e7 f6 9f a0 20 05 [ ]*vlrepf %v15,4000\(%r6,%r9\)
+.*: e7 f6 9f a0 30 05 [ ]*vlrepg %v15,4000\(%r6,%r9\)
+.*: e7 f6 9f a0 d0 00 [ ]*vleb %v15,4000\(%r6,%r9\),13
+.*: e7 f6 9f a0 d0 01 [ ]*vleh %v15,4000\(%r6,%r9\),13
+.*: e7 f6 9f a0 d0 03 [ ]*vlef %v15,4000\(%r6,%r9\),13
+.*: e7 f6 9f a0 d0 02 [ ]*vleg %v15,4000\(%r6,%r9\),13
+.*: e7 f0 80 03 c0 40 [ ]*vleib %v15,-32765,12
+.*: e7 f0 80 03 c0 41 [ ]*vleih %v15,-32765,12
+.*: e7 f0 80 03 c0 43 [ ]*vleif %v15,-32765,12
+.*: e7 f0 80 03 c0 42 [ ]*vleig %v15,-32765,12
+.*: e7 6f 9f a0 d0 21 [ ]*vlgv %r6,%v15,4000\(%r9\),13
+.*: e7 6f 9f a0 00 21 [ ]*vlgvb %r6,%v15,4000\(%r9\)
+.*: e7 6f 9f a0 10 21 [ ]*vlgvh %r6,%v15,4000\(%r9\)
+.*: e7 6f 9f a0 20 21 [ ]*vlgvf %r6,%v15,4000\(%r9\)
+.*: e7 6f 9f a0 30 21 [ ]*vlgvg %r6,%v15,4000\(%r9\)
+.*: e7 f6 9f a0 d0 04 [ ]*vllez %v15,4000\(%r6,%r9\),13
+.*: e7 f6 9f a0 00 04 [ ]*vllezb %v15,4000\(%r6,%r9\)
+.*: e7 f6 9f a0 10 04 [ ]*vllezh %v15,4000\(%r6,%r9\)
+.*: e7 f6 9f a0 20 04 [ ]*vllezf %v15,4000\(%r6,%r9\)
+.*: e7 f6 9f a0 30 04 [ ]*vllezg %v15,4000\(%r6,%r9\)
+.*: e7 f1 6f a0 04 36 [ ]*vlm %v15,%v17,4000\(%r6\)
+.*: e7 f6 9f a0 d0 07 [ ]*vlbb %v15,4000\(%r6,%r9\),13
+.*: e7 f6 9f a0 d0 22 [ ]*vlvg %v15,%r6,4000\(%r9\),13
+.*: e7 f6 9f a0 00 22 [ ]*vlvgb %v15,%r6,4000\(%r9\)
+.*: e7 f6 9f a0 10 22 [ ]*vlvgh %v15,%r6,4000\(%r9\)
+.*: e7 f6 9f a0 20 22 [ ]*vlvgf %v15,%r6,4000\(%r9\)
+.*: e7 f6 9f a0 30 22 [ ]*vlvgg %v15,%r6,4000\(%r9\)
+.*: e7 f6 90 00 00 62 [ ]*vlvgp %v15,%r6,%r9
+.*: e7 f6 9f a0 00 37 [ ]*vll %v15,%r6,4000\(%r9\)
+.*: e7 f1 40 00 d6 61 [ ]*vmrh %v15,%v17,%v20,13
+.*: e7 f1 40 00 06 61 [ ]*vmrhb %v15,%v17,%v20
+.*: e7 f1 40 00 16 61 [ ]*vmrhh %v15,%v17,%v20
+.*: e7 f1 40 00 26 61 [ ]*vmrhf %v15,%v17,%v20
+.*: e7 f1 40 00 36 61 [ ]*vmrhg %v15,%v17,%v20
+.*: e7 f1 40 00 d6 60 [ ]*vmrl %v15,%v17,%v20,13
+.*: e7 f1 40 00 06 60 [ ]*vmrlb %v15,%v17,%v20
+.*: e7 f1 40 00 16 60 [ ]*vmrlh %v15,%v17,%v20
+.*: e7 f1 40 00 26 60 [ ]*vmrlf %v15,%v17,%v20
+.*: e7 f1 40 00 36 60 [ ]*vmrlg %v15,%v17,%v20
+.*: e7 f1 40 00 d6 94 [ ]*vpk %v15,%v17,%v20,13
+.*: e7 f1 40 00 16 94 [ ]*vpkh %v15,%v17,%v20
+.*: e7 f1 40 00 26 94 [ ]*vpkf %v15,%v17,%v20
+.*: e7 f1 40 00 36 94 [ ]*vpkg %v15,%v17,%v20
+.*: e7 f1 40 c0 d6 97 [ ]*vpks %v15,%v17,%v20,13,12
+.*: e7 f1 40 00 16 97 [ ]*vpksh %v15,%v17,%v20
+.*: e7 f1 40 00 26 97 [ ]*vpksf %v15,%v17,%v20
+.*: e7 f1 40 00 36 97 [ ]*vpksg %v15,%v17,%v20
+.*: e7 f1 40 10 16 97 [ ]*vpkshs %v15,%v17,%v20
+.*: e7 f1 40 10 26 97 [ ]*vpksfs %v15,%v17,%v20
+.*: e7 f1 40 10 36 97 [ ]*vpksgs %v15,%v17,%v20
+.*: e7 f1 40 c0 d6 95 [ ]*vpkls %v15,%v17,%v20,13,12
+.*: e7 f1 40 00 16 95 [ ]*vpklsh %v15,%v17,%v20
+.*: e7 f1 40 00 26 95 [ ]*vpklsf %v15,%v17,%v20
+.*: e7 f1 40 00 36 95 [ ]*vpklsg %v15,%v17,%v20
+.*: e7 f1 40 10 16 95 [ ]*vpklshs %v15,%v17,%v20
+.*: e7 f1 40 10 26 95 [ ]*vpklsfs %v15,%v17,%v20
+.*: e7 f1 40 10 36 95 [ ]*vpklsgs %v15,%v17,%v20
+.*: e7 f1 40 00 87 8c [ ]*vperm %v15,%v17,%v20,%v24
+.*: e7 f1 40 00 d6 84 [ ]*vpdi %v15,%v17,%v20,13
+.*: e7 f1 ff fd c4 4d [ ]*vrep %v15,%v17,65533,12
+.*: e7 f1 ff fd 04 4d [ ]*vrepb %v15,%v17,65533
+.*: e7 f1 ff fd 14 4d [ ]*vreph %v15,%v17,65533
+.*: e7 f1 ff fd 24 4d [ ]*vrepf %v15,%v17,65533
+.*: e7 f1 ff fd 34 4d [ ]*vrepg %v15,%v17,65533
+.*: e7 f0 80 03 c0 45 [ ]*vrepi %v15,-32765,12
+.*: e7 f0 80 03 00 45 [ ]*vrepib %v15,-32765
+.*: e7 f0 80 03 10 45 [ ]*vrepih %v15,-32765
+.*: e7 f0 80 03 20 45 [ ]*vrepif %v15,-32765
+.*: e7 f0 80 03 30 45 [ ]*vrepig %v15,-32765
+.*: e7 f6 9f a0 d0 1b [ ]*vscef %v15,4000\(%v6,%r9\),13
+.*: e7 f6 9f a0 d0 1a [ ]*vsceg %v15,4000\(%v6,%r9\),13
+.*: e7 f1 40 00 87 8d [ ]*vsel %v15,%v17,%v20,%v24
+.*: e7 f1 00 00 d4 5f [ ]*vseg %v15,%v17,13
+.*: e7 f1 00 00 04 5f [ ]*vsegb %v15,%v17
+.*: e7 f1 00 00 14 5f [ ]*vsegh %v15,%v17
+.*: e7 f1 00 00 24 5f [ ]*vsegf %v15,%v17
+.*: e7 f6 9f a0 00 0e [ ]*vst %v15,4000\(%r6,%r9\)
+.*: e7 f6 9f a0 d0 08 [ ]*vsteb %v15,4000\(%r6,%r9\),13
+.*: e7 f6 9f a0 d0 09 [ ]*vsteh %v15,4000\(%r6,%r9\),13
+.*: e7 f6 9f a0 d0 0b [ ]*vstef %v15,4000\(%r6,%r9\),13
+.*: e7 f6 9f a0 d0 0a [ ]*vsteg %v15,4000\(%r6,%r9\),13
+.*: e7 f1 6f a0 04 3e [ ]*vstm %v15,%v17,4000\(%r6\)
+.*: e7 f6 9f a0 00 3f [ ]*vstl %v15,%r6,4000\(%r9\)
+.*: e7 f1 00 00 d4 d7 [ ]*vuph %v15,%v17,13
+.*: e7 f1 00 00 04 d7 [ ]*vuphb %v15,%v17
+.*: e7 f1 00 00 14 d7 [ ]*vuphh %v15,%v17
+.*: e7 f1 00 00 24 d7 [ ]*vuphf %v15,%v17
+.*: e7 f1 00 00 d4 d5 [ ]*vuplh %v15,%v17,13
+.*: e7 f1 00 00 04 d5 [ ]*vuplhb %v15,%v17
+.*: e7 f1 00 00 14 d5 [ ]*vuplhh %v15,%v17
+.*: e7 f1 00 00 24 d5 [ ]*vuplhf %v15,%v17
+.*: e7 f1 00 00 d4 d6 [ ]*vupl %v15,%v17,13
+.*: e7 f1 00 00 04 d6 [ ]*vuplb %v15,%v17
+.*: e7 f1 00 00 14 d6 [ ]*vuplhw %v15,%v17
+.*: e7 f1 00 00 24 d6 [ ]*vuplf %v15,%v17
+.*: e7 f1 00 00 d4 d4 [ ]*vupll %v15,%v17,13
+.*: e7 f1 00 00 04 d4 [ ]*vupllb %v15,%v17
+.*: e7 f1 00 00 14 d4 [ ]*vupllh %v15,%v17
+.*: e7 f1 00 00 24 d4 [ ]*vupllf %v15,%v17
+.*: e7 f1 40 00 d6 f3 [ ]*va %v15,%v17,%v20,13
+.*: e7 f1 40 00 06 f3 [ ]*vab %v15,%v17,%v20
+.*: e7 f1 40 00 16 f3 [ ]*vah %v15,%v17,%v20
+.*: e7 f1 40 00 26 f3 [ ]*vaf %v15,%v17,%v20
+.*: e7 f1 40 00 36 f3 [ ]*vag %v15,%v17,%v20
+.*: e7 f1 40 00 46 f3 [ ]*vaq %v15,%v17,%v20
+.*: e7 f1 40 00 d6 f1 [ ]*vacc %v15,%v17,%v20,13
+.*: e7 f1 40 00 06 f1 [ ]*vaccb %v15,%v17,%v20
+.*: e7 f1 40 00 16 f1 [ ]*vacch %v15,%v17,%v20
+.*: e7 f1 40 00 26 f1 [ ]*vaccf %v15,%v17,%v20
+.*: e7 f1 40 00 36 f1 [ ]*vaccg %v15,%v17,%v20
+.*: e7 f1 40 00 46 f1 [ ]*vaccq %v15,%v17,%v20
+.*: e7 f1 4d 00 87 bb [ ]*vac %v15,%v17,%v20,%v24,13
+.*: e7 f1 44 00 87 bb [ ]*vacq %v15,%v17,%v20,%v24
+.*: e7 f1 4d 00 87 b9 [ ]*vaccc %v15,%v17,%v20,%v24,13
+.*: e7 f1 44 00 87 b9 [ ]*vacccq %v15,%v17,%v20,%v24
+.*: e7 f1 40 00 06 68 [ ]*vn %v15,%v17,%v20
+.*: e7 f1 40 00 06 69 [ ]*vnc %v15,%v17,%v20
+.*: e7 f1 40 00 d6 f2 [ ]*vavg %v15,%v17,%v20,13
+.*: e7 f1 40 00 06 f2 [ ]*vavgb %v15,%v17,%v20
+.*: e7 f1 40 00 16 f2 [ ]*vavgh %v15,%v17,%v20
+.*: e7 f1 40 00 26 f2 [ ]*vavgf %v15,%v17,%v20
+.*: e7 f1 40 00 36 f2 [ ]*vavgg %v15,%v17,%v20
+.*: e7 f1 40 00 d6 f0 [ ]*vavgl %v15,%v17,%v20,13
+.*: e7 f1 40 00 06 f0 [ ]*vavglb %v15,%v17,%v20
+.*: e7 f1 40 00 16 f0 [ ]*vavglh %v15,%v17,%v20
+.*: e7 f1 40 00 26 f0 [ ]*vavglf %v15,%v17,%v20
+.*: e7 f1 40 00 36 f0 [ ]*vavglg %v15,%v17,%v20
+.*: e7 f1 40 00 06 66 [ ]*vcksm %v15,%v17,%v20
+.*: e7 f1 00 00 d4 db [ ]*vec %v15,%v17,13
+.*: e7 f1 00 00 04 db [ ]*vecb %v15,%v17
+.*: e7 f1 00 00 14 db [ ]*vech %v15,%v17
+.*: e7 f1 00 00 24 db [ ]*vecf %v15,%v17
+.*: e7 f1 00 00 34 db [ ]*vecg %v15,%v17
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+.*: e7 f1 00 00 04 d9 [ ]*veclb %v15,%v17
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+++ b/gas/testsuite/gas/s390/zarch-z13.s
@@ -0,0 +1,542 @@
+.text
+foo:
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+ wfadb %v15,%v17,%v20
+ wfc %v15,%v17,13,12
+ wfcdb %v15,%v17
+ wfk %v15,%v17,13,12
+ wfkdb %v15,%v17
+ vfce %v15,%v17,%v20
+ vfcedb %v15,%v17,%v20
+ vfcedbs %v15,%v17,%v20
+ wfcedb %v15,%v17,%v20
+ wfcedbs %v15,%v17,%v20
+ vfch %v15,%v17,%v20,13,12,11
+ vfchdb %v15,%v17,%v20
+ vfchdbs %v15,%v17,%v20
+ wfchdb %v15,%v17,%v20
+ wfchdbs %v15,%v17,%v20
+ vfche %v15,%v17,%v20,13,12,11
+ vfchedb %v15,%v17,%v20
+ vfchedbs %v15,%v17,%v20
+ wfchedb %v15,%v17,%v20
+ wfchedbs %v15,%v17,%v20
+ vcdg %v15,%v17,13,12,11
+ vcdgb %v15,%v17,13,12
+ wcdgb %v15,%v17,13,12
+ vcdlg %v15,%v17,13,12,11
+ vcdlgb %v15,%v17,13,12
+ wcdlgb %v15,%v17,13,12
+ vcgd %v15,%v17,13,12,11
+ vcgdb %v15,%v17,13,12
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+ vfd %v15,%v17,%v20,13,12
+ vfddb %v15,%v17,%v20
+ wfddb %v15,%v17,%v20
+ vfi %v15,%v17,13,12,11
+ vfidb %v15,%v17,13,12
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+ vfpso %v15,%v17,13,12,11
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+ wfpsodb %v15,%v17,13
+ vflcdb %v15,%v17
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+ vflndb %v15,%v17
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+ wflpdb %v15,%v17
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+ wfsqdb %v15,%v17
+ vfs %v15,%v17,%v20,13,12
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+ wfsdb %v15,%v17,%v20
+ vftci %v15,%v17,4093,12,11
+ vftcidb %v15,%v17,4093
+ wftcidb %v15,%v17,4093
diff --git a/gas/testsuite/gas/s390/zarch-z9-109.d b/gas/testsuite/gas/s390/zarch-z9-109.d
index 3715b42..5a9717c 100644
--- a/gas/testsuite/gas/s390/zarch-z9-109.d
+++ b/gas/testsuite/gas/s390/zarch-z9-109.d
@@ -45,12 +45,17 @@ Disassembly of section .text:
.*: c8 60 5f ff af ff [ ]*mvcos 4095\(%r5\),4095\(%r10\),%r6
.*: b9 aa 9f 65 [ ]*lptea %r6,%r9,%r5,15
.*: b2 2b f0 69 [ ]*sske %r6,%r9,15
+.*: b2 2b 00 69 [ ]*sske %r6,%r9
.*: b9 b1 f0 68 [ ]*cu24 %r6,%r8,15
+.*: b9 b1 00 68 [ ]*cu24 %r6,%r8
.*: b2 a6 f0 68 [ ]*cu21 %r6,%r8,15
+.*: b2 a6 00 68 [ ]*cuutf %r6,%r8
.*: b9 b3 00 68 [ ]*cu42 %r6,%r8
.*: b9 b2 00 68 [ ]*cu41 %r6,%r8
.*: b2 a7 f0 68 [ ]*cu12 %r6,%r8,15
+.*: b2 a7 00 68 [ ]*cutfu %r6,%r8
.*: b9 b0 f0 68 [ ]*cu14 %r6,%r8,15
+.*: b9 b0 00 68 [ ]*cu14 %r6,%r8
.*: b3 3b 60 95 [ ]*myr %f6,%f9,%f5
.*: b3 3d 60 95 [ ]*myhr %f6,%f9,%f5
.*: b3 39 60 95 [ ]*mylr %f6,%f9,%f5
diff --git a/gas/testsuite/gas/s390/zarch-z9-109.s b/gas/testsuite/gas/s390/zarch-z9-109.s
index 9a70d90..10d77ac 100644
--- a/gas/testsuite/gas/s390/zarch-z9-109.s
+++ b/gas/testsuite/gas/s390/zarch-z9-109.s
@@ -39,12 +39,17 @@ foo:
mvcos 4095(%r5),4095(%r10),%r6
lptea %r6,%r9,%r5,15
sske %r6,%r9,15
+ sske %r6,%r9
cu24 %r6,%r8,15
+ cu24 %r6,%r8
cu21 %r6,%r8,15
+ cu21 %r6,%r8
cu42 %r6,%r8
cu41 %r6,%r8
cu12 %r6,%r8,15
+ cu12 %r6,%r8
cu14 %r6,%r8,15
+ cu14 %r6,%r8
myr %f6,%f9,%f5
myhr %f6,%f9,%f5
mylr %f6,%f9,%f5
diff --git a/gas/testsuite/gas/s390/zarch-zEC12.d b/gas/testsuite/gas/s390/zarch-zEC12.d
index 5a6d5f1..2989dda 100644
--- a/gas/testsuite/gas/s390/zarch-zEC12.d
+++ b/gas/testsuite/gas/s390/zarch-zEC12.d
@@ -52,7 +52,7 @@ Disassembly of section .text:
.*: ed 0f 8f a0 6d a8 [ ]*czdt %f6,4000\(16,%r8\),13
.*: ed 21 8f a0 4d a9 [ ]*czxt %f4,4000\(34,%r8\),13
.*: b2 e8 c0 56 [ ]*ppa %r5,%r6,12
-.*: b9 8f 60 59 [ ]*crdte %r5,%r6,%r9,0
+.*: b9 8f 60 59 [ ]*crdte %r5,%r6,%r9
.*: b9 8f 61 59 [ ]*crdte %r5,%r6,%r9,1
.*: c5 a0 06 00 00 06 [ ]*bprp 10,11e <bar>,11e <bar>
.*: c5 a0 00 00 00 00 [ ]*bprp 10,118 <foo\+0x118>,118 <foo\+0x118>