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authorRichard Sandiford <rdsandiford@googlemail.com>2013-08-04 07:31:39 +0000
committerRichard Sandiford <rdsandiford@googlemail.com>2013-08-04 07:31:39 +0000
commit14daeee3aec3b5e02e2f71303f8c2a78fb3108f4 (patch)
treeb535af4d5838e62a19569276d3182f0658345181 /gas
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include/opcode/
2013-08-04 Jürgen Urban <JuergenUrban@gmx.de> Richard Sandiford <rdsandiford@googlemail.com> * mips.h: Document new VU0 operand characters. (OP_VU0_SUFFIX, OP_VU0_MATCH_SUFFIX): New mips_operand_types. (OP_REG_VF, OP_REG_VI, OP_REG_R5900_I, OP_REG_R5900_Q, OP_REG_R5900_R) (OP_REG_R5900_ACC): New mips_reg_operand_types. (INSN2_VU0_CHANNEL_SUFFIX): New macro. (mips_vu0_channel_mask): Declare. opcodes/ 2013-08-04 Jürgen Urban <JuergenUrban@gmx.de> Richard Sandiford <rdsandiford@googlemail.com> * mips-dis.c (print_reg): Handle OP_REG_VI, OP_REG_VF, OP_REG_R5900_I, OP_REG_R5900_Q, OP_REG_R5900_R and OP_REG_R5900_ACC. (print_vu0_channel): New function. (print_insn_arg): Handle OP_VU0_SUFFIX and OP_VU0_MATCH_SUFFIX. (print_insn_args): Handle '#'. (print_insn_mips): Handle INSN2_VU0_CHANNEL_SUFFIX. * mips-opc.c (mips_vu0_channel_mask): New constant. (decode_mips_operand): Handle new VU0 operand types. (VU0, VU0CH): New macros. (mips_builtin_opcodes): Add VU0 opcodes. Use "+7" rather than "E" for LQC2 and SQC2. Use "+9" rather than "G" for EE CFC2 and CTC2. Use "+6" rather than "G" for QMFC2 and QMTC2. gas/ 2013-08-04 Jürgen Urban <JuergenUrban@gmx.de> Richard Sandiford <rdsandiford@googlemail.com> * config/tc-mips.c (MAX_OPERANDS): Bump to 6. (RWARN): Bump to 0x8000000. (RTYPE_VI, RTYPE_VF, RTYPE_R5900_I, RTYPE_R5900_Q, RTYPE_R5900_R) (RTYPE_R5900_ACC): New register types. (RTYPE_MASK): Include them. (R5900_I_NAMES, R5900_Q_NAMES, R5900_R_NAMES, R5900_ACC_NAMES): New macros. (reg_names): Include them. (mips_parse_register_1): New function, split out from... (mips_parse_register): ...here. Add a channels_ptr parameter. Look for VU0 channel suffixes when nonnull. (reg_lookup): Update the call to mips_parse_register. (mips_parse_vu0_channels): New function. (OT_CHANNELS, OT_DOUBLE_CHAR): New mips_operand_token_types. (mips_operand_token): Add a "channels" field to the union. Extend the comment above "ch" to OT_DOUBLE_CHAR. (mips_parse_base_start): Match -- and ++. Handle channel suffixes. (mips_parse_argument_token): Handle channel suffixes here too. (validate_mips_insn): Handle INSN2_VU0_CHANNEL_SUFFIX. Ignore OP_VU0_MATCH_SUFFIX when calculating the used bits. Handle '#' formats. (md_begin): Register $vfN and $vfI registers. (operand_reg_mask): Handle OP_VU0_SUFFIX and OP_VU0_MATCH_SUFFIX. (convert_reg_type): Handle OP_REG_VI, OP_REG_VF, OP_REG_R5900_I, OP_REG_R5900_Q, OP_REG_R5900_R and OP_REG_R5900_ACC. (match_vu0_suffix_operand): New function. (match_operand): Handle OP_VU0_SUFFIX and OP_VU0_MATCH_SUFFIX. (macro): Use "+7" rather than "E" for LDQ2 and STQ2. (mips_lookup_insn): New function. (mips_ip): Use it. Allow "+K" operands to be elided at the end of an instruction. Handle '#' sequences. gas/testsuite/ 2013-08-04 Jürgen Urban <JuergenUrban@gmx.de> * gas/mips/r5900-vu0.d: Expect $vfN and $viN instead of numeric coprocessor registers. * gas/mips/r5900-all-vu0.s, gas/mips/r5900-all-vu0.d, gas/mips/r5900-full-vu0.s, gas/mips/r5900-full-vu0.d, gas/mips/r5900-error-vu0.s, gas/mips/r5900-error-vu0.l: New tests. * gas/mips/mips.exp: Run them.
Diffstat (limited to 'gas')
-rw-r--r--gas/ChangeLog35
-rw-r--r--gas/config/tc-mips.c431
-rw-r--r--gas/testsuite/ChangeLog9
-rw-r--r--gas/testsuite/gas/mips/mips.exp3
-rw-r--r--gas/testsuite/gas/mips/r5900-all-vu0.d9217
-rw-r--r--gas/testsuite/gas/mips/r5900-all-vu0.s9217
-rw-r--r--gas/testsuite/gas/mips/r5900-error-vu0.l677
-rw-r--r--gas/testsuite/gas/mips/r5900-error-vu0.s684
-rw-r--r--gas/testsuite/gas/mips/r5900-full-vu0.d194
-rw-r--r--gas/testsuite/gas/mips/r5900-full-vu0.s214
-rw-r--r--gas/testsuite/gas/mips/r5900-vu0.d76
11 files changed, 20642 insertions, 115 deletions
diff --git a/gas/ChangeLog b/gas/ChangeLog
index 19bc225..21eab91 100644
--- a/gas/ChangeLog
+++ b/gas/ChangeLog
@@ -1,3 +1,38 @@
+2013-08-04 Jürgen Urban <JuergenUrban@gmx.de>
+ Richard Sandiford <rdsandiford@googlemail.com>
+
+ * config/tc-mips.c (MAX_OPERANDS): Bump to 6.
+ (RWARN): Bump to 0x8000000.
+ (RTYPE_VI, RTYPE_VF, RTYPE_R5900_I, RTYPE_R5900_Q, RTYPE_R5900_R)
+ (RTYPE_R5900_ACC): New register types.
+ (RTYPE_MASK): Include them.
+ (R5900_I_NAMES, R5900_Q_NAMES, R5900_R_NAMES, R5900_ACC_NAMES): New
+ macros.
+ (reg_names): Include them.
+ (mips_parse_register_1): New function, split out from...
+ (mips_parse_register): ...here. Add a channels_ptr parameter.
+ Look for VU0 channel suffixes when nonnull.
+ (reg_lookup): Update the call to mips_parse_register.
+ (mips_parse_vu0_channels): New function.
+ (OT_CHANNELS, OT_DOUBLE_CHAR): New mips_operand_token_types.
+ (mips_operand_token): Add a "channels" field to the union.
+ Extend the comment above "ch" to OT_DOUBLE_CHAR.
+ (mips_parse_base_start): Match -- and ++. Handle channel suffixes.
+ (mips_parse_argument_token): Handle channel suffixes here too.
+ (validate_mips_insn): Handle INSN2_VU0_CHANNEL_SUFFIX.
+ Ignore OP_VU0_MATCH_SUFFIX when calculating the used bits.
+ Handle '#' formats.
+ (md_begin): Register $vfN and $vfI registers.
+ (operand_reg_mask): Handle OP_VU0_SUFFIX and OP_VU0_MATCH_SUFFIX.
+ (convert_reg_type): Handle OP_REG_VI, OP_REG_VF, OP_REG_R5900_I,
+ OP_REG_R5900_Q, OP_REG_R5900_R and OP_REG_R5900_ACC.
+ (match_vu0_suffix_operand): New function.
+ (match_operand): Handle OP_VU0_SUFFIX and OP_VU0_MATCH_SUFFIX.
+ (macro): Use "+7" rather than "E" for LDQ2 and STQ2.
+ (mips_lookup_insn): New function.
+ (mips_ip): Use it. Allow "+K" operands to be elided at the end
+ of an instruction. Handle '#' sequences.
+
2013-08-03 Richard Sandiford <rdsandiford@googlemail.com>
* config/tc-mips.c (macro, mips16_macro): Create an array of operand
diff --git a/gas/config/tc-mips.c b/gas/config/tc-mips.c
index 655e669..4255f93 100644
--- a/gas/config/tc-mips.c
+++ b/gas/config/tc-mips.c
@@ -690,7 +690,7 @@ static int mips_debug = 0;
static struct mips_cl_insn history[1 + MAX_NOPS];
/* Arrays of operands for each instruction. */
-#define MAX_OPERANDS 5
+#define MAX_OPERANDS 6
struct mips_operand_array {
const struct mips_operand *operand[MAX_OPERANDS];
};
@@ -2206,18 +2206,24 @@ struct regname {
unsigned int num;
};
-#define RTYPE_MASK 0x1ff00
-#define RTYPE_NUM 0x00100
-#define RTYPE_FPU 0x00200
-#define RTYPE_FCC 0x00400
-#define RTYPE_VEC 0x00800
-#define RTYPE_GP 0x01000
-#define RTYPE_CP0 0x02000
-#define RTYPE_PC 0x04000
-#define RTYPE_ACC 0x08000
-#define RTYPE_CCC 0x10000
-#define RNUM_MASK 0x000ff
-#define RWARN 0x80000
+#define RNUM_MASK 0x00000ff
+#define RTYPE_MASK 0x0efff00
+#define RTYPE_NUM 0x0000100
+#define RTYPE_FPU 0x0000200
+#define RTYPE_FCC 0x0000400
+#define RTYPE_VEC 0x0000800
+#define RTYPE_GP 0x0001000
+#define RTYPE_CP0 0x0002000
+#define RTYPE_PC 0x0004000
+#define RTYPE_ACC 0x0008000
+#define RTYPE_CCC 0x0010000
+#define RTYPE_VI 0x0020000
+#define RTYPE_VF 0x0040000
+#define RTYPE_R5900_I 0x0080000
+#define RTYPE_R5900_Q 0x0100000
+#define RTYPE_R5900_R 0x0200000
+#define RTYPE_R5900_ACC 0x0400000
+#define RWARN 0x8000000
#define GENERIC_REGISTER_NUMBERS \
{"$0", RTYPE_NUM | 0}, \
@@ -2403,6 +2409,18 @@ struct regname {
{"$v30", RTYPE_VEC | 30}, \
{"$v31", RTYPE_VEC | 31}
+#define R5900_I_NAMES \
+ {"$I", RTYPE_R5900_I | 0}
+
+#define R5900_Q_NAMES \
+ {"$Q", RTYPE_R5900_Q | 0}
+
+#define R5900_R_NAMES \
+ {"$R", RTYPE_R5900_R | 0}
+
+#define R5900_ACC_NAMES \
+ {"$ACC", RTYPE_R5900_ACC | 0 }
+
#define MIPS_DSP_ACCUMULATOR_NAMES \
{"$ac0", RTYPE_ACC | 0}, \
{"$ac1", RTYPE_ACC | 1}, \
@@ -2423,6 +2441,10 @@ static const struct regname reg_names[] = {
MIPS16_SPECIAL_REGISTER_NAMES,
MDMX_VECTOR_REGISTER_NAMES,
+ R5900_I_NAMES,
+ R5900_Q_NAMES,
+ R5900_R_NAMES,
+ R5900_ACC_NAMES,
MIPS_DSP_ACCUMULATOR_NAMES,
{0, 0}
};
@@ -2450,24 +2472,14 @@ mips_prefer_vec_regno (unsigned int symval)
return symval;
}
-/* Return true if the string at *SPTR is a valid register name. If so,
- move *SPTR past the register and store the register's symbol value
- in *SYMVAL. This symbol value includes the register number
- (RNUM_MASK) and register type (RTYPE_MASK). */
+/* Return true if string [S, E) is a valid register name, storing its
+ symbol value in *SYMVAL_PTR if so. */
static bfd_boolean
-mips_parse_register (char **sptr, unsigned int *symval)
+mips_parse_register_1 (char *s, char *e, unsigned int *symval_ptr)
{
- symbolS *symbol;
- char *s, *e;
char save_c;
-
- /* Find end of name. */
- s = e = *sptr;
- if (is_name_beginner (*e))
- ++e;
- while (is_part_of_name (*e))
- ++e;
+ symbolS *symbol;
/* Terminate name. */
save_c = *e;
@@ -2480,8 +2492,63 @@ mips_parse_register (char **sptr, unsigned int *symval)
if (!symbol || S_GET_SEGMENT (symbol) != reg_section)
return FALSE;
+ *symval_ptr = S_GET_VALUE (symbol);
+ return TRUE;
+}
+
+/* Return true if the string at *SPTR is a valid register name. Allow it
+ to have a VU0-style channel suffix of the form x?y?z?w? if CHANNELS_PTR
+ is nonnull.
+
+ When returning true, move *SPTR past the register, store the
+ register's symbol value in *SYMVAL_PTR and the channel mask in
+ *CHANNELS_PTR (if nonnull). The symbol value includes the register
+ number (RNUM_MASK) and register type (RTYPE_MASK). The channel mask
+ is a 4-bit value of the form XYZW and is 0 if no suffix was given. */
+
+static bfd_boolean
+mips_parse_register (char **sptr, unsigned int *symval_ptr,
+ unsigned int *channels_ptr)
+{
+ char *s, *e, *m;
+ const char *q;
+ unsigned int channels, symval, bit;
+
+ /* Find end of name. */
+ s = e = *sptr;
+ if (is_name_beginner (*e))
+ ++e;
+ while (is_part_of_name (*e))
+ ++e;
+
+ channels = 0;
+ if (!mips_parse_register_1 (s, e, &symval))
+ {
+ if (!channels_ptr)
+ return FALSE;
+
+ /* Eat characters from the end of the string that are valid
+ channel suffixes. The preceding register must be $ACC or
+ end with a digit, so there is no ambiguity. */
+ bit = 1;
+ m = e;
+ for (q = "wzyx"; *q; q++, bit <<= 1)
+ if (m > s && m[-1] == *q)
+ {
+ --m;
+ channels |= bit;
+ }
+
+ if (channels == 0
+ || !mips_parse_register_1 (s, m, &symval)
+ || (symval & (RTYPE_VI | RTYPE_VF | RTYPE_R5900_ACC)) == 0)
+ return FALSE;
+ }
+
*sptr = e;
- *symval = S_GET_VALUE (symbol);
+ *symval_ptr = symval;
+ if (channels_ptr)
+ *channels_ptr = channels;
return TRUE;
}
@@ -2494,7 +2561,7 @@ reg_lookup (char **s, unsigned int types, unsigned int *regnop)
{
unsigned int regno;
- if (mips_parse_register (s, &regno))
+ if (mips_parse_register (s, &regno, NULL))
{
if (types & RTYPE_VEC)
regno = mips_prefer_vec_regno (regno);
@@ -2514,11 +2581,32 @@ reg_lookup (char **s, unsigned int types, unsigned int *regnop)
return regno <= RNUM_MASK;
}
+/* Parse a VU0 "x?y?z?w?" channel mask at S and store the associated
+ mask in *CHANNELS. Return a pointer to the first unconsumed character. */
+
+static char *
+mips_parse_vu0_channels (char *s, unsigned int *channels)
+{
+ unsigned int i;
+
+ *channels = 0;
+ for (i = 0; i < 4; i++)
+ if (*s == "xyzw"[i])
+ {
+ *channels |= 1 << (3 - i);
+ ++s;
+ }
+ return s;
+}
+
/* Token types for parsed operand lists. */
enum mips_operand_token_type {
/* A plain register, e.g. $f2. */
OT_REG,
+ /* A 4-bit XYZW channel mask. */
+ OT_CHANNELS,
+
/* An element of a vector, e.g. $v0[1]. */
OT_REG_ELEMENT,
@@ -2535,6 +2623,9 @@ enum mips_operand_token_type {
before OT_REGs. */
OT_CHAR,
+ /* A doubled character, either "--" or "++". */
+ OT_DOUBLE_CHAR,
+
/* The end of the operand list. */
OT_END
};
@@ -2549,6 +2640,9 @@ struct mips_operand_token
/* The register symbol value for an OT_REG. */
unsigned int regno;
+ /* The 4-bit channel mask for an OT_CHANNEL_SUFFIX. */
+ unsigned int channels;
+
/* The register symbol value and index for an OT_REG_ELEMENT. */
struct {
unsigned int regno;
@@ -2577,7 +2671,7 @@ struct mips_operand_token
int length;
} flt;
- /* The character represented by an OT_CHAR. */
+ /* The character represented by an OT_CHAR or OT_DOUBLE_CHAR. */
char ch;
} u;
};
@@ -2603,22 +2697,56 @@ static char *
mips_parse_base_start (char *s)
{
struct mips_operand_token token;
- unsigned int regno;
+ unsigned int regno, channels;
+ bfd_boolean decrement_p;
if (*s != '(')
return 0;
++s;
SKIP_SPACE_TABS (s);
- if (!mips_parse_register (&s, &regno))
+
+ /* Only match "--" as part of a base expression. In other contexts "--X"
+ is a double negative. */
+ decrement_p = (s[0] == '-' && s[1] == '-');
+ if (decrement_p)
+ {
+ s += 2;
+ SKIP_SPACE_TABS (s);
+ }
+
+ /* Allow a channel specifier because that leads to better error messages
+ than treating something like "$vf0x++" as an expression. */
+ if (!mips_parse_register (&s, &regno, &channels))
return 0;
token.u.ch = '(';
mips_add_token (&token, OT_CHAR);
+ if (decrement_p)
+ {
+ token.u.ch = '-';
+ mips_add_token (&token, OT_DOUBLE_CHAR);
+ }
+
token.u.regno = regno;
mips_add_token (&token, OT_REG);
+ if (channels)
+ {
+ token.u.channels = channels;
+ mips_add_token (&token, OT_CHANNELS);
+ }
+
+ /* For consistency, only match "++" as part of base expressions too. */
+ SKIP_SPACE_TABS (s);
+ if (s[0] == '+' && s[1] == '+')
+ {
+ s += 2;
+ token.u.ch = '+';
+ mips_add_token (&token, OT_DOUBLE_CHAR);
+ }
+
return s;
}
@@ -2631,7 +2759,7 @@ static char *
mips_parse_argument_token (char *s, char float_format)
{
char *end, *save_in, *err;
- unsigned int regno1, regno2;
+ unsigned int regno1, regno2, channels;
struct mips_operand_token token;
/* First look for "($reg", since we want to treat that as an
@@ -2650,15 +2778,26 @@ mips_parse_argument_token (char *s, char float_format)
}
/* Handle tokens that start with a register. */
- if (mips_parse_register (&s, &regno1))
+ if (mips_parse_register (&s, &regno1, &channels))
{
+ if (channels)
+ {
+ /* A register and a VU0 channel suffix. */
+ token.u.regno = regno1;
+ mips_add_token (&token, OT_REG);
+
+ token.u.channels = channels;
+ mips_add_token (&token, OT_CHANNELS);
+ return s;
+ }
+
SKIP_SPACE_TABS (s);
if (*s == '-')
{
/* A register range. */
++s;
SKIP_SPACE_TABS (s);
- if (!mips_parse_register (&s, &regno2))
+ if (!mips_parse_register (&s, &regno2, NULL))
{
insn_error = _("Invalid register range");
return 0;
@@ -2897,6 +3036,8 @@ validate_mips_insn (const struct mips_opcode *opcode,
}
used_bits = 0;
opno = 0;
+ if (opcode->pinfo2 & INSN2_VU0_CHANNEL_SUFFIX)
+ used_bits = mips_insert_operand (&mips_vu0_channel_mask, used_bits, -1);
for (s = opcode->args; *s; ++s)
switch (*s)
{
@@ -2905,6 +3046,10 @@ validate_mips_insn (const struct mips_opcode *opcode,
case ')':
break;
+ case '#':
+ s++;
+ break;
+
default:
if (!decode_operand)
operand = decode_mips16_operand (*s, FALSE);
@@ -2918,9 +3063,9 @@ validate_mips_insn (const struct mips_opcode *opcode,
}
gas_assert (opno < MAX_OPERANDS);
operands->operand[opno] = operand;
- if (operand)
+ if (operand && operand->type != OP_VU0_MATCH_SUFFIX)
{
- used_bits |= ((1 << operand->size) - 1) << operand->lsb;
+ used_bits = mips_insert_operand (operand, used_bits, -1);
if (operand->type == OP_MDMX_IMM_REG)
/* Bit 5 is the format selector (OB vs QH). The opcode table
has separate entries for each format. */
@@ -3160,6 +3305,23 @@ md_begin (void)
reg_names_o32[i].num, /* & RNUM_MASK, */
&zero_address_frag));
+ for (i = 0; i < 32; i++)
+ {
+ char regname[7];
+
+ /* R5900 VU0 floating-point register. */
+ regname[sizeof (rename) - 1] = 0;
+ snprintf (regname, sizeof (regname) - 1, "$vf%d", i);
+ symbol_table_insert (symbol_new (regname, reg_section,
+ RTYPE_VF | i, &zero_address_frag));
+
+ /* R5900 VU0 integer register. */
+ snprintf (regname, sizeof (regname) - 1, "$vi%d", i);
+ symbol_table_insert (symbol_new (regname, reg_section,
+ RTYPE_VI | i, &zero_address_frag));
+
+ }
+
obstack_init (&mips_operand_tokens);
mips_no_prev_insn ();
@@ -3701,6 +3863,8 @@ operand_reg_mask (const struct mips_cl_insn *insn,
case OP_REPEAT_DEST_REG:
case OP_REPEAT_PREV_REG:
case OP_PC:
+ case OP_VU0_SUFFIX:
+ case OP_VU0_MATCH_SUFFIX:
abort ();
case OP_REG:
@@ -4113,6 +4277,24 @@ convert_reg_type (const struct mips_opcode *opcode,
case OP_REG_HW:
return RTYPE_NUM;
+
+ case OP_REG_VI:
+ return RTYPE_NUM | RTYPE_VI;
+
+ case OP_REG_VF:
+ return RTYPE_NUM | RTYPE_VF;
+
+ case OP_REG_R5900_I:
+ return RTYPE_R5900_I;
+
+ case OP_REG_R5900_Q:
+ return RTYPE_R5900_Q;
+
+ case OP_REG_R5900_R:
+ return RTYPE_R5900_R;
+
+ case OP_REG_R5900_ACC:
+ return RTYPE_R5900_ACC;
}
abort ();
}
@@ -5046,6 +5228,42 @@ match_float_constant (struct mips_arg_info *arg, expressionS *imm,
return TRUE;
}
+/* OP_VU0_SUFFIX and OP_VU0_MATCH_SUFFIX matcher; MATCH_P selects between
+ them. */
+
+static bfd_boolean
+match_vu0_suffix_operand (struct mips_arg_info *arg,
+ const struct mips_operand *operand,
+ bfd_boolean match_p)
+{
+ unsigned int uval;
+
+ /* The operand can be an XYZW mask or a single 2-bit channel index
+ (with X being 0). */
+ gas_assert (operand->size == 2 || operand->size == 4);
+
+ /* The suffix can be omitted when matching a previous 4-bit mask. */
+ if (arg->token->type != OT_CHANNELS)
+ return operand->size == 4 && match_p;
+
+ uval = arg->token->u.channels;
+ if (operand->size == 2)
+ {
+ /* Check that a single bit is set and convert it into a 2-bit index. */
+ if ((uval & -uval) != uval)
+ return FALSE;
+ uval = 4 - ffs (uval);
+ }
+
+ if (match_p && insn_extract_operand (arg->insn, operand) != uval)
+ return FALSE;
+
+ ++arg->token;
+ if (!match_p)
+ insn_insert_operand (arg->insn, operand, uval);
+ return TRUE;
+}
+
/* S is the text seen for ARG. Match it against OPERAND. Return the end
of the argument text if the match is successful, otherwise return null. */
@@ -5102,6 +5320,12 @@ match_operand (struct mips_arg_info *arg,
case OP_PC:
return match_pc_operand (arg);
+
+ case OP_VU0_SUFFIX:
+ return match_vu0_suffix_operand (arg, operand, FALSE);
+
+ case OP_VU0_MATCH_SUFFIX:
+ return match_vu0_suffix_operand (arg, operand, TRUE);
}
abort ();
}
@@ -9913,7 +10137,7 @@ macro (struct mips_cl_insn *ip, char *str)
goto ld_st;
case M_LQC2_AB:
s = "lqc2";
- fmt = "E,o(b)";
+ fmt = "+7,o(b)";
/* Itbl support may require additional care here. */
coproc = 1;
goto ld_st;
@@ -10077,7 +10301,7 @@ macro (struct mips_cl_insn *ip, char *str)
goto ld_st;
case M_SQC2_AB:
s = "sqc2";
- fmt = "E,o(b)";
+ fmt = "+7,o(b)";
/* Itbl support may require additional care here. */
coproc = 1;
goto ld_st;
@@ -12078,6 +12302,74 @@ mips16_macro (struct mips_cl_insn *ip)
}
}
+/* Look up instruction [START, START + LENGTH) in HASH. Record any extra
+ opcode bits in *OPCODE_EXTRA. */
+
+static struct mips_opcode *
+mips_lookup_insn (struct hash_control *hash, const char *start,
+ unsigned int length, unsigned int *opcode_extra)
+{
+ char *name, *dot, *p;
+ unsigned int mask, suffix;
+ size_t opend;
+ struct mips_opcode *insn;
+
+ /* Make a copy of the instruction so that we can fiddle with it. */
+ name = alloca (length + 1);
+ memcpy (name, start, length);
+ name[length] = '\0';
+
+ /* Look up the instruction as-is. */
+ insn = (struct mips_opcode *) hash_find (hash, name);
+ if (insn && (insn->pinfo2 & INSN2_VU0_CHANNEL_SUFFIX) == 0)
+ return insn;
+
+ dot = strchr (name, '.');
+ if (dot && dot[1])
+ {
+ /* Try to interpret the text after the dot as a VU0 channel suffix. */
+ p = mips_parse_vu0_channels (dot + 1, &mask);
+ if (*p == 0 && mask != 0)
+ {
+ *dot = 0;
+ insn = (struct mips_opcode *) hash_find (hash, name);
+ *dot = '.';
+ if (insn && (insn->pinfo2 & INSN2_VU0_CHANNEL_SUFFIX) != 0)
+ {
+ *opcode_extra |= mask << mips_vu0_channel_mask.lsb;
+ return insn;
+ }
+ }
+ }
+
+ if (mips_opts.micromips)
+ {
+ /* See if there's an instruction size override suffix,
+ either `16' or `32', at the end of the mnemonic proper,
+ that defines the operation, i.e. before the first `.'
+ character if any. Strip it and retry. */
+ opend = dot != NULL ? dot - name : length;
+ if (opend >= 3 && name[opend - 2] == '1' && name[opend - 1] == '6')
+ suffix = 2;
+ else if (name[opend - 2] == '3' && name[opend - 1] == '2')
+ suffix = 4;
+ else
+ suffix = 0;
+ if (suffix)
+ {
+ memcpy (name + opend - 2, name + opend, length - opend + 1);
+ insn = (struct mips_opcode *) hash_find (hash, name);
+ if (insn && (insn->pinfo2 & INSN2_VU0_CHANNEL_SUFFIX) == 0)
+ {
+ forced_insn_length = suffix;
+ return insn;
+ }
+ }
+ }
+
+ return NULL;
+}
+
/* Assemble an instruction into its binary format. If the instruction
is a macro, set imm_expr, imm2_expr and offset_expr to the values
associated with "I", "+I" and "A" operands respectively. Otherwise
@@ -12095,16 +12387,14 @@ mips_ip (char *str, struct mips_cl_insn *ip)
struct hash_control *hash;
const char *args;
char c = 0;
- struct mips_opcode *insn;
- long opend;
- char *name;
- char *dot;
+ struct mips_opcode *first, *insn;
char format;
- long end;
+ size_t end;
const struct mips_operand *operand;
struct mips_arg_info arg;
struct mips_operand_token *tokens;
bfd_boolean optional_reg;
+ unsigned int opcode_extra;
insn_error = NULL;
@@ -12120,50 +12410,22 @@ mips_ip (char *str, struct mips_cl_insn *ip)
}
forced_insn_length = 0;
insn = NULL;
+ opcode_extra = 0;
/* We first try to match an instruction up to a space or to the end. */
for (end = 0; str[end] != '\0' && !ISSPACE (str[end]); end++)
continue;
- /* Make a copy of the instruction so that we can fiddle with it. */
- name = alloca (end + 1);
- memcpy (name, str, end);
- name[end] = '\0';
-
- for (;;)
- {
- insn = (struct mips_opcode *) hash_find (hash, name);
-
- if (insn != NULL || !mips_opts.micromips)
- break;
- if (forced_insn_length)
- break;
-
- /* See if there's an instruction size override suffix,
- either `16' or `32', at the end of the mnemonic proper,
- that defines the operation, i.e. before the first `.'
- character if any. Strip it and retry. */
- dot = strchr (name, '.');
- opend = dot != NULL ? dot - name : end;
- if (opend < 3)
- break;
- if (name[opend - 2] == '1' && name[opend - 1] == '6')
- forced_insn_length = 2;
- else if (name[opend - 2] == '3' && name[opend - 1] == '2')
- forced_insn_length = 4;
- else
- break;
- memcpy (name + opend - 2, name + opend, end - opend + 1);
- }
+ first = insn = mips_lookup_insn (hash, str, end, &opcode_extra);
if (insn == NULL)
{
insn_error = _("Unrecognized opcode");
return;
}
- if (strcmp (name, "li.s") == 0)
+ if (strcmp (insn->name, "li.s") == 0)
format = 'f';
- else if (strcmp (name, "li.d") == 0)
+ else if (strcmp (insn->name, "li.d") == 0)
format = 'd';
else
format = 0;
@@ -12184,7 +12446,7 @@ mips_ip (char *str, struct mips_cl_insn *ip)
bfd_boolean ok;
bfd_boolean more_alts;
- gas_assert (strcmp (insn->name, name) == 0);
+ gas_assert (strcmp (insn->name, first->name) == 0);
ok = is_opcode_valid (insn);
size_ok = is_size_valid (insn);
@@ -12240,6 +12502,7 @@ mips_ip (char *str, struct mips_cl_insn *ip)
offset_reloc[2] = BFD_RELOC_UNUSED;
create_insn (ip, insn);
+ ip->insn_opcode |= opcode_extra;
insn_error = NULL;
memset (&arg, 0, sizeof (arg));
arg.insn = ip;
@@ -12272,6 +12535,9 @@ mips_ip (char *str, struct mips_cl_insn *ip)
if (strcmp (args, "(b)") == 0)
args += 3;
+ if (args[0] == '+' && args[1] == 'K')
+ args += 2;
+
/* Fail the match if there were too few operands. */
if (*args)
break;
@@ -12301,6 +12567,17 @@ mips_ip (char *str, struct mips_cl_insn *ip)
continue;
break;
}
+ if (*args == '#')
+ {
+ ++args;
+ if (arg.token->type == OT_DOUBLE_CHAR
+ && arg.token->u.ch == *args)
+ {
+ ++arg.token;
+ continue;
+ }
+ break;
+ }
/* Handle special macro operands. Work out the properties of
other operands. */
diff --git a/gas/testsuite/ChangeLog b/gas/testsuite/ChangeLog
index deaba91..39c067d 100644
--- a/gas/testsuite/ChangeLog
+++ b/gas/testsuite/ChangeLog
@@ -1,3 +1,12 @@
+2013-08-04 Jürgen Urban <JuergenUrban@gmx.de>
+
+ * gas/mips/r5900-vu0.d: Expect $vfN and $viN instead of numeric
+ coprocessor registers.
+ * gas/mips/r5900-all-vu0.s, gas/mips/r5900-all-vu0.d,
+ gas/mips/r5900-full-vu0.s, gas/mips/r5900-full-vu0.d,
+ gas/mips/r5900-error-vu0.s, gas/mips/r5900-error-vu0.l: New tests.
+ * gas/mips/mips.exp: Run them.
+
2013-08-03 Richard Sandiford <rdsandiford@googlemail.com>
* gas/mips/mips16-macro.s, gas/mips/mips16-macro.d: New test.
diff --git a/gas/testsuite/gas/mips/mips.exp b/gas/testsuite/gas/mips/mips.exp
index 37e005b..d4a0410 100644
--- a/gas/testsuite/gas/mips/mips.exp
+++ b/gas/testsuite/gas/mips/mips.exp
@@ -1123,6 +1123,9 @@ if { [istarget mips*-*-vxworks*] } {
run_dump_test "r5900-full"
run_list_test "r5900-nollsc" "-mabi=o64 -march=r5900"
run_dump_test "r5900-vu0"
+ run_dump_test "r5900-full-vu0"
+ run_dump_test "r5900-all-vu0"
+ run_list_test "r5900-error-vu0" "-march=r5900"
run_list_test_arches "ext-ill" [mips_arch_list_matching mips64r2]
diff --git a/gas/testsuite/gas/mips/r5900-all-vu0.d b/gas/testsuite/gas/mips/r5900-all-vu0.d
new file mode 100644
index 0000000..9528c6e
--- /dev/null
+++ b/gas/testsuite/gas/mips/r5900-all-vu0.d
@@ -0,0 +1,9217 @@
+#objdump: -dr --prefix-addresses --show-raw-insn -M gpr-names=numeric -mmips:5900
+#name: MIPS R5900 All VU0
+#as: -march=r5900
+
+.*: +file format .*mips.*
+
+Disassembly of section \.text:
+[0-9a-f]+ <[^>]*> 4a2001fd vabs\.w \$vf0w,\$vf0w
+[0-9a-f]+ <[^>]*> 4a20f9fd vabs\.w \$vf0w,\$vf31w
+[0-9a-f]+ <[^>]*> 4a2111fd vabs\.w \$vf1w,\$vf2w
+[0-9a-f]+ <[^>]*> 4a3f01fd vabs\.w \$vf31w,\$vf0w
+[0-9a-f]+ <[^>]*> 4a3f79fd vabs\.w \$vf31w,\$vf15w
+[0-9a-f]+ <[^>]*> 4a3ff9fd vabs\.w \$vf31w,\$vf31w
+[0-9a-f]+ <[^>]*> 4b0001fd vabs\.x \$vf0x,\$vf0x
+[0-9a-f]+ <[^>]*> 4b00f9fd vabs\.x \$vf0x,\$vf31x
+[0-9a-f]+ <[^>]*> 4b0111fd vabs\.x \$vf1x,\$vf2x
+[0-9a-f]+ <[^>]*> 4b1f01fd vabs\.x \$vf31x,\$vf0x
+[0-9a-f]+ <[^>]*> 4b1f79fd vabs\.x \$vf31x,\$vf15x
+[0-9a-f]+ <[^>]*> 4b1ff9fd vabs\.x \$vf31x,\$vf31x
+[0-9a-f]+ <[^>]*> 4b2001fd vabs\.xw \$vf0xw,\$vf0xw
+[0-9a-f]+ <[^>]*> 4b20f9fd vabs\.xw \$vf0xw,\$vf31xw
+[0-9a-f]+ <[^>]*> 4b2111fd vabs\.xw \$vf1xw,\$vf2xw
+[0-9a-f]+ <[^>]*> 4b3f01fd vabs\.xw \$vf31xw,\$vf0xw
+[0-9a-f]+ <[^>]*> 4b3f79fd vabs\.xw \$vf31xw,\$vf15xw
+[0-9a-f]+ <[^>]*> 4b3ff9fd vabs\.xw \$vf31xw,\$vf31xw
+[0-9a-f]+ <[^>]*> 4b8001fd vabs\.xy \$vf0xy,\$vf0xy
+[0-9a-f]+ <[^>]*> 4b80f9fd vabs\.xy \$vf0xy,\$vf31xy
+[0-9a-f]+ <[^>]*> 4b8111fd vabs\.xy \$vf1xy,\$vf2xy
+[0-9a-f]+ <[^>]*> 4b9f01fd vabs\.xy \$vf31xy,\$vf0xy
+[0-9a-f]+ <[^>]*> 4b9f79fd vabs\.xy \$vf31xy,\$vf15xy
+[0-9a-f]+ <[^>]*> 4b9ff9fd vabs\.xy \$vf31xy,\$vf31xy
+[0-9a-f]+ <[^>]*> 4ba001fd vabs\.xyw \$vf0xyw,\$vf0xyw
+[0-9a-f]+ <[^>]*> 4ba0f9fd vabs\.xyw \$vf0xyw,\$vf31xyw
+[0-9a-f]+ <[^>]*> 4ba111fd vabs\.xyw \$vf1xyw,\$vf2xyw
+[0-9a-f]+ <[^>]*> 4bbf01fd vabs\.xyw \$vf31xyw,\$vf0xyw
+[0-9a-f]+ <[^>]*> 4bbf79fd vabs\.xyw \$vf31xyw,\$vf15xyw
+[0-9a-f]+ <[^>]*> 4bbff9fd vabs\.xyw \$vf31xyw,\$vf31xyw
+[0-9a-f]+ <[^>]*> 4bc001fd vabs\.xyz \$vf0xyz,\$vf0xyz
+[0-9a-f]+ <[^>]*> 4bc0f9fd vabs\.xyz \$vf0xyz,\$vf31xyz
+[0-9a-f]+ <[^>]*> 4bc111fd vabs\.xyz \$vf1xyz,\$vf2xyz
+[0-9a-f]+ <[^>]*> 4bdf01fd vabs\.xyz \$vf31xyz,\$vf0xyz
+[0-9a-f]+ <[^>]*> 4bdf79fd vabs\.xyz \$vf31xyz,\$vf15xyz
+[0-9a-f]+ <[^>]*> 4bdff9fd vabs\.xyz \$vf31xyz,\$vf31xyz
+[0-9a-f]+ <[^>]*> 4be001fd vabs\.xyzw \$vf0xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4be0f9fd vabs\.xyzw \$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4be111fd vabs\.xyzw \$vf1xyzw,\$vf2xyzw
+[0-9a-f]+ <[^>]*> 4bff01fd vabs\.xyzw \$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4bff79fd vabs\.xyzw \$vf31xyzw,\$vf15xyzw
+[0-9a-f]+ <[^>]*> 4bfff9fd vabs\.xyzw \$vf31xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4b4001fd vabs\.xz \$vf0xz,\$vf0xz
+[0-9a-f]+ <[^>]*> 4b40f9fd vabs\.xz \$vf0xz,\$vf31xz
+[0-9a-f]+ <[^>]*> 4b4111fd vabs\.xz \$vf1xz,\$vf2xz
+[0-9a-f]+ <[^>]*> 4b5f01fd vabs\.xz \$vf31xz,\$vf0xz
+[0-9a-f]+ <[^>]*> 4b5f79fd vabs\.xz \$vf31xz,\$vf15xz
+[0-9a-f]+ <[^>]*> 4b5ff9fd vabs\.xz \$vf31xz,\$vf31xz
+[0-9a-f]+ <[^>]*> 4b6001fd vabs\.xzw \$vf0xzw,\$vf0xzw
+[0-9a-f]+ <[^>]*> 4b60f9fd vabs\.xzw \$vf0xzw,\$vf31xzw
+[0-9a-f]+ <[^>]*> 4b6111fd vabs\.xzw \$vf1xzw,\$vf2xzw
+[0-9a-f]+ <[^>]*> 4b7f01fd vabs\.xzw \$vf31xzw,\$vf0xzw
+[0-9a-f]+ <[^>]*> 4b7f79fd vabs\.xzw \$vf31xzw,\$vf15xzw
+[0-9a-f]+ <[^>]*> 4b7ff9fd vabs\.xzw \$vf31xzw,\$vf31xzw
+[0-9a-f]+ <[^>]*> 4a8001fd vabs\.y \$vf0y,\$vf0y
+[0-9a-f]+ <[^>]*> 4a80f9fd vabs\.y \$vf0y,\$vf31y
+[0-9a-f]+ <[^>]*> 4a8111fd vabs\.y \$vf1y,\$vf2y
+[0-9a-f]+ <[^>]*> 4a9f01fd vabs\.y \$vf31y,\$vf0y
+[0-9a-f]+ <[^>]*> 4a9f79fd vabs\.y \$vf31y,\$vf15y
+[0-9a-f]+ <[^>]*> 4a9ff9fd vabs\.y \$vf31y,\$vf31y
+[0-9a-f]+ <[^>]*> 4aa001fd vabs\.yw \$vf0yw,\$vf0yw
+[0-9a-f]+ <[^>]*> 4aa0f9fd vabs\.yw \$vf0yw,\$vf31yw
+[0-9a-f]+ <[^>]*> 4aa111fd vabs\.yw \$vf1yw,\$vf2yw
+[0-9a-f]+ <[^>]*> 4abf01fd vabs\.yw \$vf31yw,\$vf0yw
+[0-9a-f]+ <[^>]*> 4abf79fd vabs\.yw \$vf31yw,\$vf15yw
+[0-9a-f]+ <[^>]*> 4abff9fd vabs\.yw \$vf31yw,\$vf31yw
+[0-9a-f]+ <[^>]*> 4ac001fd vabs\.yz \$vf0yz,\$vf0yz
+[0-9a-f]+ <[^>]*> 4ac0f9fd vabs\.yz \$vf0yz,\$vf31yz
+[0-9a-f]+ <[^>]*> 4ac111fd vabs\.yz \$vf1yz,\$vf2yz
+[0-9a-f]+ <[^>]*> 4adf01fd vabs\.yz \$vf31yz,\$vf0yz
+[0-9a-f]+ <[^>]*> 4adf79fd vabs\.yz \$vf31yz,\$vf15yz
+[0-9a-f]+ <[^>]*> 4adff9fd vabs\.yz \$vf31yz,\$vf31yz
+[0-9a-f]+ <[^>]*> 4ae001fd vabs\.yzw \$vf0yzw,\$vf0yzw
+[0-9a-f]+ <[^>]*> 4ae0f9fd vabs\.yzw \$vf0yzw,\$vf31yzw
+[0-9a-f]+ <[^>]*> 4ae111fd vabs\.yzw \$vf1yzw,\$vf2yzw
+[0-9a-f]+ <[^>]*> 4aff01fd vabs\.yzw \$vf31yzw,\$vf0yzw
+[0-9a-f]+ <[^>]*> 4aff79fd vabs\.yzw \$vf31yzw,\$vf15yzw
+[0-9a-f]+ <[^>]*> 4afff9fd vabs\.yzw \$vf31yzw,\$vf31yzw
+[0-9a-f]+ <[^>]*> 4a4001fd vabs\.z \$vf0z,\$vf0z
+[0-9a-f]+ <[^>]*> 4a40f9fd vabs\.z \$vf0z,\$vf31z
+[0-9a-f]+ <[^>]*> 4a4111fd vabs\.z \$vf1z,\$vf2z
+[0-9a-f]+ <[^>]*> 4a5f01fd vabs\.z \$vf31z,\$vf0z
+[0-9a-f]+ <[^>]*> 4a5f79fd vabs\.z \$vf31z,\$vf15z
+[0-9a-f]+ <[^>]*> 4a5ff9fd vabs\.z \$vf31z,\$vf31z
+[0-9a-f]+ <[^>]*> 4a6001fd vabs\.zw \$vf0zw,\$vf0zw
+[0-9a-f]+ <[^>]*> 4a60f9fd vabs\.zw \$vf0zw,\$vf31zw
+[0-9a-f]+ <[^>]*> 4a6111fd vabs\.zw \$vf1zw,\$vf2zw
+[0-9a-f]+ <[^>]*> 4a7f01fd vabs\.zw \$vf31zw,\$vf0zw
+[0-9a-f]+ <[^>]*> 4a7f79fd vabs\.zw \$vf31zw,\$vf15zw
+[0-9a-f]+ <[^>]*> 4a7ff9fd vabs\.zw \$vf31zw,\$vf31zw
+[0-9a-f]+ <[^>]*> 4a20023e vaddai\.w \$ACCw,\$vf0w,\$I
+[0-9a-f]+ <[^>]*> 4a200a3e vaddai\.w \$ACCw,\$vf1w,\$I
+[0-9a-f]+ <[^>]*> 4a20fa3e vaddai\.w \$ACCw,\$vf31w,\$I
+[0-9a-f]+ <[^>]*> 4b00023e vaddai\.x \$ACCx,\$vf0x,\$I
+[0-9a-f]+ <[^>]*> 4b000a3e vaddai\.x \$ACCx,\$vf1x,\$I
+[0-9a-f]+ <[^>]*> 4b00fa3e vaddai\.x \$ACCx,\$vf31x,\$I
+[0-9a-f]+ <[^>]*> 4b20023e vaddai\.xw \$ACCxw,\$vf0xw,\$I
+[0-9a-f]+ <[^>]*> 4b200a3e vaddai\.xw \$ACCxw,\$vf1xw,\$I
+[0-9a-f]+ <[^>]*> 4b20fa3e vaddai\.xw \$ACCxw,\$vf31xw,\$I
+[0-9a-f]+ <[^>]*> 4b80023e vaddai\.xy \$ACCxy,\$vf0xy,\$I
+[0-9a-f]+ <[^>]*> 4b800a3e vaddai\.xy \$ACCxy,\$vf1xy,\$I
+[0-9a-f]+ <[^>]*> 4b80fa3e vaddai\.xy \$ACCxy,\$vf31xy,\$I
+[0-9a-f]+ <[^>]*> 4ba0023e vaddai\.xyw \$ACCxyw,\$vf0xyw,\$I
+[0-9a-f]+ <[^>]*> 4ba00a3e vaddai\.xyw \$ACCxyw,\$vf1xyw,\$I
+[0-9a-f]+ <[^>]*> 4ba0fa3e vaddai\.xyw \$ACCxyw,\$vf31xyw,\$I
+[0-9a-f]+ <[^>]*> 4bc0023e vaddai\.xyz \$ACCxyz,\$vf0xyz,\$I
+[0-9a-f]+ <[^>]*> 4bc00a3e vaddai\.xyz \$ACCxyz,\$vf1xyz,\$I
+[0-9a-f]+ <[^>]*> 4bc0fa3e vaddai\.xyz \$ACCxyz,\$vf31xyz,\$I
+[0-9a-f]+ <[^>]*> 4be0023e vaddai\.xyzw \$ACCxyzw,\$vf0xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be00a3e vaddai\.xyzw \$ACCxyzw,\$vf1xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be0fa3e vaddai\.xyzw \$ACCxyzw,\$vf31xyzw,\$I
+[0-9a-f]+ <[^>]*> 4b40023e vaddai\.xz \$ACCxz,\$vf0xz,\$I
+[0-9a-f]+ <[^>]*> 4b400a3e vaddai\.xz \$ACCxz,\$vf1xz,\$I
+[0-9a-f]+ <[^>]*> 4b40fa3e vaddai\.xz \$ACCxz,\$vf31xz,\$I
+[0-9a-f]+ <[^>]*> 4b60023e vaddai\.xzw \$ACCxzw,\$vf0xzw,\$I
+[0-9a-f]+ <[^>]*> 4b600a3e vaddai\.xzw \$ACCxzw,\$vf1xzw,\$I
+[0-9a-f]+ <[^>]*> 4b60fa3e vaddai\.xzw \$ACCxzw,\$vf31xzw,\$I
+[0-9a-f]+ <[^>]*> 4a80023e vaddai\.y \$ACCy,\$vf0y,\$I
+[0-9a-f]+ <[^>]*> 4a800a3e vaddai\.y \$ACCy,\$vf1y,\$I
+[0-9a-f]+ <[^>]*> 4a80fa3e vaddai\.y \$ACCy,\$vf31y,\$I
+[0-9a-f]+ <[^>]*> 4aa0023e vaddai\.yw \$ACCyw,\$vf0yw,\$I
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+[0-9a-f]+ <[^>]*> 4aa0fa3e vaddai\.yw \$ACCyw,\$vf31yw,\$I
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+ vsubz.zw $vf0zw, $vf0zw, $vf31z
+ vsubz.zw $vf0zw, $vf31zw, $vf0z
+ vsubz.zw $vf1zw, $vf2zw, $vf3z
+ vsubz.zw $vf31zw, $vf0zw, $vf0z
+ vsubz.zw $vf31zw, $vf15zw, $vf7z
+ vsubz.zw $vf31zw, $vf31zw, $vf31z
+ vwaitq
+
+# Force at least 8 (non-delay-slot) zero bytes, to make 'objdump' print ...
+ .space 8
diff --git a/gas/testsuite/gas/mips/r5900-error-vu0.l b/gas/testsuite/gas/mips/r5900-error-vu0.l
new file mode 100644
index 0000000..9bf7077
--- /dev/null
+++ b/gas/testsuite/gas/mips/r5900-error-vu0.l
@@ -0,0 +1,677 @@
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+.*: Error: Illegal operands `vabs\.w \$vf0z,\$vf31w'
+.*: Error: Illegal operands `vabs\.xw \$vf0xw,\$vf0w'
+.*: Error: Illegal operands `vabs\.xw \$vf0x,\$vf31xw'
+.*: Error: Illegal operands `vabs\.xyzw \$vf0xyz,\$vf0xyzw'
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+.*: Error: Illegal operands `vaddai\.w \$ACCz,\$vf0w,\$Q'
+.*: Error: Illegal operands `vaddai\.xyzw \$ACCxyw,\$vf0xyzw,\$I'
+.*: Error: Illegal operands `vaddaq\.w \$ACCw,\$vf31z,\$Q'
+.*: Error: Illegal operands `vaddaq\.x \$ACCx,\$vf0w,\$Q'
+.*: Error: Illegal operands `vaddaq\.x \$ACCw,\$vf1x,\$Q'
+.*: Error: Illegal operands `vaddaq\.xw \$ACCxw,\$vf1z,\$Q'
+.*: Error: Illegal operands `vaddaq\.xw \$ACCw,\$vf31xw,\$Q'
+.*: Error: Illegal operands `vaddaq\.xyw \$ACCxw,\$vf0xyw,\$Q'
+.*: Error: Illegal operands `vaddaq\.xyw \$ACCxyw,\$vf1yw,\$Q'
+.*: Error: Illegal operands `vaddaq\.xyzw \$ACCxyzw,\$vf1yzw,\$Q'
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+.*: Error: Illegal operands `vaddaq\.x \$ACCxz,\$vf1xz,\$Q'
+.*: Error: Illegal operands `vaddaq\.xzw \$ACCxw,\$vf0xzw,\$Q'
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+.*: Error: Illegal operands `vaddaq\.y \$ACCy,\$vf1y,\$I'
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+.*: Error: Illegal operands `vaddaq\.yw \$ACCyw,\$vf31wy,\$Q'
+.*: Error: Illegal operands `vaddaq\.yz \$ACCy,\$vf0yz,\$Q'
+.*: Error: Illegal operands `vaddaq\.yzw \$ACCxyzw,\$vf0yzw,\$Q'
+.*: Error: Illegal operands `vaddaq\.yzw \$ACCyzw,\$vf1xyzw,\$Q'
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+.*: Error: Illegal operands `vaddaw\.xyzw \$ACCxyzw,\$vf0xyzw,\$vf0x'
+.*: Error: Illegal operands `vaddaw\.xyzw \$ACCxyzw,\$vf0xyzw,\$vf31xyzw'
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+.*: Error: Illegal operands `vaddaw\.xz \$ACCxzw,\$vf0xz,\$vf31w'
+.*: Error: Illegal operands `vaddaw\.xz \$ACCxz,\$vf1xyz,\$vf2w'
+.*: Error: Illegal operands `vaddaw\.xz \$ACCxz,\$vf31xzw,\$vf0w'
+.*: Error: Illegal operands `vaddaw\.xz \$ACCxz,\$vf31z,\$vf15w'
+.*: Error: Illegal operands `vaddaw\.xzw \$ACCxyzw,\$vf0xzw,\$vf0w'
+.*: Error: Illegal operands `vaddaw\.xzw \$ACC,\$vf0,\$vf31z'
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+.*: Error: Illegal operands `vaddaw\.xzw \$ACCxzw,\$vf31xzw,\$vf0x'
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+.*: Error: Illegal operands `vaddax\.w \$ACCw,\$vf31w,\$vf0w'
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+.*: Error: Illegal operands `vaddax\.xw \$ACCxw,\$vf0xw,\$vf31z'
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+.*: Error: Illegal operands `vaddi\.w \$vf31w,\$vf15w,\$ACCw'
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+.*: Error: Illegal operands `vaddi\.xzw \$vf31xw,\$vf0xzw,\$I'
+.*: Error: Illegal operands `vaddi\.xzw \$vf31xzw,\$vf15xzw,\$Ixzw'
+.*: Error: Illegal operands `vaddq\.w \$vf1w,\$vf2w,\$Qw'
+.*: Error: Illegal operands `vaddq\.w \$vf31w,\$vf0w,\$R'
+.*: Error: Illegal operands `vaddq\.w \$vf31w,\$vf15w,\$ACCw'
+.*: Error: Illegal operands `vaddq\.w \$vf31w,\$vf31w,\$ACC'
+.*: Error: Illegal operands `vaddq\.xyzw \$vf31xyzw,\$vf32xyzw,\$Q'
+.*: Error: Illegal operands `vaddq\.xyzw \$vf31xyzw,\$32,\$Q'
+.*: Error: Illegal operands `vaddq\.xz \$vf0xz,\$\-1,\$Q'
+.*: Error: Illegal operands `vaddw\.xyzw \$vf31xyzw,\$vf15xyzw,\$vf7z'
+.*: Error: Illegal operands `vaddx\.yw \$vf31yw,\$vf31yw,\$vf31y'
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+.*: Error: Illegal operands `vaddz\.xyzw \$vf31xyzw,\$vf0xyzw,\$vf0x'
+.*: Error: Illegal operands `vaddz\.xyzw \$vf31xyzw,\$vf15xyzw,\$vf7y'
+.*: Error: Illegal operands `vaddz\.xyzw \$vf31xyzw,\$vf31xyzw,\$vf31w'
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+.*: Error: Operand 1 of `vcallms' must be a factor of 8, was 0x7\.
+.*: Error: Operand 1 of `vcallms' must be a factor of 8, was 0x4\.
+.*: Error: Operand 1 of `vcallms' must be a factor of 8, was 0x2\.
+.*: Error: Operand 1 of `vcallms' must be in the range \[0x0, 0x3fff8\], was 0x40000\.
+.*: Error: Operand 1 of `vcallms' must be in the range \[0x0, 0x3fff8\], was 0x40008\.
+.*: Error: Illegal operands `vclipw\.xyz \$vf0xyz,\$vf0x'
+.*: Error: Illegal operands `vclipw\.xyz \$vf0xyz,\$vf31y'
+.*: Error: Illegal operands `vclipw\.xyz \$vf1xyz,\$vf2z'
+.*: Error: Illegal operands `vdiv \$Q,\$vf0x,\$vf0xy'
+.*: Error: Illegal operands `vdiv \$Q,\$vf0xyzw,\$vf31y'
+.*: Error: Illegal operands `vdiv \$Q,\$vf1,\$vf2z'
+.*: Error: Illegal operands `vdiv \$Q,\$vf31x,\$vf15'
+.*: Error: Illegal operands `vdiv \$0,\$vf31w,\$vf31y'
+.*: Error: Illegal operands `vdiv \$Q,\$vf32y,\$vf0w'
+.*: Error: Illegal operands `vftoi0\.w \$vf0w,\$vf0x'
+.*: Error: Illegal operands `vftoi0\.w \$vf0x,\$vf31w'
+.*: Error: Illegal operands `vftoi0\.w \$vf1xw,\$vf2w'
+.*: Error: Illegal operands `vftoi0\.w \$vf31wx,\$vf0w'
+.*: Error: Illegal operands `vftoi0\.w \$vf31w,\$vf15wz'
+.*: Error: Illegal operands `vftoi12\.xw \$vf0xw,\$vf0w'
+.*: Error: Illegal operands `vftoi12\.xw \$vf0x,\$vf31xw'
+.*: Error: Illegal operands `vftoi15\.xyz \$vf31xyzw,\$vf15xyz'
+.*: Error: Illegal operands `vftoi15\.xyz \$vf31xyz,\$vf31xyzw'
+.*: Error: Illegal operands `vftoi15\.xyzw \$vf0xyzw,\$vf0xyz'
+.*: Error: Illegal operands `vftoi15\.y \$vf1y,\$vf2x'
+.*: Error: Illegal operands `vftoi15\.y \$vf31y,\$vf0w'
+.*: Error: Operand 3 of `viaddi' must be in the range \[\-16, 15\], was \-17\.
+.*: Error: Operand 3 of `viaddi' must be in the range \[\-16, 15\], was 16\.
+.*: Error: Operand 3 of `viaddi' must be in the range \[\-16, 15\], was 17\.
+.*: Error: Operand 3 of `viaddi' must be in the range \[\-16, 15\], was 32\.
+.*: Error: Operand 3 of `viaddi' must be in the range \[\-16, 15\], was 31\.
+.*: Error: Illegal operands `viand \$vi0xyzw,\$vi0,\$vi0'
+.*: Error: Illegal operands `viand \$vi0,\$vi0xyzw,\$vi31'
+.*: Error: Illegal operands `viand \$vi0,\$vi31,\$vi0xyzw'
+.*: Error: Illegal operands `viand \$vi1,\$vi2,\$vi3x'
+.*: Error: Illegal operands `viand \$vi31,\$vi0y,\$vi0'
+.*: Error: Illegal operands `viand \$vi31w,\$vi15,\$vi7'
+.*: Error: Illegal operands `viand \$vi31,\$vi31,\$vi31x'
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+.*: Error: Illegal operands `vilwr\.w \$vi0,\(\$vi31y\)'
+.*: Error: Illegal operands `vilwr\.w \$vi1,\(\$vi2z\)'
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+.*: Error: Illegal operands `vilwr\.w \$vi31,\(\$vi15xyzw\)'
+.*: Error: Illegal operands `vilwr\.w \$vi31x,\(\$vi31\)'
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+.*: Error: Illegal operands `vilwr\.x \$vi31xy,\(\$vi15\)'
+.*: Error: Illegal operands `vilwr\.x \$vi31zw,\(\$vi31\)'
+.*: Error: Illegal operands `vilwr\.y \$vi0wx,\(\$vi0\)'
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+.*: Error: Illegal operands `vilwr\.y \$vi1y,\(\$vi2\)'
+.*: Error: Illegal operands `vilwr\.y \$vi31,\(\$vi0y\)'
+.*: Error: Illegal operands `vilwr\.z \$vi0z,\(\$vi0\)'
+.*: Error: Illegal operands `vilwr\.z \$vi0,\(\$vi31z\)'
+.*: Error: Illegal operands `vior \$vi0x,\$vi0,\$vi0'
+.*: Error: Illegal operands `vior \$vi0,\$vi0x,\$vi31'
+.*: Error: Illegal operands `vior \$vi0,\$vi31,\$vi0x'
+.*: Error: Illegal operands `vior \$vi1y,\$vi2,\$vi3'
+.*: Error: Illegal operands `vior \$vi31,\$vi0y,\$vi0'
+.*: Error: Illegal operands `vior \$vi31,\$vi15,\$vi7y'
+.*: Error: Illegal operands `vior \$vi31xyzw,\$vi31,\$vi31'
+.*: Error: Illegal operands `visub \$vi0x,\$vi0,\$vi0'
+.*: Error: Illegal operands `visub \$vi0,\$vi0y,\$vi31'
+.*: Error: Illegal operands `visub \$vi0,\$vi31,\$vi0z'
+.*: Error: Illegal operands `visub \$vi1w,\$vi2,\$vi3'
+.*: Error: Illegal operands `visub \$vi31,\$vi0xy,\$vi0'
+.*: Error: Illegal operands `visub \$vi31,\$vi15,\$vi7zw'
+.*: Error: Illegal operands `visub \$vi31,\$vi31,\$vi31w'
+.*: Error: Illegal operands `viswr\.w \$vi0,\(\$vi0w\)'
+.*: Error: Illegal operands `viswr\.w \$vi0w,\(\$vi31\)'
+.*: Error: Illegal operands `viswr\.x \$vi0x,\(\$vi31\)'
+.*: Error: Illegal operands `viswr\.x \$vi1,\(\$vi2x\)'
+.*: Error: Illegal operands `viswr\.x \$vi31x,\(\$vi0x\)'
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+.*: Error: Illegal operands `vmulz\.y \$vf1y,\$vf2z,\$vf3z'
+.*: Error: Illegal operands `vmulz\.y \$vf31z,\$vf0y,\$vf0z'
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+.*: Error: Illegal operands `vopmsub \$vf31,\$vf31,\$I'
+.*: Error: Illegal operands `vopmsub\.xyz \$vf0xyz,\$vf0xyz,\$vf0xy'
+.*: Error: Illegal operands `vopmula \$0,\$vf0,\$vf0'
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+.*: Error: Illegal operands `vopmula \$ACCx,\$vf31,\$vf15'
+.*: Error: Illegal operands `vopmula \$ACCxyzw,\$vf31,\$vf31'
+.*: Error: Illegal operands `vopmula\.xyz \$ACCxyzw,\$vf0xyz,\$vf0xyz'
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+.*: Error: Illegal operands `vrget\.xyz \$vf1xyzw,\$R'
+.*: Error: Illegal operands `vrget\.xyz \$vf31xyzw,\$R'
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+.*: Error: Illegal operands `vrget\.xz \$vf1z,\$R'
+.*: Error: Illegal operands `vrget\.xzw \$vf0xw,\$R'
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+.*: Error: Illegal operands `vsqd\.xz \$vf0,\(\-\-\$vi31xz\)'
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+.*: Error: Illegal operands `vsqi\.zw \$vf0zw,\(\$vi0zw\+\+\)'
+.*: Error: Illegal operands `vsqrt \$Q,\$vf1zw'
+.*: Error: Illegal operands `vsqrt \$Q,\$vf31xw'
+.*: Error: Illegal operands `vsqrt \$Q,\$vf31xy'
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+.*: Error: Illegal operands `vsubai\.w \$ACCx,\$vf31w,\$I'
+.*: Error: Illegal operands `vsubai\.x \$ACCw,\$vf31x,\$I'
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+.*: Error: Illegal operands `vsubai\.xw \$ACCxw,\$vf1x,\$I'
+.*: Error: Illegal operands `vsubai\.xw \$ACCxw,\$vf31xw,\$0'
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+.*: Error: Illegal operands `vsubai\.xyz \$ACCxyz,\$vf31xyz,\$ACC'
+.*: Error: Illegal operands `vsubai\.xyzw \$ACCxyzw,\$vf0xyzw,\$R'
+.*: Error: Illegal operands `vsubai\.xyzw \$ACCxyzw,\$vf1xyzw,\$Q'
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+.*: Error: Illegal operands `vsubaq\.w \$ACCw,\$Q,\$Q'
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+.*: Error: Illegal operands `vsubaq\.xyw \$ACCxyw,\$vf0xw,\$Q'
+.*: Error: Illegal operands `vsubaq\.xyzw \$ACCxyzw,\$vf0xyz,\$Q'
+.*: Error: Illegal operands `vsubaq\.xzw \$ACCxzw,\$vf1xw,\$Q'
+.*: Error: Illegal operands `vsubaq\.yw \$ACCyw,\$vf31y,\$Q'
+.*: Error: Illegal operands `vsubaq\.yz \$ACCyz,\$vf0yz,\$ACC'
+.*: Error: Illegal operands `vsubaq\.yz \$ACCyz,\$vf1yz,\$I'
+.*: Error: Illegal operands `vsubax\.w \$ACCw,\$vf0w,\$vf0w'
+.*: Error: Illegal operands `vsubax\.w \$ACCw,\$vf0x,\$vf31x'
+.*: Error: Illegal operands `vsubax\.w \$ACCx,\$vf1w,\$vf2x'
+.*: Error: Illegal operands `vsubax\.w \$ACCx,\$vf31x,\$vf0x'
+.*: Error: Illegal operands `vsubax\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf0xyzw'
+.*: Error: Illegal operands `vsubax\.xzw \$ACCxzw,\$vf1xzw,\$vf2xzw'
+.*: Error: Illegal operands `vsubax\.y \$ACCy,\$vf1y,\$vf2'
+.*: Error: Illegal operands `vsubax\.y \$ACCy,\$vf31y,\$vf0y'
+.*: Error: Illegal operands `vsubax\.yw \$ACCyw,\$vf0yw,\$vf0yw'
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+.*: Error: Illegal operands `vsubay\.zw \$ACCzw,\$vf0zw,\$vf0zw'
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+.*: Error: Illegal operands `vsubz\.xyw \$vf31xyw,\$vf31yw,\$vf31z'
+.*: Error: Illegal operands `vsubz\.xyz \$vf0xyz,\$vf0xyz,\$vf0x'
+.*: Error: Illegal operands `vwaitq \$vf0x'
diff --git a/gas/testsuite/gas/mips/r5900-error-vu0.s b/gas/testsuite/gas/mips/r5900-error-vu0.s
new file mode 100644
index 0000000..7840e03
--- /dev/null
+++ b/gas/testsuite/gas/mips/r5900-error-vu0.s
@@ -0,0 +1,684 @@
+ .set noreorder
+ .set noat
+
+ .globl text_label .text
+text_label:
+ # All instructions have at least one error in suffix or in register
+ # usage. All errors should be detected by the assembler.
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+ vabs.w $vf0z, $vf31w
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+ vaddax.xw $ACCxw, $vf1xw, $vf2w
+ vaddax.xw $ACCxw, $vf31wx, $vf0
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+ vaddi.w $vf0w, $vf31w, $Q
+ vaddi.w $vf1w, $vf2w, $R
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+ vmaddi.xw $vf1xw, $vf2xw, $Ixw
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+ vmaxx.z $vf31x, $vf31z, $vf31x
+ vmaxx.zw $vf1zw, $vf2zw, $vf3zw
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+ vmaxy.z $vf0y, $vf31z, $vf0y
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+ vminix.zw $vf31zw, $vf31zw, $vf31zw
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+ vminiy.x $vf31x, $vf31y, $vf31y
+ vminiy.xw $vf0y, $vf0xw, $vf0y
+ vminiy.xw $vf0xw, $vf0y, $vf31y
+ vminiy.xw $vf0xw, $vf31xw, $vf0xw
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+ vminiy.xyzw $vf0y, $vf0xyzw, $vf31y
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+ vminiy.zw $vf1zw, $vf2zw, $vf3zw
+ vmini.z $vf0z, $vf0z, $vf0x
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+ vminiz.xw $vf0xw, $vf31xw, $vf0xw
+ vminiz.xyw $vf31xyw, $vf0xyw, $vf0xyw
+ vminiz.xyw $vf31xyw, $vf15z, $vf7z
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+ vmr32.xw $vf0xw, $vf0w
+ vmr32.xw $vf0w, $vf31xw
+ vmsubai.xy $ACCxy, $vf31xy, $Q
+ vmsubai.xyw $ACCxyw, $vf0xyw, $0
+ vmsubai.xyw $ACCxyw, $vf1xyw, $ACC
+ vmsubai.xyw $ACCxyw, $vf31xw, $I
+ vmsubaq.y $ACCy, $vf31y, $Qy
+ vmsubaq.yw $ACCw, $vf0yw, $Q
+ vmsubaq.yw $ACCwy, $vf1yw, $Q
+ vmsubaw.x $ACCx, $vf31x, $vf0x
+ vmsubaw.x $ACCx, $vf31w, $vf15w
+ vmsubaw.x $ACCw, $vf31x, $vf31w
+ vmsubaw.xw $ACCw, $vf0xw, $vf0w
+ vmsubaw.xw $ACCxw, $vf0w, $vf31w
+ vmsubaw.xw $ACCxw, $vf1xw, $vf2xw
+ vmsubax.yzw $ACCyzw, $vf0yzw, $vf31yzw
+ vmsubax.z $ACCz, $vf31z, $vf0z
+ vmsuba.y $ACCy, $vf31y, $vf15a
+ vmsuba.yw $ACCyw, $vf31yw, $vf0w
+ vmsubay.x $ACCx, $vf31x, $vf15x
+ vmsubay.x $ACCx, $vf31y, $vf31y
+ vmsubay.xw $ACCxw, $vf0xw, $vf0xw
+ vmsubaz.xy $ACCxy, $vf0xy, $vf31xy
+ vmsubaz.yw $ACCyw, $vf31yw, $vf0yw
+ vmsubi.xyzw $vf31xyzw, $vf0xyzw, $R
+ vmsubw.xyw $vf0xyw, $vf0xyw, $vf0xyw
+ vmsubw.xzw $vf0xzw, $vf0xzw, $vf31xzw
+ vmsubw.y $vf31y, $vf31y, $vf31y
+ vmsubw.yw $vf0yw, $vf0y, $vf0w
+ vmsubw.yw $vf0w, $vf0yw, $vf31w
+ vmsubw.zw $vf0zw, $vf0zw, $vf31zw
+ vmsubx.w $vf0w, $vf0w, $vf0w
+ vmsub.y $vf31y, $vf15y, $vf7w
+ vmsuby.x $vf0x, $vf0x, $vf31x
+ vmsuby.x $vf0x, $vf31y, $vf0y
+ vmsubz.x $vf0x, $vf31x, $vf0x
+ vmulai.xyz $ACCxyz, $vf1xz, $I
+ vmulaq.zw $ACCzw, $vf31zw, $I
+ vmula.w $ACCw, $vf31w, $vf0x
+ vmulax.xz $ACCxz, $vf0xz, $vf31xz
+ vmulax.xz $ACCxz, $vf1x, $vf2x
+ vmulax.xz $ACCx, $vf31xz, $vf0x
+ vmulay.yzw $ACCyzw, $vf0yzw, $vf31yzw
+ vmulaz.w $ACCw, $vf0w, $vf31w
+ mulaz.xy $ACCz, $vf31xy, $vf0z
+ vmulaz.xy $ACCxy, $vf31z, $vf15z
+ vmulaz.z $ACCz, $vf1z, $vf2x
+ vmuli.x $vf31x, $vf15x, $ACC
+ vmulq.x $vf0x, $vf31x, $0
+ vmulq.x $vf1x, $vf2x, $ACC
+ vmulq.x $vf31x, $vf0x, $R
+ vmulq.x $vf31x, $vf15x, $I
+ vmulw.z $vf31z, $vf15z, $vf7z
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+ vmulw.zw $vf0zw, $vf0zw, $vf0zw
+ vmuly.xyzw $vf0xyzw, $vf0y, $vf31y
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+ vmulz.y $vf0y, $vf31y, $vf0y
+ vmulz.y $vf1y, $vf2z, $vf3z
+ vmulz.y $vf31z, $vf0y, $vf0z
+ vmulz.y $vf31z, $vf15z, $vf7z
+ vopmsub $vf0x, $vf0, $vf31
+ vopmsub $vf0, $vf31x, $vf0
+ vopmsub $vf1, $vf2, $vf3x
+ vopmsub $ACC, $vf0, $vf0
+ vopmsub $vf31, $R, $vf7
+ vopmsub $vf31, $vf31, $I
+ vopmsub.xyz $vf0xyz, $vf0xyz, $vf0xy
+ vopmula $0, $vf0, $vf0
+ vopmula $Q, $vf0, $vf31
+ vopmula $R, $vf1, $vf2
+ vopmula $I, $vf31, $vf0
+ vopmula $ACCx, $vf31, $vf15
+ vopmula $ACCxyzw, $vf31, $vf31
+ vopmula.xyz $ACCxyzw, $vf0xyz, $vf0xyz
+ vopmula.xyzw $ACCxyzw, $vf0xyzw, $vf31xyzw
+ vrget.w $vf0w, $0
+ vrget.w $vf1w, $I
+ vrget.w $vf31w, $Q
+ vrget.x $vf0x, $ACC
+ vrget.x $vf1y, $R
+ vrget.xy $vf31x, $R
+ vrget.xyw $vf0xw, $R
+ vrget.xyw $vf1yw, $R
+ vrget.xyw $vf31xy, $R
+ vrget.xyz $vf0xy, $R
+ vrget.xyz $vf1xyzw, $R
+ vrget.xyz $vf31xyzw, $R
+ vrget.xyzw $vf0xyz, $R
+ vrget.xyzw $vf1xzw, $R
+ vrget.xyzw $vf31yzw, $R
+ vrget.xz $vf0xz, $0
+ vrget.xz $vf1z, $R
+ vrget.xzw $vf0xw, $R
+ vrget.y $vf0z, $R
+ vrget.y $vf1y, $I
+ vrget.z $vf31z, $Q
+ vrget.zw $vf0zw, $ACC
+ vrnext.xyzw $vf0xyz, $R
+ vrnext.xyzw $vf1xyzw, $0
+ vrnext.xyzw $vf31xyzw, $Rxyzw
+ vrnext.yz $vf31yz, $Ryz
+ vrnext.z $vf0z, $Rz
+ vrsqrt $Q, $vf0xz, $vf31y
+ vrsqrt $Q, $vf1z, $vf2xz
+ vrsqrt $Q, $vf31yx, $vf15w
+ vrsqrt $Qx, $vf31x, $vf31y
+ vrsqrt $0, $vf31y, $vf0w
+ vrxor $0, $vf0w
+ vrxor $R, $vf0xy
+ vrxor $R, $vf0zw
+ vrxor $R, $vf1yz
+ vrxor $ACC, $vf31x
+ vrxor $Q, $vf31y
+ vsqd.w $vf0, (--$vi0w)
+ vsqd.w $vf0, (--$vi31w)
+ vsqd.x $vf1, (--$vi2x)
+ vsqd.xw $vf0, (--$vi0xw)
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+ vsqd.xyw $vf0, (--$vi0xyw)
+ vsqd.xyz $vf0, (--$vi31xyz)
+ vsqd.xyzw $vf0, (--$vi0xyzw)
+ vsqd.xz $vf0, (--$vi31xz)
+ vsqd.xzw $vf0, (--$vi0xzw)
+ vsqd.y $vf0, (--$vi0y)
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+ vsqd.yz $vf0, (--$vi31yz)
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+ vsqd.yzw $vf0yzw, (--$vi0x)
+ vsqd.z $vf1, (--$vi2z)
+ vsqd.zw $vf1, (--$vi2zw)
+ vsqi.w $vf0, ($vi0w++)
+ vsqi.x $vf0x, ($vi0x++)
+ vsqi.xw $vf0xw, ($vi0xw++)
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+ vsqi.xw $vf31w, ($vi0++)
+ vsqi.xy $vf0, ($vi31xy++)
+ vsqi.xyw $vf0x, ($vi0++)
+ vsqi.xyw $vf0, ($vi31xyw++)
+ vsqi.xyz $vf0xyz, ($vi0xyz++)
+ vsqi.xyzw $vf0, ($vi31xyzw++)
+ vsqi.xz $vf0xz, ($vi0xz++)
+ vsqi.xzw $vf0xzw, ($vi0xzw++)
+ vsqi.y $vf1, ($vi2y++)
+ vsqi.yw $vf0yw, ($vi0yw++)
+ vsqi.yz $vf1, ($vi2yz++)
+ vsqi.yzw $vf0yzw, ($vi0yzw++)
+ vsqi.z $vf0, ($vi31z++)
+ vsqi.zw $vf0zw, ($vi0zw++)
+ vsqrt $Q, $vf1zw
+ vsqrt $Q, $vf31xw
+ vsqrt $Q, $vf31xy
+ vsubai.w $ACCw, $vf0w, $0
+ vsubai.w $ACCw, $vf1x, $I
+ vsubai.w $ACCx, $vf31w, $I
+ vsubai.x $ACCw, $vf31x, $I
+ vsubai.xw $ACCw, $vf0xw, $I
+ vsubai.xw $ACCxw, $vf1x, $I
+ vsubai.xw $ACCxw, $vf31xw, $0
+ vsubai.xy $ACCxy, $vf0y, $I
+ vsubai.xy $ACCxy, $vf1x, $I
+ vsubai.xy $ACCxy, $vf311xy, $I
+ vsubai.xyz $ACCxyz, $vf1yz, $I
+ vsubai.xyz $ACCxyz, $vf31xyz, $ACC
+ vsubai.xyzw $ACCxyzw, $vf0xyzw, $R
+ vsubai.xyzw $ACCxyzw, $vf1xyzw, $Q
+ vsubai.xz $ACCxz, $vf1z, $I
+ vsubai.y $ACCy, $vf31, $3
+ vsubai.yw $ACCyw, $vf0yw, $Iyw
+ vsubai.zw $ACCzw, $vf1zw, $Izw
+ vsubai.zw $ACCzw, $vf31w, $I
+ vsubaq.w $ACCw, $Q, $Q
+ vsubaq.w $ACCw, $I, $Q
+ vsubaq.xyw $ACCxyw, $vf0xw, $Q
+ vsubaq.xyzw $ACCxyzw, $vf0xyz, $Q
+ vsubaq.xzw $ACCxzw, $vf1xw, $Q
+ vsubaq.yw $ACCyw, $vf31y, $Q
+ vsubaq.yz $ACCyz, $vf0yz, $ACC
+ vsubaq.yz $ACCyz, $vf1yz, $I
+ vsubax.w $ACCw, $vf0w, $vf0w
+ vsubax.w $ACCw, $vf0x, $vf31x
+ vsubax.w $ACCx, $vf1w, $vf2x
+ vsubax.w $ACCx, $vf31x, $vf0x
+ vsubax.xyzw $ACCxyzw, $vf31xyzw, $vf0xyzw
+ vsubax.xzw $ACCxzw, $vf1xzw, $vf2xzw
+ vsubax.y $ACCy, $vf1y, $vf2
+ vsubax.y $ACCy, $vf31y, $vf0y
+ vsubax.yw $ACCyw, $vf0yw, $vf0yw
+ vsubay.yw $ACCyw, $vf0yw, $vf31yw
+ vsubay.yzw $ACCyzw, $vf0yzw, $vf31yzw
+ vsubay.z $ACCz, $vf0z, $vf31z
+ vsubay.zw $ACCzw, $vf0zw, $vf0zw
+ vsubaz.w $ACCw, $vf31w, $vf15w
+ vsubaz.x $ACCx, $vf0x, $vf31x
+ vsubaz.xy $ACCxy, $vf0xy, $vf0xy
+ vsubaz.xz $ACCxz, $vf31xz, $vf15xz
+ vsubaz.xz $ACCxz, $vf31z, $vf31z
+ vsubaz.xzw $ACCxw, $vf0xzw, $vf0z
+ vsubaz.xzw $ACCz, $vf0xzw, $vf31z
+ vsubaz.xzw $ACCxzw, $vf1z, $vf2z
+ vsubaz.yw $ACCyw, $vf1yw, $vf2yw
+ vsubi.w $vf31w, $vf15w, $0
+ vsubi.w $vf31w, $vf31w, $R
+ vsubi.x $vf0x, $vf0y, $I
+ vsubi.x $vf0x, $vf31x, $Ix
+ vsubi.xy $vf0xy, $vf31y, $I
+ vsubi.xy $vf1x, $vf2xy, $I
+ vsubq.x $vf31x, $vf15x, $Qx
+ vsubq.x $vf31x, $vf31y, $Q
+ vsubq.xw $vf0xw, $vf0xw, $0
+ vsubq.xw $vf0xw, $vf31xw, $2
+ vsubq.xyzw $vf1yzw, $vf2xyzw, $Q
+ vsubq.yw $vf31w, $vf15yw, $Q
+ vsubq.yw $vf31yw, $vf31y, $Q
+ vsubx.xyw $vf0xyw, $vf31xyw, $vf0xyw
+ vsubx.xzw $vf1xzw, $vf2xzw, $vf3xzw
+ vsuby.xw $vf0xw, $vf0xw, $vf0xw
+ vsuby.zw $vf0zw, $vf0zw, $vf0zw
+ vsub.z $vf0z, $vf31z, $vf0x
+ vsubz.xyw $vf31yw, $vf15xyw, $vf7z
+ vsubz.xyw $vf31xyw, $vf31yw, $vf31z
+ vsubz.xyz $vf0xyz, $vf0xyz, $vf0x
+ vwaitq $vf0x
+
+# Force at least 8 (non-delay-slot) zero bytes, to make 'objdump' print ...
+ .space 8
diff --git a/gas/testsuite/gas/mips/r5900-full-vu0.d b/gas/testsuite/gas/mips/r5900-full-vu0.d
new file mode 100644
index 0000000..be0bf5b
--- /dev/null
+++ b/gas/testsuite/gas/mips/r5900-full-vu0.d
@@ -0,0 +1,194 @@
+#objdump: -dr --prefix-addresses --show-raw-insn -M gpr-names=numeric -mmips:5900
+#name: MIPS R5900 Full VU0
+#as: -march=r5900
+
+.*: +file format .*mips.*
+
+Disassembly of section \.text:
+[0-9a-f]+ <[^>]*> 4be0f9fd vabs\.xyzw \$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4be0faa8 vadd\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4be0faa2 vaddi\.xyzw \$vf10xyzw,\$vf31xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be0faa0 vaddq\.xyzw \$vf10xyzw,\$vf31xyzw,\$Q
+[0-9a-f]+ <[^>]*> 4be1fa83 vaddw\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1w
+[0-9a-f]+ <[^>]*> 4be1fa80 vaddx\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1x
+[0-9a-f]+ <[^>]*> 4be1fa81 vaddy\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1y
+[0-9a-f]+ <[^>]*> 4be1fa82 vaddz\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1z
+[0-9a-f]+ <[^>]*> 4be0fabc vadda\.xyzw \$ACCxyzw,\$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4be0fa3e vaddai\.xyzw \$ACCxyzw,\$vf31xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be0fa3c vaddaq\.xyzw \$ACCxyzw,\$vf31xyzw,\$Q
+[0-9a-f]+ <[^>]*> 4be1f83f vaddaw\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1w
+[0-9a-f]+ <[^>]*> 4be1f83c vaddax\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1x
+[0-9a-f]+ <[^>]*> 4be1f83d vadday\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1y
+[0-9a-f]+ <[^>]*> 4be1f83e vaddaz\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1z
+[0-9a-f]+ <[^>]*> 4a000038 vcallms 0x0
+[0-9a-f]+ <[^>]*> 4a001a38 vcallms 0x340
+[0-9a-f]+ <[^>]*> 4a007ff8 vcallms 0xff8
+[0-9a-f]+ <[^>]*> 4a00d839 vcallmsr \$vi27
+[0-9a-f]+ <[^>]*> 4bc1f9ff vclipw\.xyz \$vf31xyz,\$vf1w
+[0-9a-f]+ <[^>]*> 4a2b0bbc vdiv \$Q,\$vf1y,\$vf11x
+[0-9a-f]+ <[^>]*> 4be0f97c vftoi0\.xyzw \$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4be0f97d vftoi4\.xyzw \$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4be0f97e vftoi12\.xyzw \$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4be0f97f vftoi15\.xyzw \$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4a007870 viadd \$vi1,\$vi15,\$vi0
+[0-9a-f]+ <[^>]*> 4a007ff2 viaddi \$vi0,\$vi15,-1
+[0-9a-f]+ <[^>]*> 4a007874 viand \$vi1,\$vi15,\$vi0
+[0-9a-f]+ <[^>]*> 4a207bfe vilwr\.w \$vi0,\(\$vi15\)
+[0-9a-f]+ <[^>]*> 4b007bfe vilwr\.x \$vi0,\(\$vi15\)
+[0-9a-f]+ <[^>]*> 4a807bfe vilwr\.y \$vi0,\(\$vi15\)
+[0-9a-f]+ <[^>]*> 4a407bfe vilwr\.z \$vi0,\(\$vi15\)
+[0-9a-f]+ <[^>]*> 4a007875 vior \$vi1,\$vi15,\$vi0
+[0-9a-f]+ <[^>]*> 4a207bff viswr\.w \$vi0,\(\$vi15\)
+[0-9a-f]+ <[^>]*> 4b007bff viswr\.x \$vi0,\(\$vi15\)
+[0-9a-f]+ <[^>]*> 4a807bff viswr\.y \$vi0,\(\$vi15\)
+[0-9a-f]+ <[^>]*> 4a407bff viswr\.z \$vi0,\(\$vi15\)
+[0-9a-f]+ <[^>]*> 4a007871 visub \$vi1,\$vi15,\$vi0
+[0-9a-f]+ <[^>]*> 4be0f93c vitof0\.xyzw \$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4be0f93d vitof4\.xyzw \$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4be0f93e vitof12\.xyzw \$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4be0f93f vitof15\.xyzw \$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4be07b7e vlqd\.xyzw \$vf0xyzw,\(\-\-\$vi15\)
+[0-9a-f]+ <[^>]*> 4be07b7c vlqi\.xyzw \$vf0xyzw,\(\$vi15\+\+\)
+[0-9a-f]+ <[^>]*> 4be0faa9 vmadd\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4be0faa3 vmaddi\.xyzw \$vf10xyzw,\$vf31xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be0faa1 vmaddq\.xyzw \$vf10xyzw,\$vf31xyzw,\$Q
+[0-9a-f]+ <[^>]*> 4be1fa8b vmaddw\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1w
+[0-9a-f]+ <[^>]*> 4be1fa88 vmaddx\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1x
+[0-9a-f]+ <[^>]*> 4be1fa89 vmaddy\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1y
+[0-9a-f]+ <[^>]*> 4be1fa8a vmaddz\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1z
+[0-9a-f]+ <[^>]*> 4be0fabd vmadda\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4be0fa3f vmaddai\.xyzw \$ACCxyzw,\$vf31xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be0fa3d vmaddaq\.xyzw \$ACCxyzw,\$vf31xyzw,\$Q
+[0-9a-f]+ <[^>]*> 4be1f8bf vmaddaw\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1w
+[0-9a-f]+ <[^>]*> 4be1f8bc vmaddax\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1x
+[0-9a-f]+ <[^>]*> 4be1f8bd vmadday\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1y
+[0-9a-f]+ <[^>]*> 4be1f8be vmaddaz\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1z
+[0-9a-f]+ <[^>]*> 4be0faab vmax\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4be0fa9d vmaxi\.xyzw \$vf10xyzw,\$vf31xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be1fa93 vmaxw\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1w
+[0-9a-f]+ <[^>]*> 4be1fa90 vmaxx\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1x
+[0-9a-f]+ <[^>]*> 4be1fa91 vmaxy\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1y
+[0-9a-f]+ <[^>]*> 4be1fa92 vmaxz\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1z
+[0-9a-f]+ <[^>]*> 4be07bfd vmfir\.xyzw \$vf0xyzw,\$vi15
+[0-9a-f]+ <[^>]*> 4be0faaf vmini\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4be0fa9f vminii\.xyzw \$vf10xyzw,\$vf31xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be1fa97 vminiw\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1w
+[0-9a-f]+ <[^>]*> 4be1fa94 vminix\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1x
+[0-9a-f]+ <[^>]*> 4be1fa95 vminiy\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1y
+[0-9a-f]+ <[^>]*> 4be1fa96 vminiz\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1z
+[0-9a-f]+ <[^>]*> 4be0fb3c vmove\.xyzw \$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4be0fb3d vmr32\.xyzw \$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4be0faad vmsub\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4be0faa7 vmsubi\.xyzw \$vf10xyzw,\$vf31xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be0faa5 vmsubq\.xyzw \$vf10xyzw,\$vf31xyzw,\$Q
+[0-9a-f]+ <[^>]*> 4be1fa8f vmsubw\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1w
+[0-9a-f]+ <[^>]*> 4be1fa8c vmsubx\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1x
+[0-9a-f]+ <[^>]*> 4be1fa8d vmsuby\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1y
+[0-9a-f]+ <[^>]*> 4be1fa8e vmsubz\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1z
+[0-9a-f]+ <[^>]*> 4be0fafd vmsuba\.xyzw \$ACCxyzw,\$vf0xyzw,\$vf31xyzw
+[0-9a-f]+ <[^>]*> 4be0fa7f vmsubai\.xyzw \$ACCxyzw,\$vf31xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be0fa7d vmsubaq\.xyzw \$ACCxyzw,\$vf31xyzw,\$Q
+[0-9a-f]+ <[^>]*> 4be1f8ff vmsubaw\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1w
+[0-9a-f]+ <[^>]*> 4be1f8fc vmsubax\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1x
+[0-9a-f]+ <[^>]*> 4be1f8fd vmsubay\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1y
+[0-9a-f]+ <[^>]*> 4be1f8fe vmsubaz\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1z
+[0-9a-f]+ <[^>]*> 4a400bfc vmtir \$vi0,\$vf1z
+[0-9a-f]+ <[^>]*> 4be0faaa vmul\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4be0fa9e vmuli\.xyzw \$vf10xyzw,\$vf31xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be0fa9c vmulq\.xyzw \$vf10xyzw,\$vf31xyzw,\$Q
+[0-9a-f]+ <[^>]*> 4be1fa9b vmulw\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1w
+[0-9a-f]+ <[^>]*> 4be1fa98 vmulx\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1x
+[0-9a-f]+ <[^>]*> 4be1fa99 vmuly\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1y
+[0-9a-f]+ <[^>]*> 4be1fa9a vmulz\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1z
+[0-9a-f]+ <[^>]*> 4be0fabe vmula\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4be0f9fe vmulai\.xyzw \$ACCxyzw,\$vf31xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be0f9fc vmulaq\.xyzw \$ACCxyzw,\$vf31xyzw,\$Q
+[0-9a-f]+ <[^>]*> 4be1f9bf vmulaw\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1w
+[0-9a-f]+ <[^>]*> 4be1f9bc vmulax\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1x
+[0-9a-f]+ <[^>]*> 4be1f9bd vmulay\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1y
+[0-9a-f]+ <[^>]*> 4be1f9be vmulaz\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1z
+[0-9a-f]+ <[^>]*> 4a0002ff vnop
+[0-9a-f]+ <[^>]*> 4bc0fafe vopmula\.xyz \$ACCxyz,\$vf31xyz,\$vf0xyz
+[0-9a-f]+ <[^>]*> 4bc0faae vopmsub\.xyz \$vf10xyz,\$vf31xyz,\$vf0xyz
+[0-9a-f]+ <[^>]*> 4be0043d vrget.xyzw \$vf0xyzw,\$R
+[0-9a-f]+ <[^>]*> 4a600c3e vrinit \$R,\$vf1w
+[0-9a-f]+ <[^>]*> 4be0043c vrnext\.xyzw \$vf0xyzw,\$R
+[0-9a-f]+ <[^>]*> 4a6b0bbe vrsqrt \$Q,\$vf1w,\$vf11x
+[0-9a-f]+ <[^>]*> 4a000c3f vrxor \$R,\$vf1x
+[0-9a-f]+ <[^>]*> 4be0fb7f vsqd\.xyzw \$vf31xyzw,\(\-\-\$vi0\)
+[0-9a-f]+ <[^>]*> 4be0fb7d vsqi\.xyzw \$vf31xyzw,\(\$vi0\+\+\)
+[0-9a-f]+ <[^>]*> 4b2b03bd vsqrt \$Q,\$vf11z
+[0-9a-f]+ <[^>]*> 4be0faac vsub\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4be0faa6 vsubi\.xyzw \$vf10xyzw,\$vf31xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be0faa4 vsubq\.xyzw \$vf10xyzw,\$vf31xyzw,\$Q
+[0-9a-f]+ <[^>]*> 4be1fa87 vsubw\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1w
+[0-9a-f]+ <[^>]*> 4be1fa84 vsubx\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1x
+[0-9a-f]+ <[^>]*> 4be1fa85 vsuby\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1y
+[0-9a-f]+ <[^>]*> 4be1fa86 vsubz\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf1z
+[0-9a-f]+ <[^>]*> 4be0fafc vsuba\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4be0fa7e vsubai\.xyzw \$ACCxyzw,\$vf31xyzw,\$I
+[0-9a-f]+ <[^>]*> 4be0fa7c vsubaq\.xyzw \$ACCxyzw,\$vf31xyzw,\$Q
+[0-9a-f]+ <[^>]*> 4be1f87f vsubaw\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1w
+[0-9a-f]+ <[^>]*> 4be1f87c vsubax\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1x
+[0-9a-f]+ <[^>]*> 4be1f87d vsubay\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1y
+[0-9a-f]+ <[^>]*> 4be1f87e vsubaz\.xyzw \$ACCxyzw,\$vf31xyzw,\$vf1z
+[0-9a-f]+ <[^>]*> 4a0003bf vwaitq
+[0-9a-f]+ <[^>]*> 4be0faa8 vadd\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4b80faa8 vadd\.xy \$vf10xy,\$vf31xy,\$vf0xy
+[0-9a-f]+ <[^>]*> 4be0faa8 vadd\.xyzw \$vf10xyzw,\$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4b807b7c vlqi\.xy \$vf0xy,\(\$vi15\+\+\)
+[0-9a-f]+ <[^>]*> 4be20828 vadd\.xyzw \$vf0xyzw,\$vf1xyzw,\$vf2xyzw
+[0-9a-f]+ <[^>]*> 4be520e8 vadd\.xyzw \$vf3xyzw,\$vf4xyzw,\$vf5xyzw
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+[0-9a-f]+ <[^>]*> 4bee6b28 vadd\.xyzw \$vf12xyzw,\$vf13xyzw,\$vf14xyzw
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+[0-9a-f]+ <[^>]*> 4bf49ca8 vadd\.xyzw \$vf18xyzw,\$vf19xyzw,\$vf20xyzw
+[0-9a-f]+ <[^>]*> 4bf7b568 vadd\.xyzw \$vf21xyzw,\$vf22xyzw,\$vf23xyzw
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+[0-9a-f]+ <[^>]*> 4be0ffa8 vadd\.xyzw \$vf30xyzw,\$vf31xyzw,\$vf0xyzw
+[0-9a-f]+ <[^>]*> 4a020830 viadd \$vi0,\$vi1,\$vi2
+[0-9a-f]+ <[^>]*> 4a0520f0 viadd \$vi3,\$vi4,\$vi5
+[0-9a-f]+ <[^>]*> 4a0839b0 viadd \$vi6,\$vi7,\$vi8
+[0-9a-f]+ <[^>]*> 4a0b5270 viadd \$vi9,\$vi10,\$vi11
+[0-9a-f]+ <[^>]*> 4a0e6b30 viadd \$vi12,\$vi13,\$vi14
+[0-9a-f]+ <[^>]*> 4a1183f0 viadd \$vi15,\$vi16,\$vi17
+[0-9a-f]+ <[^>]*> 4a149cb0 viadd \$vi18,\$vi19,\$vi20
+[0-9a-f]+ <[^>]*> 4a17b570 viadd \$vi21,\$vi22,\$vi23
+[0-9a-f]+ <[^>]*> 4a1ace30 viadd \$vi24,\$vi25,\$vi26
+[0-9a-f]+ <[^>]*> 4a1de6f0 viadd \$vi27,\$vi28,\$vi29
+[0-9a-f]+ <[^>]*> 4a00ffb0 viadd \$vi30,\$vi31,\$vi0
+[0-9a-f]+ <[^>]*> d8000000 lqc2 \$vf0,0\(\$0\)
+[0-9a-f]+ <[^>]*> d8217fff lqc2 \$vf1,32767\(\$1\)
+[0-9a-f]+ <[^>]*> d9088000 lqc2 \$vf8,-32768\(\$8\)
+[0-9a-f]+ <[^>]*> dbffffff lqc2 \$vf31,-1\(\$31\)
+[0-9a-f]+ <[^>]*> f8000000 sqc2 \$vf0,0\(\$0\)
+[0-9a-f]+ <[^>]*> f8217fff sqc2 \$vf1,32767\(\$1\)
+[0-9a-f]+ <[^>]*> f9088000 sqc2 \$vf8,-32768\(\$8\)
+[0-9a-f]+ <[^>]*> fbffffff sqc2 \$vf31,-1\(\$31\)
+[0-9a-f]+ <[^>]*> 48400000 cfc2 \$0,\$vi0
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+[0-9a-f]+ <[^>]*> 4840f801 cfc2\.i \$0,\$vi31
+[0-9a-f]+ <[^>]*> 48400000 cfc2 \$0,\$vi0
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+[0-9a-f]+ <[^>]*> 48c0f800 ctc2 \$0,\$vi31
+[0-9a-f]+ <[^>]*> 48c00001 ctc2\.i \$0,\$vi0
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+[0-9a-f]+ <[^>]*> 48a0f800 qmtc2 \$0,\$vf31
+ \.\.\.
diff --git a/gas/testsuite/gas/mips/r5900-full-vu0.s b/gas/testsuite/gas/mips/r5900-full-vu0.s
new file mode 100644
index 0000000..a26235b
--- /dev/null
+++ b/gas/testsuite/gas/mips/r5900-full-vu0.s
@@ -0,0 +1,214 @@
+ .set noreorder
+ .set noat
+
+ .globl text_label .text
+text_label:
+
+ # VU Macromode instruction set
+ vabs.xyzw $vf0xyzw,$vf31xyzw
+ vadd.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vaddi.xyzw $vf10xyzw,$vf31xyzw,$I
+ vaddq.xyzw $vf10xyzw,$vf31xyzw,$Q
+ vaddw.xyzw $vf10xyzw,$vf31xyzw,$vf1w
+ vaddx.xyzw $vf10xyzw,$vf31xyzw,$vf1x
+ vaddy.xyzw $vf10xyzw,$vf31xyzw,$vf1y
+ vaddz.xyzw $vf10xyzw,$vf31xyzw,$vf1z
+ vadda.xyzw $ACCxyzw,$vf0xyzw,$vf31xyzw
+ vaddai.xyzw $ACCxyzw,$vf31xyzw,$I
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+ vcallms 0x0
+ vcallms 0x340
+ vcallms 0xff8
+ vcallmsr $vi27
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+ vdiv $Q,$vf1y,$vf11x
+ vftoi0.xyzw $vf0xyzw,$vf31xyzw
+ vftoi4.xyzw $vf0xyzw,$vf31xyzw
+ vftoi12.xyzw $vf0xyzw,$vf31xyzw
+ vftoi15.xyzw $vf0xyzw,$vf31xyzw
+ viadd $vi1,$vi15,$vi0
+ viaddi $vi0,$vi15,-1
+ viand $vi1,$vi15,$vi0
+ vilwr.w $vi0,($vi15)
+ vilwr.x $vi0,($vi15)
+ vilwr.y $vi0,($vi15)
+ vilwr.z $vi0,($vi15)
+ vior $vi1,$vi15,$vi0
+ viswr.w $vi0,($vi15)
+ viswr.x $vi0,($vi15)
+ viswr.y $vi0,($vi15)
+ viswr.z $vi0,($vi15)
+ visub $vi1,$vi15,$vi0
+ vitof0.xyzw $vf0xyzw,$vf31xyzw
+ vitof4.xyzw $vf0xyzw,$vf31xyzw
+ vitof12.xyzw $vf0xyzw,$vf31xyzw
+ vitof15.xyzw $vf0xyzw,$vf31xyzw
+ vlqd.xyzw $vf0xyzw,(--$vi15)
+ vlqi.xyzw $vf0xyzw,($vi15++)
+ vmadd.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vmaddi.xyzw $vf10xyzw,$vf31xyzw,$I
+ vmaddq.xyzw $vf10xyzw,$vf31xyzw,$Q
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+ vmaddx.xyzw $vf10xyzw,$vf31xyzw,$vf1x
+ vmaddy.xyzw $vf10xyzw,$vf31xyzw,$vf1y
+ vmaddz.xyzw $vf10xyzw,$vf31xyzw,$vf1z
+ vmadda.xyzw $ACCxyzw,$vf31xyzw,$vf0xyzw
+ vmaddai.xyzw $ACCxyzw,$vf31xyzw,$I
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+ vmaddax.xyzw $ACCxyzw,$vf31xyzw,$vf1x
+ vmadday.xyzw $ACCxyzw,$vf31xyzw,$vf1y
+ vmaddaz.xyzw $ACCxyzw,$vf31xyzw,$vf1z
+ vmax.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vmaxi.xyzw $vf10xyzw,$vf31xyzw,$I
+ vmaxw.xyzw $vf10xyzw,$vf31xyzw,$vf1w
+ vmaxx.xyzw $vf10xyzw,$vf31xyzw,$vf1x
+ vmaxy.xyzw $vf10xyzw,$vf31xyzw,$vf1y
+ vmaxz.xyzw $vf10xyzw,$vf31xyzw,$vf1z
+ vmfir.xyzw $vf0xyzw,$vi15
+ vmini.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vminii.xyzw $vf10xyzw,$vf31xyzw,$I
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+ vmove.xyzw $vf0xyzw,$vf31xyzw
+ vmr32.xyzw $vf0xyzw,$vf31xyzw
+ vmsub.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vmsubi.xyzw $vf10xyzw,$vf31xyzw,$I
+ vmsubq.xyzw $vf10xyzw,$vf31xyzw,$Q
+ vmsubw.xyzw $vf10xyzw,$vf31xyzw,$vf1w
+ vmsubx.xyzw $vf10xyzw,$vf31xyzw,$vf1x
+ vmsuby.xyzw $vf10xyzw,$vf31xyzw,$vf1y
+ vmsubz.xyzw $vf10xyzw,$vf31xyzw,$vf1z
+ vmsuba.xyzw $ACCxyzw,$vf0xyzw,$vf31xyzw
+ vmsubai.xyzw $ACCxyzw,$vf31xyzw,$I
+ vmsubaq.xyzw $ACCxyzw,$vf31xyzw,$Q
+ vmsubaw.xyzw $ACCxyzw,$vf31xyzw,$vf1w
+ vmsubax.xyzw $ACCxyzw,$vf31xyzw,$vf1x
+ vmsubay.xyzw $ACCxyzw,$vf31xyzw,$vf1y
+ vmsubaz.xyzw $ACCxyzw,$vf31xyzw,$vf1z
+ vmtir $vi0,$vf1z
+ vmul.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vmuli.xyzw $vf10xyzw,$vf31xyzw,$I
+ vmulq.xyzw $vf10xyzw,$vf31xyzw,$Q
+ vmulw.xyzw $vf10xyzw,$vf31xyzw,$vf1w
+ vmulx.xyzw $vf10xyzw,$vf31xyzw,$vf1x
+ vmuly.xyzw $vf10xyzw,$vf31xyzw,$vf1y
+ vmulz.xyzw $vf10xyzw,$vf31xyzw,$vf1z
+ vmula.xyzw $ACCxyzw,$vf31xyzw,$vf0xyzw
+ vmulai.xyzw $ACCxyzw,$vf31xyzw,$I
+ vmulaq.xyzw $ACCxyzw,$vf31xyzw,$Q
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+ vmulay.xyzw $ACCxyzw,$vf31xyzw,$vf1y
+ vmulaz.xyzw $ACCxyzw,$vf31xyzw,$vf1z
+ vnop
+ vopmula.xyz $ACCxyz,$vf31xyz,$vf0xyz
+ vopmsub.xyz $vf10xyz,$vf31xyz,$vf0xyz
+ vrget.xyzw $vf0xyzw,$R
+ vrinit $R,$vf1w
+ vrnext.xyzw $vf0xyzw,$R
+ vrsqrt $Q,$vf1w,$vf11x
+ vrxor $R,$vf1x
+ vsqd.xyzw $vf31xyzw,(--$vi0)
+ vsqi.xyzw $vf31xyzw,($vi0++)
+ vsqrt $Q,$vf11z
+ vsub.xyzw $vf10xyzw,$vf31xyzw,$vf0xyzw
+ vsubi.xyzw $vf10xyzw,$vf31xyzw,$I
+ vsubq.xyzw $vf10xyzw,$vf31xyzw,$Q
+ vsubw.xyzw $vf10xyzw,$vf31xyzw,$vf1w
+ vsubx.xyzw $vf10xyzw,$vf31xyzw,$vf1x
+ vsuby.xyzw $vf10xyzw,$vf31xyzw,$vf1y
+ vsubz.xyzw $vf10xyzw,$vf31xyzw,$vf1z
+ vsuba.xyzw $ACCxyzw,$vf31xyzw,$vf0xyzw
+ vsubai.xyzw $ACCxyzw,$vf31xyzw,$I
+ vsubaq.xyzw $ACCxyzw,$vf31xyzw,$Q
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+ vsubax.xyzw $ACCxyzw,$vf31xyzw,$vf1x
+ vsubay.xyzw $ACCxyzw,$vf31xyzw,$vf1y
+ vsubaz.xyzw $ACCxyzw,$vf31xyzw,$vf1z
+ vwaitq
+
+ # Implicit suffixes
+ vadd.xyzw $vf10,$vf31,$vf0
+ vadd.xy $vf10,$vf31,$vf0
+ vadd.xyzw $vf10,$vf31,$vf0
+ vlqi.xy $vf0,($vi15++)
+
+ # VU floating point registers
+ vadd.xyzw $vf0,$vf1,$vf2
+ vadd.xyzw $vf3,$vf4,$vf5
+ vadd.xyzw $vf6,$vf7,$vf8
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+ vadd.xyzw $vf12,$vf13,$vf14
+ vadd.xyzw $vf15,$vf16,$vf17
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+ vadd.xyzw $vf21,$vf22,$vf23
+ vadd.xyzw $vf24,$vf25,$vf26
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+ vadd.xyzw $vf30,$vf31,$vf0
+
+ # VU integer registers
+ viadd $vi0,$vi1,$vi2
+ viadd $vi3,$vi4,$vi5
+ viadd $vi6,$vi7,$vi8
+ viadd $vi9,$vi10,$vi11
+ viadd $vi12,$vi13,$vi14
+ viadd $vi15,$vi16,$vi17
+ viadd $vi18,$vi19,$vi20
+ viadd $vi21,$vi22,$vi23
+ viadd $vi24,$vi25,$vi26
+ viadd $vi27,$vi28,$vi29
+ viadd $vi30,$vi31,$vi0
+
+ # Floating point transfer to VU
+ lqc2 $0,0($0)
+ lqc2 $1, 0x7fff($1)
+ lqc2 $8, -0x8000($8)
+ lqc2 $31, -1($31)
+
+ # Floating point transfer from VU
+ sqc2 $0,0($0)
+ sqc2 $1, 0x7fff($1)
+ sqc2 $8, -0x8000($8)
+ sqc2 $31, -1($31)
+
+ # Integer transfer from VU
+ cfc2 $0,$0
+ cfc2 $0,$31
+ cfc2.i $0,$0
+ cfc2.i $0,$31
+ cfc2.ni $0,$0
+ cfc2.ni $0,$31
+
+ # Integer transfer to VU
+ ctc2 $0,$0
+ ctc2 $0,$31
+ ctc2.i $0,$0
+ ctc2.i $0,$31
+ ctc2.ni $0,$0
+ ctc2.ni $0,$31
+
+ # Floating point transfer from VU
+ qmfc2 $0,$0
+ qmfc2 $0,$31
+ qmfc2.i $0,$0
+ qmfc2.i $0,$31
+ qmfc2.ni $0,$0
+ qmfc2.ni $0,$31
+
+ # Floating point transfer to VU
+ qmtc2 $0,$0
+ qmtc2 $0,$31
+ qmtc2.i $0,$0
+ qmtc2.i $0,$31
+ qmtc2.ni $0,$0
+ qmtc2.ni $0,$31
+
+# Force at least 8 (non-delay-slot) zero bytes, to make 'objdump' print ...
+ .space 8
diff --git a/gas/testsuite/gas/mips/r5900-vu0.d b/gas/testsuite/gas/mips/r5900-vu0.d
index 8375946..268c7d6 100644
--- a/gas/testsuite/gas/mips/r5900-vu0.d
+++ b/gas/testsuite/gas/mips/r5900-vu0.d
@@ -5,56 +5,56 @@
.*: +file format .*mips.*
Disassembly of section \.text:
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+[0-9a-f]+ <[^>]*> d8208000 lqc2 \$vf0,-32768\(\$1\)
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+[0-9a-f]+ <[^>]*> d8287fff lqc2 \$vf8,32767\(\$1\)
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