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path: root/include/dt-bindings/clock/qcom,gcc-msm8953.h
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/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */

#ifndef _DT_BINDINGS_CLK_MSM_GCC_8953_H
#define _DT_BINDINGS_CLK_MSM_GCC_8953_H

/* Clocks */
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#define BLSP1_QUP3_SPI_APPS_CLK_SRC		8
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#define BLSP2_QUP4_I2C_APPS_CLK_SRC		19
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#define GPLL3					180
#define GPLL3_EARLY				181
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#define GPLL4_EARLY				183
#define GPLL6					184
#define GPLL6_EARLY				185
#define JPEG0_CLK_SRC				186
#define MCLK0_CLK_SRC				187
#define MCLK1_CLK_SRC				188
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#define MDP_CLK_SRC				191
#define PCLK0_CLK_SRC				192
#define PCLK1_CLK_SRC				193
#define PDM2_CLK_SRC				194
#define RBCPR_GFX_CLK_SRC			195
#define SDCC1_APPS_CLK_SRC			196
#define SDCC1_ICE_CORE_CLK_SRC			197
#define SDCC2_APPS_CLK_SRC			198
#define USB30_MASTER_CLK_SRC			199
#define USB30_MOCK_UTMI_CLK_SRC			200
#define USB3_AUX_CLK_SRC			201
#define VCODEC0_CLK_SRC				202
#define VFE0_CLK_SRC				203
#define VFE1_CLK_SRC				204
#define VSYNC_CLK_SRC				205

/* GCC block resets */
#define GCC_CAMSS_MICRO_BCR			0
#define GCC_MSS_BCR				1
#define GCC_QUSB2_PHY_BCR			2
#define GCC_USB3PHY_PHY_BCR			3
#define GCC_USB3_PHY_BCR			4
#define GCC_USB_30_BCR				5

/* GDSCs */
#define CPP_GDSC				0
#define JPEG_GDSC				1
#define MDSS_GDSC				2
#define OXILI_CX_GDSC				3
#define OXILI_GX_GDSC				4
#define USB30_GDSC				5
#define VENUS_CORE0_GDSC			6
#define VENUS_GDSC				7
#define VFE0_GDSC				8
#define VFE1_GDSC				9

#endif